专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]三维存储器件及其制造方法-CN202210276258.9在审
  • 孙昌志;夏志良;刘小欣;高庭庭;杜小龙;刘佳裔 - 长江存储科技有限责任公司
  • 2022-03-21 - 2022-06-24 - H01L27/1157
  • 本发明提供三维存储器件及其制造方法,制造方法包括:提供衬底,衬底上形有堆叠结构,堆叠结构包括交替层叠的牺牲层和绝缘层;沿垂直于衬底的纵向上形成贯穿堆叠结构的沟道孔;在沟道孔的内壁上形成第一功能层以及对应覆盖在第一功能层上的第二功能层,其中第一功能层包括沿围绕于沟道孔的中心轴线的方向上相互隔开的多个子电荷捕获层,第二功能层包括围绕于中心轴线的方向上相互隔开的多个子沟道层;在多个子沟道层的内表面上形成介质层,以使沟道孔被介质层填充。由于相互隔开的多个子沟道层形成多条存储串,一个子沟道层位于一个存储串中,不需要增加堆栈的层数就提高存储密度,相互隔开的多个子存储层避免相邻存储串之间发生串扰现象。
  • 三维存储器件及其制造方法
  • [实用新型]具有p埋层的纵向沟道SOI nLDMOS器件单元-CN201120060193.1无效
  • 张海鹏;许生根;刘怡新;吴倩倩;孔令军;汪洋;赵伟立 - 杭州电子科技大学
  • 2011-03-10 - 2011-10-26 - H01L29/78
  • 本实用新型涉及一种具有p埋层的纵向沟道SOI nLDMOS器件单元。现有产品限制了器件结构与电学特性的改善。本实用新型包括p型半导体衬底、隐埋氧化层、p型埋层区、n型轻掺杂漂移区、p型阱区、p型欧姆接触区、n型源区、纵向栅氧化层、n型缓冲区、n型漏区、场氧区、纵向n型多晶硅栅极和金属电极引线。器件上部设置有深沟槽纵向栅氧化层、两个场氧化层、纵向n型多晶硅栅极以及金属层。本实用新型在n型轻掺杂漂移区与隐埋氧化层之间引入p型埋层区,当器件处于正向阻断态且漏源之间存在高压时,形成的反向偏置pn结能够承受器件绝大部分纵向耐压,提高了器件的纵向耐压性能,改善了器件电学特性的热稳定性
  • 具有纵向沟道soinldmos器件单元
  • [发明专利]一种新型数字门集成电路的结构-CN201911306273.8在审
  • 廖永波;李平;唐瑞枫;林凡;李垚森;曾祥和;胡兆晞;邹佳瑞;聂瑞宏;彭辰曦;冯轲 - 电子科技大学
  • 2019-12-18 - 2020-04-21 - H01L29/06
  • 本发明的一种新型数字门集成电路的结构为纵向N型或P型TMOS,在纵向上分别设置有源极区域、半导体沟道区域以及漏极区域;在水平方向上四周环绕着栅极区域,栅极与沟道半导体区之间设置有栅介质层,底部漏极区域可通过引线孔从外侧引出本发明所要解决的关键技术问题是:提供一种新型数字门集成电路的结构,该结构的栅极环绕器件体区,当栅极加上合适的偏置时,会形成四面沟道,加大了栅控能力,提高了导通时的电流密度。且新结构的沟道区不由光刻工艺完成,沟道长度不再受到光刻精度的限制。同时,通过采用窄禁带材料做源区并在漏区前端加入N‑漂移区结构,实现器件的小面积、大电流、低导通电阻,从而提高集成电路的集成度。
  • 一种新型数字集成电路结构

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