[发明专利]存储器及其形成方法、存储器单元阵列及其驱动方法在审

专利信息
申请号: 202010192701.5 申请日: 2020-03-18
公开(公告)号: CN111341776A 公开(公告)日: 2020-06-26
发明(设计)人: 于涛 申请(专利权)人: 上海华虹宏力半导体制造有限公司
主分类号: H01L27/11517 分类号: H01L27/11517;H01L27/11519;H01L27/11521;G11C11/4063
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 徐文欣
地址: 201203 上海市浦东*** 国省代码: 上海;31
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摘要: 一种存储器及其形成方法、存储器单元阵列及其驱动方法,其中存储器包括:基底,所述基底包括相邻且分离的第一存储区和第二存储区;位于所述第一存储区和第二存储区之间基底内的源区;位于所述第一存储区和第二存储区两侧的基底内的第一漏区和第二漏区;位于所述第一存储区上的第一存储结构,所述第一存储结构包括:第一存储单元和第二存储单元、以及位于第一存储单元和第二存储单元之间的第一字线栅;位于所述第二存储区上的第二存储结构,所述第二存储结构包括:第三存储单元和第四存储单元、以及位于第三存储单元和第四存储单元之间的第二字线栅。所述存储器的性能得到提升。
搜索关键词: 存储器 及其 形成 方法 单元 阵列 驱动
【主权项】:
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  • 2019-10-25 - 2022-05-31 - H01L27/11517
  • 本发明提供一种分栅快闪存储器的版图、掩膜版及版图制作方法,所述分栅快闪存储器的版图包括一浮栅版图层,所述浮栅版图层的浮栅图形区四周形成有冗余图形区,采用该版图制得掩膜版,从而形成分栅快闪存储器时,形成的分栅快闪存储器的浮栅结构的四围还围绕着没有功能的冗余结构,该冗余结构在后续对存储器的源线进行研磨时,起到负载作用,可在一定程度上保护浮栅结构的边缘不会被过度研磨,从而可以避免字线高度过低。即,本发明提供的分栅快闪存储器的版图、掩膜版及版图制作方法解决了分栅快闪存储器编程串扰失效的问题。
  • 单层多晶硅电子抹除式可复写只读存储器-202210113253.4
  • 李志浩;陈自平 - 联华电子股份有限公司
  • 2016-10-21 - 2022-05-27 - H01L27/11517
  • 本发明公开一种单层多晶硅电子抹除式可复写只读存储器,包含有一源极、一漏极、一介电层以及一电极层。源极以及漏极位于一基底中,其中源极以及漏极具有一第一导电型。介电层设置于基底上且位于源极以及漏极之间,其中介电层包含第一介电层,第一介电层具有分隔的两个穿隧介电部分,且两个穿隧介电部分的厚度薄于第一介电层的其他部分的厚度。电极层设置于介电层上,其中电极层包含一第一电极设置于第一介电层上,因而第一电极为一浮置栅极。
  • 集成电路-202122510757.3
  • C·里韦罗;P·波伊文;F·塔耶;R·西莫拉 - 意法半导体(鲁塞)公司
  • 2021-10-19 - 2022-05-10 - H01L27/11517
  • 本公开的各实施例涉及集成电路。该集成电路包括非易失性存储器单元。一种用于非易失性存储器单元的存储器晶体管包括被植入半导体衬底中的源极区和漏极区。源极区与漏极区隔开。用于存储器晶体管的双栅极区在源极区与漏极区之间的半导体衬底中至少部分地在深度上延伸,并且还延伸超出该源极区和该漏极区。存储器单元还包括具有栅极区的选择晶体管,该栅极区在用于存储器晶体管的双栅极区上方部分延伸。在存储器晶体管的双栅极区上方延伸的选择晶体管的栅极区的部分具有足够大的表面以接收接触区,因此可以减少选择晶体管的栅极区在半导体衬底上方延伸的部分,以减小存储器单元的占用表面积。
  • 非易失性存储器-202111213892.X
  • C·里韦罗;P·波伊文;F·塔耶;R·西莫拉 - 意法半导体(鲁塞)公司
  • 2021-10-19 - 2022-05-06 - H01L27/11517
  • 本公开的各实施例涉及非易失性存储器。一种用于非易失性存储器单元的存储器晶体管包括被植入半导体衬底中的源极区和漏极区。源极区与漏极区隔开。用于存储器晶体管的双栅极区在源极区与漏极区之间的半导体衬底中至少部分地在深度上延伸,并且还延伸超出该源极区和该漏极区。存储器单元还包括具有栅极区的选择晶体管,该栅极区在用于存储器晶体管的双栅极区上方部分延伸。
  • 闪存器件及其制作方法-201911090126.1
  • 薛广杰;胡华;李赟 - 武汉新芯集成电路制造有限公司
  • 2019-11-08 - 2022-04-08 - H01L27/11517
  • 本发明提供了一种闪存器件及其制作方法,在浮栅材料层上形成氧化层,平坦化所述氧化层与所述浮栅材料层之后,所述存储区内剩余的浮栅材料层形成浮栅且外围区保留有部分厚度的所述浮栅材料层,以所述浮栅和所述外围区保留的部分厚度的浮栅材料层为掩膜刻蚀所述浮栅之间的隔离结构,能够节省图形化工艺,避免了由于光刻胶图形化造成的缺陷,并且降低了生产成本,同时提高了浮栅的均一性。
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