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- [发明专利]窗口显示控制方法和装置-CN201710007251.6有效
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任晓帅
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腾讯科技(深圳)有限公司
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2017-01-05
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2021-03-02
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G06F3/0486
- 所述方法包括:接收应用中进行浮层窗口显示的指令;根据指令配置所述浮层窗口属性得到存放所述浮层窗口属性的布局信息,所述布局信息中窗口类型配置为对话框类型;获取应用窗口的窗口令牌,并在所述布局信息中指定获取的所述窗口令牌为所述浮层窗口的令牌值;通过所述布局信息在所述应用窗口中显示所述浮层窗口。由此,将不需要申请权限,使得浮层窗口的实现不再受限于权限,此外,由于浮层窗口的令牌值被指定为应用窗口的窗口令牌,使得浮层窗口是依附于应用窗口存在的,并且其窗口类型为对话框类型,保证了浮层窗口在应用窗口的层次之上进行显示,也在浮层窗口属性的作用下保证浮层窗口的全屏幕拖动。
- 窗口显示控制方法装置
- [发明专利]沟槽分离栅器件及其制造方法-CN201810259783.3有效
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方冬;卞铮
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无锡华润上华科技有限公司
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2018-03-27
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2021-08-17
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H01L29/78
- 本发明涉及一种沟槽分离栅器件的制造方法,所述方法包括:刻蚀半导体衬底形成沟槽;于沟槽内淀积氧化物形成浮栅氧化层,使所述浮栅氧化层沿沟槽侧壁从上至下逐渐增厚,所述沟槽侧壁下部的浮栅氧化层厚度与所述沟槽底部的浮栅氧化层厚度相同;向所述沟槽内淀积多晶硅形成浮栅多晶层;在所述浮栅多晶层上表面生长绝缘介质形成隔离层;在所述沟槽内的所述隔离层上形成控制栅。本申请采用淀积技术在沟槽底部淀积浮栅氧化层,使得浮栅氧化层厚度从沟槽侧壁至沟槽底部逐渐变厚并且沟槽侧壁下部的浮栅氧化层厚度与沟槽底部浮栅氧化层厚度相同。逐渐变化的浮栅氧化层厚度可以缩小沟槽宽度,从而进一步减小元胞面积,降低器件的比导通电阻。
- 沟槽分离器件及其制造方法
- [发明专利]浮栅型分栅闪存器件及其制备方法-CN202210986808.6在审
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许昭昭
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华虹半导体(无锡)有限公司
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2022-08-17
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2022-11-22
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H01L29/423
- 本发明提供一种浮栅型分栅闪存器件及其制备方法,其中器件包括:衬底;浮栅氧化层、台阶型浮栅多晶硅层;ONO介质层;源端侧墙;第一侧墙;源端多晶硅层;保护层;第二侧墙;选择栅氧化硅层、选择栅多晶硅层和第三侧墙本申请通过利用源端侧墙在浮栅多晶硅层的左、右、上三个方向对浮栅多晶硅层形成包裹,增加源端侧墙和浮栅多晶硅层的交叠面积,可以在微缩闪存器件的尺寸的同时提高SL‑FG的耦合系数;进一步的,本申请通过将浮栅多晶硅层的内外做成厚度不同的台阶形貌,增厚内侧浮栅多晶硅层的厚度,同时减薄外侧浮栅多晶硅层的厚度,使得选择栅至浮栅的有效交叠面积基本不变,同时选择栅对浮栅的外侧上角形成包裹,提高器件的擦除效率。
- 浮栅型分栅闪存器件及其制备方法
- [发明专利]一种闪存器件及其制备方法-CN202111428327.5在审
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曹子贵
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上海华虹宏力半导体制造有限公司
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2021-11-26
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2022-03-01
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H01L27/11521
- 本发明提供一种闪存器件及其制备方法,包括:衬底,所述衬底上具有沟槽;控制栅层,位于所述沟槽中且向上延伸;两个浮栅层,位于所述沟槽中且分别位于所述控制栅层的两侧;连接氧化层,位于所述漏区与所述控制栅层之间;字线层,位于一个所述浮栅层的外侧,用于连接另一沟槽中的浮栅层。将所述控制栅层与所述浮栅层之间的耦合由平面结构改为立体结构,所述控制栅层与所述浮栅层之间在所述沟槽中垂直方向上的重叠面积不受所述浮栅层平面面积的限制,在保证所述控制栅层与所述浮栅层之间耦合系数的同时,缩小浮栅层在平面上的长度;于此同时本发明中两个所述存储位中的所述浮栅层共用同一个所述字线层,进一步缩小所述闪存器件的面积。
- 一种闪存器件及其制备方法
- [发明专利]闪存器件的浮置栅极的制造方法-CN200610173266.1无效
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金成均
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东部电子股份有限公司
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2006-12-19
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2007-06-27
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H01L21/28
- 本发明提供了一种形成闪存器件的浮置栅极的方法,包括:在半导体衬底上形成隧道绝缘层;在该隧道绝缘层上形成浮置栅极导电层;在该浮置栅极导电层上形成硬掩模层图案;在该硬掩模层图案和该浮置栅极导电层的露出表面上形成第二导电层;蚀刻该第二导电层以在该硬掩模层图案的侧壁上形成导电间隔层;氧化该导电间隔层和该浮置栅极导电层以形成掩模氧化物层和间隔氧化物层;除去该硬掩模层图案以部分地露出该浮置栅极导电层的表面;以及通过使用该掩模氧化物层和该间隔氧化物层作为蚀刻掩模进行蚀刻处理,除去该浮置栅极导电层的露出部分,从而形成浮置栅极图案。
- 闪存器件栅极制造方法
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