专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体结构-CN201410110738.3有效
  • 陈蔚宗;蔡娟娟;辛哲宏;蔡学宏;杨智翔 - 元太科技工业股份有限公司
  • 2014-03-19 - 2018-01-23 - H01L29/786
  • 本发明是有关于一种半导体结构,包括顶栅极、氧化半导体通道层、第一介电层、第二介电层以及源极与漏极。氧化半导体通道层配置于顶栅极与基板之间。第一介电层配置于顶栅极与氧化半导体通道层之间。第二介电层配置于第一介电层与氧化半导体通道层之间。源极与漏极配置于氧化半导体通道层的相对两侧,且位于第一介电层与基板之间。氧化半导体通道层的一部分暴露于源极与漏极之间。部分第一介电层及部分第二介电层直接接触且完全覆盖氧化半导体通道层的部分。
  • 半导体结构
  • [发明专利]记忆体阵列、位准移位电路以及偏压电路-CN202210266412.4在审
  • 喻鹏飞;张盟昇;张彤诚;王奕 - 台湾积体电路制造股份有限公司
  • 2022-03-17 - 2022-12-27 - G11C5/02
  • 一种记忆体阵列、位准移位电路以及偏压电路,记忆体阵列包含N堆叠通道栅、赋能线、N型金属氧化半导体堆叠、字元线及电阻元件矩阵。每一N堆叠通道栅包含串联的第1级P型金属氧化半导体核心装置及第N级P型金属氧化半导体核心装置。每一第1级P型金属氧化半导体耦接至电压供应。每一赋能线驱动堆叠通道栅。每一N堆叠选择器包含N型金属氧化半导体堆叠。每一N型金属氧化半导体堆叠包含串联的第1级N型金属氧化半导体核心装置及第N级N型金属氧化半导体核心装置。每一第1级N型金属氧化半导体核心装置耦接至接地轨。每一字元线驱动堆叠选择器。每一电阻元件耦接在堆叠通道栅与堆叠选择器之间。电压供应大于核心装置的崩溃电压。
  • 记忆体阵列移位电路以及偏压
  • [发明专利]金属氧化半导体薄膜晶体管阵列基板及制作方法-CN201911168601.2有效
  • 何佳新 - 昆山龙腾光电股份有限公司
  • 2019-11-25 - 2022-05-17 - H01L27/12
  • 一种金属氧化半导体薄膜晶体管阵列基板的制作方法,在栅极绝缘层上依次连续沉积一层结晶态金属氧化半导体薄膜和一层非晶态金属氧化半导体薄膜;在非晶态金属氧化半导体薄膜上沉积形成由铜电极材料制成的源漏极金属材料层;利用半色调光罩形成光阻层,所形成的光阻层包括源/漏极光阻图形区域和有源层光阻图形区域;同时蚀刻源漏极金属材料层和非晶态金属氧化半导体薄膜以形成源漏极金属层和非晶态金属氧化半导体层;对结晶态金属氧化半导体薄膜进行蚀刻以形成结晶态金属氧化半导体层;对光阻层进一步图案化以去除有源层光阻图形区域的光阻材料;对源漏极金属层和非晶态金属氧化半导体层进行蚀刻以形成源极、漏极以及沟道。
  • 金属氧化物半导体薄膜晶体管阵列制作方法
  • [发明专利]半导体装置及其制造方法-CN201480012341.9有效
  • 北角英人 - 夏普株式会社
  • 2014-02-25 - 2018-11-06 - H01L29/786
  • 半导体装置(1001)包括由基板(1)支承的氧化半导体层(7)和导电体层(13a、13b、13c、13s),该半导体装置中,氧化半导体层(7)包含第一金属元素,导电体层(13a、13b、13c、13s)具有层叠构造,该层叠构造包括:包含第一金属元素的第一金属氧化层(m1);配置在第一金属氧化层上且包含第二金属元素的氧化的第二金属氧化层(m2);和配置在第二金属氧化层上且包含第二金属元素的金属层(M),第一金属氧化层(m1)和氧化半导体层(7)由同一氧化膜形成,在从基板的法线方向看时,第一金属氧化层(m1)与所述氧化半导体层(7)不重叠。
  • 半导体装置及其制造方法
  • [发明专利]半导体装置和半导体装置的制造方法-CN201710009742.4有效
  • 内山博幸;藤崎寿美子;森塚翼 - 日立金属株式会社
  • 2017-01-06 - 2020-11-13 - H01L29/786
  • 本发明提供一种半导体装置及其制造方法。该半导体装置提高半导体装置(薄膜晶体管)的特性。半导体装置构成如下:具有形成在基板(SUB)上的栅电极(GE)、在其上面隔着栅绝缘膜(GI)形成的第1金属氧化半导体膜(MO1)、形成在其上面的第2金属氧化半导体膜(MO2)、以及形成在其上面的源、并且,使第1金属氧化半导体膜(MO1)的端部与第2金属氧化半导体膜(MO2)的端部相比后退。根据这样的构成,能够确保下层的第1金属氧化半导体膜(MO1)与源、漏电极(SD)的距离。由此,能够防止源、漏电极(SD)与下层的第1金属氧化半导体膜(MO1)的短路,能够提高晶体管特性。
  • 半导体装置制造方法
  • [发明专利]金属氧化半导体薄膜晶体管及其制作方法-CN201410061903.0有效
  • 简廷宪;钟德镇;吴婷婷;戴文君 - 昆山龙腾光电有限公司
  • 2014-02-24 - 2016-11-09 - H01L29/786
  • 金属氧化半导体薄膜晶体管包括栅极、栅极绝缘层以及金属氧化半导体层。栅极绝缘层位于栅极与金属氧化半导体层之间。栅极绝缘层包括氮氧化硅层和氧化硅层。氮氧化硅层位于栅极与氧化硅层之间。氧化硅层位于氮氧化硅层与金属氧化半导体层之间,且氧化硅层具有与氮氧化硅层接触的第一表面以及与金属氧化半导体层接触的第二表面。氧化硅层靠近第二表面的氧原子密度大于氧化硅层靠近第一表面的氧原子密度。金属氧化半导体薄膜晶体管,在减少工艺时间的同时,有效的解决了因成膜应力过大而导致的玻璃基板易破片的问题,并有利于减少栅极绝缘层对金属氧化半导体层中的氧含量的影响。
  • 金属氧化物半导体薄膜晶体管及其制作方法
  • [发明专利]半导体结构的制备方法及半导体结构-CN202110047069.X在审
  • 杨蒙蒙;白杰 - 长鑫存储技术有限公司
  • 2021-01-14 - 2022-07-19 - H01L21/28
  • 本发明属于半导体技术领域,具体涉及一种半导体结构的制备方法及半导体结构,用于解决半导体结构的氧化厚度较大的技术问题。该半导体结构的制备方法包括:提供基底,基底包括器件区域和浅沟槽隔离区域,浅沟槽隔离区域环绕器件区域,器件区域暴露于基底表面;于基底上沉积阻挡层,阻挡层至少覆盖器件区域;形成初始氧化,初始氧化位于器件区域内,且与阻挡层接触;去除部分初始氧化,形成器件氧化。形成初始氧化时,利用阻挡层遮挡器件区域,可以减缓初始氧化的生长速率,控制初始氧化的厚度,形成较薄的初始氧化,最终形成较薄的器件氧化。此外,去除部分初始氧化后形成器件氧化,进一步减小了器件氧化的厚度。
  • 半导体结构制备方法
  • [发明专利]半导体装置及半导体装置的制造方法-CN201780040477.4有效
  • 汤田洋平;绵引达郎 - 三菱电机株式会社
  • 2017-06-08 - 2022-02-25 - H01L29/872
  • 即使在n型氧化半导体中设置p型氧化半导体作为终端结构,也防止p型氧化半导体被n型氧化半导体的氧所氧化半导体装置(10),其具备:n型氧化镓基板(1);与n型氧化镓基板1接合的阳极电极(3);和设置于n型氧化镓基板(1)的阴极电极(2),使电流经由在阳极电极(3)与阴极电极(2)之间设置的n型氧化镓基板(1)在阳极电极(3)与阴极电极(2)之间流动,其特征在于,具备:与将阳极电极(3)与n型氧化镓基板(1)接合的接合部邻接地设置的p型氧化半导体层(4a);和在p型氧化半导体层4a与n型氧化镓基板(1)之间所设置的氮化层(7)。
  • 半导体装置制造方法

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