专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]显示面板-CN202211272822.6有效
  • 黄嘉辉;江志雄;王强;弓程;余明爵;蔡志辉 - 广州华星光电半导体显示技术有限公司
  • 2022-10-18 - 2023-03-24 - H01L27/12
  • 本申请提供一种显示面板,包括薄膜晶体管,薄膜晶体管包括:栅极;源极和漏极;以及金属氧化,对应栅极设置,包括:下金属氧化,下金属氧化包括铟的氧化以及镧系元素的氧化;以及上金属氧化,与下金属氧化层叠置且位于下金属氧化靠近源极和所述漏极的表面上,源极和漏极与上金属氧化连接,上金属氧化包括铟的氧化以及镧系元素的氧化,上金属氧化包括多晶相。金属氧化包括下金属氧化和上金属氧化,下金属氧化包括铟的氧化以及镧系元素的氧化,有利于包括下金属氧化的薄膜晶体管实现高迁移率,上金属氧化包括多晶相,有利于提高包括上金属氧化的薄膜晶体管稳定性
  • 显示面板
  • [发明专利]氧化p-i-n结器件及其制备方法-CN200610164954.1无效
  • 赵柏儒;袁洁;吴昊;曹立新;许波;赵力;金魁;朱北沂 - 中国科学院物理研究所
  • 2006-12-08 - 2008-06-11 - H01L29/868
  • 本发明涉及一种氧化p-i-n结器件及其制备方法,该器件包括衬底,在衬底之上形成的p型氧化,在p型氧化上形成的n型氧化,以及分别形成在p型氧化和n型氧化上用于连接引线的引出端和在p型氧化和n型氧化之间的铁电体势垒;n型氧化和铁电体势垒设置在的p型氧化的一侧,其占p型氧化层面积的1/3~2/3,其余部分作为p型氧化的引出端;n型氧化表面作为n型氧化的引出端,在p型氧化和n型氧化的引出端上分别制作用于连接引线的贵金属焊盘;p型氧化和n型氧化均为金属性的;本发明的器件制备方法简单,结构易于实现,实现了单一器件功能的多样化。
  • 氧化物器件及其制备方法
  • [发明专利]形成金属氧化图案的方法及制造半导体装置的方法-CN200810127783.4无效
  • 朴玟俊;姜昌珍;金东贤 - 三星电子株式会社
  • 2008-02-15 - 2008-11-12 - H01L21/311
  • 本发明公开了形成金属氧化图案的方法及制造半导体装置的方法。在基板上形成金属氧化图案的方法包括:在基板上提供初步金属氧化;蚀刻该初步金属氧化以提供初步金属氧化图案,其线宽在垂直向下的方向上逐渐增加;以降低该初步金属氧化图案的下部线宽的方式蚀刻该初步金属氧化图案,形成金属氧化图案。制造半导体装置的方法包括在基板上形成金属氧化和第一导电;蚀刻该金属氧化以提供初步金属氧化图案,其线宽在垂直向下的方向上逐渐增加;蚀刻该第一导电以提供第一导电图案;和以降低该初步金属氧化图案的下部线宽的方式蚀刻该初步金属氧化图案,以提供金属氧化图案。
  • 形成金属氧化物图案方法制造半导体装置
  • [发明专利]半导体装置及其制造方法-CN201380043764.2有效
  • 山崎舜平 - 株式会社半导体能源研究所
  • 2013-08-01 - 2018-05-15 - H01L29/786
  • 其包括在其中层叠有第一氧化半导体、第二氧化半导体以及第三氧化半导体氧化半导体叠,与氧化半导体叠接触的源电极以及漏电极,与氧化半导体重叠的栅电极(在所述氧化半导体和所述栅电极之间设置有栅极绝缘),以及第一氧化绝缘及第二氧化绝缘(在所述第一氧化绝缘及所述第二氧化绝缘之间夹有氧化半导体叠)。第一至第三氧化半导体中的每个包含铟、镓及锌。第二氧化半导体中的铟的比例比第一及第三氧化半导体中的每个的铟的比例多。第一氧化半导体是非晶的。第二及第三氧化半导体都具有晶体结构。
  • 半导体装置及其制造方法
  • [发明专利]半导体装置及其制造方法-CN202210863089.9在审
  • 江家维;范扬顺;黄震铄 - 友达光电股份有限公司
  • 2022-07-21 - 2022-09-13 - H01L29/786
  • 一种半导体装置及其制造方法,半导体装置包括基板、半导体结构、第一栅介电、第一栅极、源极以及漏极。半导体结构包括第一金属氧化以及第二金属氧化。第二金属氧化覆盖第一金属氧化的顶面以及侧壁。第二金属氧化于第一金属氧化的侧壁处具有阶梯结构。第一金属氧化的载子迁移率大于第二金属氧化的通道区的载子迁移率。第二金属氧化的厚度大于或等于第一金属氧化的厚度。第一栅极的宽度与第一金属氧化的宽度差值小于0.5微米。
  • 半导体装置及其制造方法
  • [发明专利]透明导电膜-CN201380069624.2在审
  • 梨木智刚;拝师基希;野口知功;石桥邦昭 - 日东电工株式会社
  • 2013-10-08 - 2015-09-09 - H01B5/14
  • 透明导电膜(1)具有形成在薄膜基体材料(2)的两个表面上的透明导体(3、4)。透明导体(3)是从薄膜基体材料(2)的表面(2a)侧起依次层叠有铟锡氧化(5)、铟锡氧化(6)和铟锡氧化(7)而构成。透明导体(4)是从薄膜基体材料(2)的表面(2b)侧起依次层叠有铟锡氧化(8)、铟锡氧化(9)和铟锡氧化(10)而构成。铟锡氧化(6)的氧化锡含量比铟锡氧化(5)的氧化锡含量和铟锡氧化(7)的氧化锡含量都高。铟锡氧化(9)的氧化锡含量比铟锡氧化(8)的氧化锡含量和铟锡氧化(10)的氧化锡含量都高。
  • 透明导电
  • [发明专利]半导体装置及其制造方法-CN201810335239.2有效
  • 山崎舜平 - 株式会社半导体能源研究所
  • 2013-08-01 - 2021-08-03 - H01L29/417
  • 其包括在其中层叠有第一氧化半导体、第二氧化半导体以及第三氧化半导体氧化半导体叠,与氧化半导体叠接触的源电极以及漏电极,与氧化半导体重叠的栅电极(在所述氧化半导体和所述栅电极之间设置有栅极绝缘),以及第一氧化绝缘及第二氧化绝缘(在所述第一氧化绝缘及所述第二氧化绝缘之间夹有氧化半导体叠)。第一至第三氧化半导体中的每个包含铟、镓及锌。第二氧化半导体中的铟的比例比第一及第三氧化半导体中的每个的铟的比例多。第一氧化半导体是非晶的。第二及第三氧化半导体都具有晶体结构。
  • 半导体装置及其制造方法

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