专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种具有耐压结构的碳化硅MOSFET的制造方法-CN202210941206.9有效
  • 张长沙;周海;李佳帅;单体玮 - 泰科天润半导体科技(北京)有限公司
  • 2022-08-08 - 2022-11-04 - H01L21/336
  • 本发明提供了一种具有耐压结构的碳化硅MOSFET的制造方法,包括:在具有漂移的碳化硅衬底上形成阻挡,并对阻挡蚀刻形成通孔,通过通孔对漂移进行离子注入,以形成至少两个P型的耐压夹断区、至少一个N型的耐压区以及N+低阻导电区;重新形成阻挡,并对阻挡蚀刻形成通孔进行离子注入,形成N+源区;重新形成阻挡,并对阻挡蚀刻形成通孔,通过通孔氧化形成栅极绝缘;重新形成阻挡,并对阻挡蚀刻形成通孔,通过通孔淀积金属形成源极金属;重新形成阻挡,并对阻挡蚀刻栅极金属淀积区,淀积形成栅极金属;清除所有阻挡,在碳化硅衬底上淀积形成漏极金属,使得其耐压特性显著提高,满足特高压输电的需求。
  • 一种具有耐压结构碳化硅mosfet制造方法
  • [发明专利]片式熔断器阻挡的加工方法-CN201710707408.6有效
  • 肖晴;韩玉成;李厚忠;刘应强;彭昌文;王成;蒲蓉;王海珍 - 中国振华集团云科电子有限公司
  • 2017-08-17 - 2019-01-04 - H01H69/02
  • 本发明涉及电子元器件制造领域,旨在解决现有技术中的印刷方框型阻挡耗时较长,人员效率低,阻挡易断裂,产品质量和合格率低的问题,提供一种片式熔断器阻挡的加工方法。本发明的实施例中提供的片式熔断器阻挡的加工方法,先采用高压力、低速度、低圈数的方法,保证阻挡基底平滑光润,方便后续阻挡的累加。后减小压力、提高速度、增加圈数进行印刷,将阻挡从上窄下宽的梯形变成上下宽度一致的矩型,增强阻挡抗物理冲击的性质,同时提高阻挡厚度的累积速度。本发明的实施例中提供的片式熔断器阻挡的加工方法可有效地避免阻挡的易断裂,降低生产成本,提高产品质量和合格率。
  • 熔断器阻挡加工方法
  • [发明专利]膜及其制备方法-CN201911293755.4有效
  • 林小锋 - 苏州普希环保科技有限公司
  • 2019-12-16 - 2022-02-22 - C09D179/08
  • 膜包括:基底层、设置于所述基底层表面的第一阻挡以及设置于所述第一阻挡表面的第二阻挡,其中:所述第二阻挡中包括二维纳米材料以及高分子材料。由于二维纳米材料的材料粒径属于纳米级,相较于第一阻挡,使得第二阻挡的致密性较高,孔径大小较小,在第一阻挡上增加该第二阻挡能够增加膜整体的密封性能,从而解决现有技术中的问题。
  • 及其制备方法
  • [发明专利]后端结构的形成方法-CN202011292924.5有效
  • 张超逸;梁金娥;卢光远 - 华虹半导体(无锡)有限公司
  • 2020-11-18 - 2022-09-30 - H01L21/768
  • 本申请公开了一种后端结构的形成方法,包括:在介质上形成反射阻挡,介质形成于第一金属上,第一金属形成于衬底上,反射阻挡的反射率低于第一金属的反射率;对目标区域进行刻蚀,形成通孔,通孔底端的第一金属暴露;在反射阻挡和通孔的表面形成阻挡;在阻挡上形成第二金属,第二金属填充通孔;通过CMP工艺进行平坦化处理,去除通孔所在区域以外的其它区域的反射阻挡阻挡和第二金属,通孔内剩余的的阻挡和第二金属形成金属连线本申请通过在介质上形成反射阻挡,通过该反射阻挡阻挡终端探测器穿透介质照射到前金属上的光,降低了前金属的反射光对设备控制端的影响。
  • 后端结构形成方法
  • [发明专利]半导体元件-CN201510392655.2有效
  • 邵柏竣;洪永泰;骆统 - 旺宏电子股份有限公司
  • 2015-07-07 - 2019-03-15 - H01L23/522
  • 一种半导体元件,该半导体元件包括基底、介电、多个第一阻挡、多个第二阻挡和多个导体;其中,介电层位于基底上;第一阻挡位于介电中;第二阻挡位于介电中,且位于第一阻挡上;导体层位于介电中,导体与第一阻挡和第二阻挡连接,且相邻两个导体之间具有空气间隙,空气间隙的顶端至少高于导体层高度的三分之二。
  • 半导体元件
  • [发明专利]提高耐压的横向沟槽型碳化硅MOSFET的制造方法-CN202211646425.0在审
  • 李昀佶;周海;何佳;单体玮 - 泰科天润半导体科技(北京)有限公司
  • 2022-12-21 - 2023-01-20 - H01L21/336
  • 本发明提供了一种提高耐压的横向沟槽型碳化硅MOSFET的制造方法,在碳化硅衬底上形成阻挡,蚀刻形成沟槽;对沟槽进行氧化形成绝缘;形成阻挡,并对阻挡蚀刻,淀积,形成多晶硅;形成阻挡,并对阻挡蚀刻、离子注入,形成源区和漏区;形成阻挡,蚀刻形成栅极区域,对栅极区域进行氧化形成栅极氧化;形成阻挡,蚀刻,淀积金属,形成源极金属和漏极金属;在碳化硅衬底上形成阻挡,并对阻挡蚀刻形成通孔,对栅极氧化刻蚀到多晶硅;进行金属淀积,形成栅极金属,并清除所有阻挡;结构简单,制造工艺也简单,成本较低,有效控制器件成本的情况下,在100‑650V电压领域完成碳化硅器件的应用市场拓展。
  • 提高耐压横向沟槽碳化硅mosfet制造方法
  • [发明专利]一种增加耐压能力的碳化硅MOSFET的制造方法-CN202211003443.7有效
  • 何佳;陈彤;张长沙;单体玮 - 泰科天润半导体科技(北京)有限公司
  • 2022-08-22 - 2023-05-12 - H01L21/336
  • 本发明提供了一种增加耐压能力的碳化硅MOSFET的制造方法,在碳化硅衬底的隔离区上生长阻挡,并对阻挡蚀刻形成通孔,通过通孔对隔离区进行离子注入,形成导电沟道区;重新生长阻挡,并对阻挡蚀刻形成通孔,通过通孔对隔离区进行离子注入,以形成漏极源区和源极源区;在漏极源区和源极源区上分别淀积形成漏极金属和源极金属;重新生长阻挡,并对阻挡蚀刻形成通孔,氧化形成绝缘;重新生长阻挡,并对阻挡蚀刻形成通孔,并进行刻蚀形成栅极金属淀积区;重新生长阻挡,并对阻挡蚀刻形成通孔,在栅极金属淀积区淀积,形成栅极金属,清除所有阻挡,可以在较小的面积上实现SiC LDMOSFET的耐压能力提高。
  • 一种增加耐压能力碳化硅mosfet制造方法
  • [发明专利]半导体结构的形成方法-CN200710103965.3无效
  • 余振华;陈海清;包天一 - 台湾积体电路制造股份有限公司
  • 2007-05-17 - 2008-05-28 - H01L21/768
  • 本发明提供一种半导结构的形成方法,包括提供一基板,形成一低介电常数介电于该基板上,形成一导线于该低介电常数介电中,且在一含碳硅烷化学品中,热处理该导线以形成一阻挡于该导线上。形成一衬阻挡于开口中以形成此导线。此衬阻挡含有与阻挡相同的材料,在形成阻挡前,可去除此衬阻挡,且衬阻挡可含有一可被硅化的金属。本发明的半导体结构的形成方法通过形成凹槽可去除介于阻挡交界处的脆弱点,并且阻挡可对铜导线形成良好的密封。
  • 半导体结构形成方法
  • [发明专利]一种屏蔽栅沟槽型碳化硅MOSFET的制造方法-CN202211646476.3在审
  • 胡臻;周海;何佳;吴玲琼 - 泰科天润半导体科技(北京)有限公司
  • 2022-12-21 - 2023-01-20 - H01L21/336
  • 本发明提供了一种屏蔽栅沟槽型碳化硅MOSFET的制造方法,包括在碳化硅衬底的漂移上形成阻挡,并对阻挡和漂移蚀刻形成沟槽;氧化沟槽,形成绝缘;重新形成阻挡,蚀刻并离子注入形成屏蔽栅;重新形成阻挡,蚀刻并离子注入形成夹断区;重新形成阻挡,蚀刻并离子注入形成源区;重新形成阻挡,蚀刻并离子注入形成栅极;重新形成阻挡,蚀刻,并进行淀积,形成栅极金属;重新形成阻挡,并对阻挡蚀刻形成通孔,通过通孔对源区淀积,形成源极金属;去除所有阻挡,对碳化硅衬底进行淀积,形成漏极金属,在不影响器件导通电阻的情况下,通过屏蔽栅结构,将栅源电容减少,可以提高器件开关速度。
  • 一种屏蔽沟槽碳化硅mosfet制造方法

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