[发明专利]半导体封装装置及其制造方法在审
| 申请号: | 202111010497.1 | 申请日: | 2021-08-31 |
| 公开(公告)号: | CN113990814A | 公开(公告)日: | 2022-01-28 |
| 发明(设计)人: | 王铭汉 | 申请(专利权)人: | 日月光半导体制造股份有限公司 |
| 主分类号: | H01L23/31 | 分类号: | H01L23/31;H01L23/16;H01L23/367;H01L21/56 |
| 代理公司: | 北京植德律师事务所 11780 | 代理人: | 唐华东 |
| 地址: | 中国台湾高雄*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 半导体 封装 装置 及其 制造 方法 | ||
本公开提供了半导体封装装置及其制造方法,通过取消现有技术中一个焊盘上的焊垫,即只形成焊盘不形成焊垫,并通过利用上层结构的焊垫直接对接下层焊盘的正面或者侧面,下层结构的焊垫直接对接上层焊盘的正面或者侧面,即上下两个焊垫的位置采用交错式设计,进而留出更多的空间以实现扩大相邻两电连接件之间的空间,避免桥接。
技术领域
本公开涉及半导体封装技术领域,具体涉及半导体封装装置及其制造方法。
背景技术
FOCoS(Fan Out Chip on Substrate,扇出型基板上芯片)封装产品中,不同材料的热膨胀系数(coefficient of thermal expansion,CTE)存在差异,其中散热片(Heatsink)、重布线层(RDL,Redistribution Layer)和基板(Substrate)的CTE大于其他各材料,因此在热循环测试过程中会产生外拉应力。而由于FOCoS中存在多个功能芯片,不同功能芯片之间的缝隙(Die gap)处会填充底部填充剂(Underfill),由于底部填充剂的刚性较低,在热循环测试过程中无法直接承受上述CTE差异所导致的外拉应力,因此容易在底部填充剂与功能芯片之间产生脱层(delamination)或断裂(crack)。另外,当经历多次热循环测试过程后,因多次外拉应利力而可能使得上述所产生的脱层或断裂扩大,进而可能破坏重布线层的线路。
发明内容
本公开提出了半导体封装装置及其制造方法。
第一方面,本公开提供了一种半导体封装装置,包括:
衬底,具有第一表面;
重布线层,设置于所述第一表面;
芯片模组,设置于所述重布线层上,所述芯片模组包括第一功能芯片和至少两个第二功能芯片,所述至少两个第二功能芯片通过所述重布线层电性连接所述第一功能芯片;
固定件,设置于所述重布线层上所述芯片模组的外侧壁,且所述第一功能芯片和所述第二功能芯片之间的缝隙处对应设置有所述固定件。
在一些可选的实施方式中,所述半导体封装装置还包括:
散热件,设置于所述第一表面且跨越所述芯片模组和所述固定件。
在一些可选的实施方式中,所述芯片模组的第一外侧壁从所述第一功能芯片和第二功能芯片之间的缝隙沿第一方向到所述第一外侧壁的第一中心线之间设置有所述固定件,所述第一外侧壁为所述芯片模组的外侧壁中所述第一功能芯片和第二功能芯片之间的缝隙所延伸至的侧壁,所述第一方向从所述第二功能芯片到所述第一功能芯片,所述第一中心线为所述第一外侧壁与所述芯片模组上表面连接线的中点和所述第一外侧壁与所述芯片模组下表面连接线的中点之间的连线。
在一些可选的实施方式中,所述芯片模组的第一外侧壁完整设置有所述固定件。
在一些可选的实施方式中,所述芯片模组的第二外侧壁设置有所述固定件,其中,所述芯片模组的第二外侧壁为所述芯片模组的外侧壁中只对应所述第二功能芯片的侧壁。
在一些可选的实施方式中,所述芯片模组的第三外侧壁设置有所述固定件,其中,所述芯片模组的第三外侧壁为所述芯片模组的外侧壁中只对应所述第一功能芯片的侧壁。
在一些可选的实施方式中,所述固定件通过粘合层粘合至所述重布线层。
在一些可选的实施方式中,所述固定件通过焊料凸块固定至所述重布线层。
在一些可选的实施方式中,所述半导体封装装置还包括:
第一底部填充胶,设置于所述芯片模组和所述重布线层之间,且所述第一底部填充胶延伸至所述芯片模组的外侧壁;
第二底部填充胶,设置于所述芯片模组和所述固定件之间,且所述第二底部填充胶延伸至所述固定件的外侧壁;
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