[发明专利]半导体装置在审
申请号: | 202110651130.1 | 申请日: | 2017-08-11 |
公开(公告)号: | CN113380815A | 公开(公告)日: | 2021-09-10 |
发明(设计)人: | 荒井伸也 | 申请(专利权)人: | 东芝存储器株式会社 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11529;H01L27/11548;H01L27/11556;H01L27/1157;H01L27/11573;H01L27/11575;H01L27/11582;H01L29/06;H01L29/167;H01L29/792 |
代理公司: | 北京市中咨律师事务所 11247 | 代理人: | 刘瑞东;段承恩 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 半导体 装置 | ||
1.一种半导体装置,包括:
第一半导体层;
层叠体,其设置在所述第一半导体层上方,并且包括在第一方向上层叠的多个电极层;以及
柱状部,其包括第二半导体层和电荷积蓄膜,
所述第二半导体层在所述第一方向上延伸贯通所述层叠体且到达所述第一半导体层,并且包括与所述第一半导体层相接触的侧壁部,
所述电荷积蓄膜包括位于所述多个电极层与所述第二半导体层之间的第一部分以及位于所述第二半导体层与所述第一半导体层之间的第二部分,
所述第一部分和所述第二部分彼此在所述第一方向上被所述第一半导体层完全分离,
所述第二半导体层的所述侧壁部没有被所述电荷积蓄膜覆盖。
2.根据权利要求1所述的半导体装置,
所述第一半导体层包含杂质。
3.根据权利要求1所述的半导体装置,
还包括设置在所述第一半导体层与所述层叠体之间的栅层,所述栅层比所述多个电极层的1层的厚度厚。
4.根据权利要求3所述的半导体装置,
所述侧壁部和所述第二半导体层的与所述栅层相对向的部分之间的距离,比所述栅层的厚度小。
5.根据权利要求1所述的半导体装置,
所述第二半导体层的所述侧壁部的杂质浓度,比所述第二半导体层的与所述层叠体相对向的部分的杂质浓度高。
6.根据权利要求3所述的半导体装置,
所述第二半导体层的与所述栅层相对向的第一部分的杂质浓度,比所述第二半导体层的与所述层叠体相对向的第二部分的杂质浓度高。
7.根据权利要求3所述的半导体装置,
所述多个电极层具有:
比所述栅层薄的至少1层漏侧选择栅;
设置在所述漏侧选择栅与所述栅层之间且比所述栅层薄的至少1层源侧选择栅;以及
多个单元栅,其设置在所述漏侧选择栅与所述源侧选择栅之间,与所述电荷积蓄膜相对向,该多个单元栅的各单元栅比所述栅层薄。
8.根据权利要求3所述的半导体装置,
所述栅层为包含磷的硅层。
9.根据权利要求1所述的半导体装置,
所述第一半导体层为包含磷的硅层。
10.根据权利要求3所述的半导体装置,
还包括包含金属的层,所述第一半导体层设置在所述栅层与所述包含金属的层之间。
11.根据权利要求1所述的半导体装置,
所述电荷积蓄膜在所述层叠体与所述第二半导体层之间在所述第一方向上连续。
12.根据权利要求3所述的半导体装置,
所述电荷积蓄膜设置在所述栅层与所述第二半导体主体之间。
13.根据权利要求3所述的半导体装置,
在擦除工作时,将使在所述第二半导体层中的与所述栅层相对向的部分产生GIDL即栅诱导漏泄漏的电位施加到所述栅层。
14.根据权利要求1所述的半导体装置,
在所述第一半导体层中形成空腔。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的