[发明专利]一种半导体芯片及半导体芯片的封装方法在审

专利信息
申请号: 201711384461.3 申请日: 2017-12-20
公开(公告)号: CN107946250A 公开(公告)日: 2018-04-20
发明(设计)人: 赫然;须贺唯知;王英辉 申请(专利权)人: 中科院微电子研究所昆山分所
主分类号: H01L23/13 分类号: H01L23/13;H01L23/367;H01L21/48
代理公司: 北京集佳知识产权代理有限公司11227 代理人: 罗满
地址: 215347 江苏省苏州*** 国省代码: 江苏;32
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摘要:
搜索关键词: 一种 半导体 芯片 封装 方法
【说明书】:

技术领域

发明涉及半导体器件封装领域,特别是涉及一种半导体芯片及半导体芯片的封装方法。

背景技术

随着近年来科技不断的进步,集成电路的集成度也在不断的增加,相应的封装尺寸也在不断的减少,从而导致半导体芯片产生的热量也越来越集中。特别是大功率半导体芯片,其工作温度可以达到150摄氏度以上。在现阶段,制约半导体芯片的集成度进一步增加的主要问题就是散热问题。

在现有技术中,通常是在芯片层与第一基板之间涂抹一层粘结质,例如焊膏,之后再加热让粘结质烧结固化。但是粘结质的热导率通常较低,同时粘结质在烧结之后会形成微小的气孔,使得粘结质整体的导热率进一步降低,从而导致整个半导体芯片的散热性能较差。

发明内容

本发明的目的是提供一种半导体芯片,可以有效增加半导体芯片的散热性能;本发明的另一目的在于提供一种半导体芯片的封装方法,可以有效增加半导体芯片的散热性能。

为解决上述技术问题,本发明提供一种半导体芯片,所述半导体芯片包括芯片层和第一基板;

所述第一基板的表面键合有所述芯片层,所述第一基板中朝向所述芯片层的表面设置有至少一个第一凸起,所述第一凸起周围形成有凹陷区域;

所述第一凸起的上表面与所述芯片层相接触,所述凹陷区域中设置有连接所述芯片层与所述第一基板的粘结质。

可选的,所述芯片层包括半导体层和第一金属层;

所述第一金属层覆盖于所述半导体层朝向所述第一基板的表面。

可选的,所述第一基板朝向所述芯片层的表面覆盖有第二金属层。

可选的,所述第一基板中朝向所述芯片层的表面的边缘部形成有所述凹陷区域,所述边缘部为与所述第一基板的各个侧边的距离在预先设置的范围内的区域。

可选的,所述粘结质为焊膏。

可选的,所述第一基板背向所述芯片层的表面键合有第二基板,所述第二基板与所述第一基板之间设置有第二凸起,所述第二凸起周围形成有所述凹陷区域;

所述第二凸起的上表面与所述第一基板或第二基板相接触,所述凹陷区域中设置有连接所述第一基板与所述第二基板的粘结质。

本发明还提供一种半导体芯片的封装方法,所述方法包括:

在第一基板的凹陷区域中设置粘结质;其中,所述第一基板的表面设置有至少一个第一凸起,所述第一凸起周围形成有所述凹陷区域;

将芯片层压合于所述第一基板的表面,以将具有第一高度的所述第一凸起压低成具有第二高度的第一凸起;

加热所述第一基板和所述芯片层,以使所述第一基板与所述芯片层相互键合。

可选的,所述加热所述第一基板和所述芯片层,以使所述第一基板与所述芯片层相互键合包括:

以第一温度加热所述第一基板和所述芯片层,以使所述第一凸起的上表面直接键合于所述芯片层;

以第二温度加热所述第一基板和所述芯片层,以使所述粘结质固定连接所述第一基板与所述芯片层。

可选的,在所述将芯片层压合于所述第一基板的表面,以将具有第一高度的所述第一凸起压低成具有第二高度的所述第一凸起之前,所述方法还包括:

加热所述第一基板,以挥发所述粘结质中的挥发性物质。

可选的,在所述在第一基板的凹陷区域中设置粘结质之前,所述方法还包括:

清洗所述第一基板。

本发明所提供的一种半导体芯片,在第一基板表面具有第一凸起,该第一凸起会直接与芯片层接触并且进行直接键合,而第一基板表面的凹陷区域会通过粘结质与芯片层进行键合。通过将第一基板直接与芯片层接触可以有效提高半导体芯片的散热性能。

本发明还提供了一种半导体芯片的封装方法,通过将第一基板表面具有第一高度的第一凸起压低成具有第二高度的第一凸起可以保证该第一凸起的上表面与芯片层相接触的区域变得非常平整,即通过将第一凸起压低可以有效补偿第一基板与芯片层之间相接触的表面的粗糙度,从而得以实现所述第一凸起的上表面与芯片层之间的直接键合,通过上述封装方法可以有效提高半导体芯片的散热性能。

附图说明

为了更清楚的说明本发明实施例或现有技术的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单的介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。

图1为本发明实施例所提供的一种半导体芯片的结构示意图;

图2为本发明实施例所提供的另一种半导体芯片的结构示意图;

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