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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]用于在自定时存储器中进行自适应读写操作的方法和电路-CN201910107693.7有效
发明人： A·帕沙克;T·罗伊;S·库马尔 -专利权人：意法半导体国际有限公司
申请日： 2019-02-01 - 公布日： 2023-07-11 - 主分类号： G11C11/419 文献下载
摘要：本文中公开了一种存储器电路，其包括：驱动虚设字线的虚设字线驱动器、耦合到虚设位线和虚设互补位线的虚设存储器单元、以及耦合到虚设字线以从虚设字线驱动器向虚设存储器单元的输入传递字线信号的传输门。晶体管在传输门与虚设存储器单元中沿着虚设字线最靠近传输门的给定虚设存储器单元的成对通过门之间耦合到虚设字线。复位信号输出耦合到虚设互补位线。晶体管用于降低虚设字线上的电压，并且指示所测量的虚设周期的结束的复位信号在复位信号输出处被生成。
用于定时存储器进行自适应读写操作方法电路

[发明专利]显示装置-CN202180004153.1在审
发明人：魏俊波;杨盛际;卢鹏程;黄冠达;田元兰 -专利权人：京东方科技集团股份有限公司;云南创视界光电科技有限公司
申请日： 2021-12-23 - 公布日： 2023-08-25 - 主分类号： H10K59/88 文献下载
摘要：一种显示装置，包括显示区域(100)和虚设区域(300)；显示区域(100)包括多个像素驱动电路和多个显示发光器件(10)，显示发光器件(10)至少包括显示阳极和显示阴极；虚设区域(300)包括阴极电压线40、至少一个虚设阳极连接线(60)和多个虚设发光器件(30)，虚设发光器件(30)至少包括虚设阳极和虚设阴极；显示阴极和虚设阴极均与阴极电压线(40)连接，显示阳极与像素驱动电路连接，虚设阳极与虚设阳极连接线(40)连接，虚设阳极连接线(60)被配置为使虚设阳极与虚设阴极的电压差小于虚设发光器件(30)的起亮电压。
显示装置

[实用新型]存储器电路和存储器设备-CN201920182823.9有效
发明人： A·帕沙克;T·罗伊;S·库马尔 -专利权人：意法半导体国际有限公司
申请日： 2019-02-01 - 公布日： 2019-09-27 - 主分类号： G11C11/419 文献下载
摘要：本文中公开了一种存储器电路和存储器设备，该存储器电路包括：驱动虚设字线的虚设字线驱动器、耦合到虚设位线和虚设互补位线的虚设存储器单元、以及耦合到虚设字线以从虚设字线驱动器向虚设存储器单元的输入传递字线信号的传输门晶体管在传输门与虚设存储器单元中沿着虚设字线最靠近传输门的给定虚设存储器单元的成对通过门之间耦合到虚设字线。复位信号输出耦合到虚设互补位线。晶体管用于降低虚设字线上的电压，并且指示所测量的虚设周期的结束的复位信号在复位信号输出处被生成。
虚设字线虚设存储器单元耦合到存储器电路虚设传输门驱动器复位信号输出存储器设备互补位线晶体管复位信号字线信号成对位线测量驱动传递

[发明专利]虚设部去除单元及利用虚设部去除单元的虚设部去除方法-CN201911176569.2在审
发明人：张喜童;金善根;徐正欢 -专利权人：塔工程有限公司
申请日： 2019-11-26 - 公布日： 2020-11-03 - 主分类号： H01L21/67 文献下载
摘要：本发明提供一种虚设部去除单元及利用虚设部去除单元的虚设部去除方法，虚设部去除单元，其去除通过划线划定的虚设部，划线形成于粘连第一面板和第二面板而构成的基板的第二面板的端部，其中，虚设部去除单元可以包括虚设部加压组件，虚设部加压组件向虚设部的侧面施加虚设部从基板的端部分离的方向上的力。
虚设去除单元利用方法

[发明专利]在其虚设阵列上具有短路结构的存储器阵列及其提供方法-CN202011558658.6在审
发明人： J·B·帕特尔;E·弗洛雷斯三世;K·哈斯纳特;M·F·海因曼 -专利权人：英特尔公司
申请日： 2020-12-25 - 公布日： 2021-12-28 - 主分类号： G11C8/16 文献下载
摘要：存储器设备包括：有源存储器阵列，包括存储器单元和地址线，该地址线包括位线(BL)和字线(WL)，每个存储器单元连接在BL之一和WL之一之间；虚设阵列，其包括虚设地址线，该虚设地址线包括虚设BL和虚设WL；至少一个短路结构，其跨所述虚设地址线中的至少一些虚设地址线延伸并与之电接触，以将所述虚设地址线中的至少一些虚设地址线一起电短路；以及至少一个接触结构，其从虚设阵列延伸并电耦合至所述虚设地址线中的至少一些虚设地址线，以将所述虚设地址线中的至少一些虚设地址线连接至预定电压。
虚设阵列具有短路结构存储器及其提供方法

[发明专利]半导体装置及其制造方法-CN201910485262.4有效
发明人：余德伟;赵晟博;邓运桢 -专利权人：台湾积体电路制造股份有限公司
申请日： 2019-06-05 - 公布日： 2023-05-05 - 主分类号： H01L21/336 文献下载
摘要：在一实施例中，半导体装置的制造方法包含在从基底延伸出的鳍部上沉积虚设介电层；在虚设介电层上沉积虚设栅极晶种层；将虚设栅极晶种层回焊；蚀刻虚设栅极晶种层；以及在虚设栅极晶种层上方选择性地沉积虚设栅极材料，虚设栅极材料和虚设栅极晶种层构成虚设栅极。
半导体装置及其制造方法

[发明专利]虚设图案自动生成方法-CN03122480.6无效
发明人：松本明 -专利权人：恩益禧电子股份有限公司
申请日： 2003-04-28 - 公布日： 2003-11-05 - 主分类号： H01L21/82 文献下载
摘要：本发明的虚设图案自动生成方法包括：第一步，准备多个虚设图案元件，它们各自具有规则排列的虚设图案，且根据预定的规则为这些虚设图案元件设置了优先级；第二步，选择多个虚设图案元件之一，并排列属于被选择的虚设图案元件的虚设图案，使其覆盖设置有排列禁止区的掩模图案布局数据；第三步，从排列的虚设图案中，去除接触或覆盖排列禁止区的虚设图案；和第四步，在多个虚设图案互相接触或覆盖的情况下，去除属于优先级较低的虚设图案元件的虚设图案。
虚设图案自动生成方法

[实用新型]显示装置-CN202320678689.8有效
发明人：李龙熙;郭真善;金璟陪;李智慧 -专利权人：三星显示有限公司
申请日： 2023-03-30 - 公布日： 2023-08-11 - 主分类号： H01L27/15 文献下载
摘要：本公开涉及显示装置，该显示装置包括：显示区域，其中设置有像素，像素中的每个包括第一电极和第二电极以及发光元件；第一虚设像素区域，设置在显示区域之外并且其中设置有虚设像素，虚设像素中的每个包括第一电极、第二电极和发光元件；以及第二虚设像素区域，围绕显示区域和第一虚设像素区域并且其中设置有虚设电极线和虚设电极图案，其中，虚设电极线彼此间隔开并且电连接到虚设像素的第二电极，并且虚设电极图案设置在虚设电极线之间并且与虚设像素的第一电极间隔开
显示装置

[发明专利]半导体存储器装置-CN201911219053.1在审
发明人：金在泽;郑蕙英 -专利权人：爱思开海力士有限公司
申请日： 2019-12-03 - 公布日： 2021-01-19 - 主分类号： H01L27/11517 文献下载
摘要：该半导体存储器装置包括：多个沟道插塞，其被设置在半导体基板的单元区中；第一虚设区和第二虚设区，该第一虚设区被设置在所述单元区的一个端部处，并且该第二虚设区被设置在所述单元区的另一端部处；第一虚设插塞和第二虚设插塞，所述第一虚设插塞被设置在所述第一虚设区中，并且所述第二虚设插塞被设置在所述第二虚设区中。所述第一虚设插塞的数量与所述第二虚设插塞的数量不同。
半导体存储器装置

[发明专利]半导体装置、制造半导体装置的方法以及检查错误的方法-CN202110480740.X在审
发明人：金在泽;郑蕙英 -专利权人：爱思开海力士有限公司
申请日： 2021-04-30 - 公布日： 2022-04-22 - 主分类号： H01L23/528 文献下载
摘要：主虚设图案和测试虚设图案可以形成在下部布线结构上。主虚设图案可以包括通孔图案和宽度比通孔图案的宽度更宽的布线图案。测试虚设图案可以与主虚设图案间隔开不小于临界距离。测试虚设图案可以具有与通孔图案的宽度基本相同的宽度。测试虚设图案可以具有与主虚设图案的高度基本相同的高度。然后可以测试测试虚设图案以基于测试虚设图案的错误来预测主虚设图案的错误。
半导体装置制造方法以及检查错误

[发明专利]阵列基板、具有其的显示装置、及其方法-CN200710005930.6有效
发明人：林智淑;申爱 -专利权人：三星电子株式会社
申请日： 2007-02-15 - 公布日： 2007-08-29 - 主分类号： G02F1/133 文献下载
摘要：本发明提供一种阵列基板，包括底部基板、虚设电路部件、虚设像素部分、延伸线、公共电压线、以及交迭部分。像素部分形成在显示区域中。虚设电路部件形成在外围区域中从而保护所述像素部分免于静电影响。虚设像素部分与虚设电路部件相邻。虚设电路部件处于电浮置状态。延伸线从所述虚设电路部件延伸并关于虚设像素部分电开路。公共电压线与虚设电路部件的延伸线交迭，延伸线关于显示区域电开路，因而显示区域可被保护免于流进虚设电路部件的静电的影响。
阵列具有显示装置及其方法

[发明专利]掩模布局方法、半导体器件及其制造方法-CN200810097071.2无效
发明人：李相熙;曹甲焕 -专利权人：东部高科股份有限公司
申请日： 2008-05-12 - 公布日： 2008-11-12 - 主分类号： H01L27/02 文献下载
摘要：所述半导体器件可包括主图案，第一虚设图案以及第二虚设图案。所述主图案可沉积于衬底上。所述第一虚设图案和所述第二虚设图案可围绕所述主图案的侧边沉积。所述第一虚设图案具有内部开放区域。所述第二虚设图案可沉积于所述第一虚设图案的所述内部开放区域，以使所述第一虚设图案围绕所述第二虚设图案。
布局方法半导体器件及其制造

[发明专利]虚设字线跟踪电路-CN201811226443.7在审
发明人：拉雷特·古普塔;吉滕达拉·达萨尼;维韦克·诺蒂亚;法赫尔丁·阿里·博赫拉 -专利权人： ARM有限公司
申请日： 2018-10-19 - 公布日： 2019-04-30 - 主分类号： G11C7/18 文献下载
摘要：集成电路可以包括虚设字线电路，所述虚设字线电路具有经由虚设字线耦合到多个虚设字线负载的虚设字线驱动器。集成电路可以包括多路分配器电路，所述多路分配器电路耦合到虚设字线驱动器与多个虚设字线负载之间的虚设字线的第一路径。集成电路可以包括多路复用器电路，所述多路复用器电路耦合到多个虚设字线负载与虚设位线负载之间的虚设字线的第二路径。可以用一个或多个选择信号控制多路分配器电路和多路复用器电路以选择多个虚设字线负载中的至少一个。
虚设字线多路复用器电路多路分配器集成电路电路驱动器耦合到电路耦合跟踪电路位线负载选择信号虚设

[发明专利]半导体器件及其制造方法-CN200710161861.8无效
发明人：李相熙;曹甲焕 -专利权人：东部高科股份有限公司
申请日： 2007-09-24 - 公布日： 2008-10-29 - 主分类号： H01L27/00 文献下载
摘要：一种半导体器件及其制造方法，其中根据实施例的半导体器件包括第一组虚设图案和第二组虚设图案，该第二组虚设图案与第一组虚设图案以第二间距分隔开。第一组虚设图案包括多个第一虚设图案，该多个第一虚设图案以第一间距彼此分隔开而形成。第二组虚设图案包括多个第二虚设图案，该多个第二虚设图案以第一间距彼此分隔开而形成。第一虚设图案和第二虚设图案具有相同形状和大小。本发明的半导体器件及其制造方法可以确保图案一致性以及简化设计工艺和制造工艺。
半导体器件及其制造方法

[发明专利]虚设单电池的制造方法以及虚设单电池的制造装置-CN202010146724.2有效
发明人：井上大辅 -专利权人：本田技研工业株式会社
申请日： 2020-03-05 - 公布日： 2023-05-16 - 主分类号： H01M8/2465 文献下载
摘要：本公开涉及虚设单电池的制造方法以及虚设单电池的制造装置。在虚设单电池的制造方法的一体化工序中，对虚设层叠体(168)进行加热并且按压来使粘接剂(120a)硬化，将虚设层叠体(168)一体化，虚设层叠体(168)是将虚设结构体(110)与虚设树脂框构件(111在一体化工序中，在使限制突起(166)与虚设树脂框构件(111)的外周端面(82a)接触来限制虚设树脂框构件(111)朝向外方变形的状态下，对虚设层叠体(168)进行加热和按压。
虚设电池制造方法以及装置

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