专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体器件的制备方法及半导体器件-CN202010732615.9有效
  • 张魁;应战 - 长鑫存储技术有限公司
  • 2020-07-27 - 2022-12-16 - H01L21/762
  • 该方法包括:提供半导体衬底,其包括浅沟槽及有源区;在浅沟槽及有源区暴露的外表面形成含氧层;在表面包括含氧层的浅沟槽内填充设定高度的第一隔离层,设定高度低于有源区的高度;在第一隔离层的上表面形成刻蚀停止层;在浅沟槽中刻蚀停止层之上填充第二隔离层,以形成沟槽隔离结构;刻蚀有源区和浅沟槽隔离结构,以形成字线沟槽,其中浅沟槽隔离结构内的字线沟槽的底部高于设定高度。本公开的制备方法可以利用刻蚀停止层,控制浅沟槽隔离结构内的字线沟槽的深度,使其尽量与有源区内的字线沟槽的深度保持一致。
  • 半导体器件制备方法
  • [发明专利]沟槽隔离结构的制造方法-CN201410356831.2无效
  • 鲍宇 - 上海华力微电子有限公司
  • 2014-07-25 - 2014-10-01 - H01L21/762
  • 本发明提供一种浅沟槽隔离结构的制造方法,包括:提供一半导体衬底,且在所述衬底上形成硬质掩膜层,所述硬质掩膜层内形成暴露出所述衬底的开口;采用刻蚀工艺在所述衬底中形成隔离沟槽;对所述硬质掩膜层进行回刻,并在所述隔离沟槽侧壁、底部表面形成内衬层;沉积隔离介质层充满所述隔离沟槽并覆盖所述硬质掩膜层的表面,并对所述隔离介质层进行平坦化;对所述隔离介质层进行回刻;在所述隔离介质层表面形成氧化硅侧墙;采用刻蚀工艺去除所述硬质掩膜层,以形成沟槽隔离结构。本发明可避免在浅沟槽隔离结构与半导体衬底接缝处出现凹槽,提高所形成沟槽隔离结构的形貌,进而提高包含所形成沟槽隔离结构的半导体器件的电学性能。
  • 沟槽隔离结构制造方法
  • [发明专利]屏蔽栅沟槽MOSFET及其制备方法、电子设备-CN201911395093.1在审
  • 杨国江;范荣定;陈炜;刘健;夏昊天;葛海波 - 江苏长晶科技有限公司
  • 2019-12-30 - 2020-06-05 - H01L29/78
  • 本发明提供了一种屏蔽栅沟槽MOSFET及其制备方法、电子设备,该制备方法包括:在外延半导体层上形成沟槽;在沟槽的内壁形成第一绝缘层,并在沟槽形成第一栅极,第一绝缘层和第一栅极延伸至外延半导体层的表面,第一绝缘层用于隔开第一栅极和外延半导体层;刻蚀第一绝缘层和第一栅极,使得刻蚀后的第一绝缘层的表面与刻蚀后的第一栅极的表面共面;在刻蚀后的第一栅极和刻蚀后的第一绝缘层的表面形成层间介电层;在沟槽的上部的侧壁上形成第二绝缘层,并在沟槽的上部中形成第二栅极,其中,沟槽的上部为层间介电层远离第一栅极的表面沟槽开口的部分。本发明的技术方案利用,能够简化工艺、提高屏蔽栅沟槽MOSFET的性能和可靠性。
  • 屏蔽沟槽mosfet及其制备方法电子设备
  • [发明专利]屏蔽栅沟槽MOSFET及其制备方法、电子设备-CN202010906159.5在审
  • 杨国江;赖信彰;于世珩 - 江苏长晶科技有限公司
  • 2020-09-01 - 2020-10-27 - H01L29/78
  • 本发明提供了一种屏蔽栅沟槽MOSFET及其制备方法、电子设备,该制备方法包括:在外延半导体层上形成沟槽;在沟槽的内壁形成第一绝缘层,并在沟槽形成第一栅极,第一绝缘层和第一栅极延伸至外延半导体层的表面,第一绝缘层用于隔开第一栅极和外延半导体层;刻蚀第一绝缘层和第一栅极,使得刻蚀后的第一绝缘层的表面与刻蚀后的第一栅极的表面共面;在刻蚀后的第一栅极和刻蚀后的第一绝缘层的表面形成层间介电层;在沟槽的上部的侧壁上形成第二绝缘层,并在沟槽的上部中形成第二栅极,其中,沟槽的上部为层间介电层远离第一栅极的表面沟槽开口的部分。本发明的技术方案利用,能够简化工艺、提高屏蔽栅沟槽MOSFET的性能和可靠性。
  • 屏蔽沟槽mosfet及其制备方法电子设备
  • [发明专利]形成沟槽隔离(STI)结构的方法-CN201680032734.5有效
  • 贾斯丁·希罗奇·萨托;格雷戈里·艾伦·斯托姆 - 密克罗奇普技术公司
  • 2016-06-03 - 2022-01-25 - H01L21/02
  • 本发明提供一种形成用于集成电路的沟槽隔离(例如,STI)的方法,所述方法包含:在半导体衬底上方形成垫氧化物层且接着形成氮化物层;穿透所述结构执行沟槽蚀刻以形成沟槽;沉积沟槽氧化物层于所述结构上方以形成经填充沟槽;沉积牺牲平坦化层于所述经沉积氧化物上方,所述牺牲平坦化层对所述沟槽氧化物层具有蚀刻选择性;执行平坦化蚀刻工艺,其移除所述牺牲平坦化层且减小所述沟槽氧化物层的上表面中的表面变化;执行氧化物蚀刻工艺,其对所述沟槽氧化物层具有选择性以移除所述经填充沟槽外侧的所述沟槽氧化物层的剩余部分;及移除剩余氮化物层,使得所述剩余经氧化物填充沟槽界定突出于所述半导体衬底的经曝露上表面上方的沟槽隔离结构。
  • 形成沟槽隔离sti结构方法
  • [发明专利]芯片封装体的制造方法-CN201910047741.8在审
  • 赖建志;林泓彣 - 典琦科技股份有限公司
  • 2019-01-18 - 2020-07-28 - H01L21/48
  • 提供晶圆,此晶圆具有上表面及与其相对的下表面,且包含多个导电垫位于上表面形成多个导电凸块分别位于对应的导电垫上。由下表面朝上表面薄化晶圆。形成绝缘层于下表面下方。刻蚀晶圆的上表面形成多个沟槽,且这些沟槽暴露出绝缘层。形成钝化层覆盖各沟槽的内壁。沿着各沟槽切割钝化层和绝缘层,以形成多个芯片封装体。上述方法可以避免产生对位偏移的问题。
  • 芯片封装制造方法
  • [发明专利]半导体器件的制备方法及半导体器件-CN202010733747.3在审
  • 张魁;应战 - 长鑫存储技术有限公司
  • 2020-07-27 - 2022-01-28 - H01L21/762
  • 该方法包括:提供半导体衬底,所述半导体衬底包括浅沟槽及所述浅沟槽隔离出的有源区;在所述浅沟槽及所述有源区暴露的外表面形成含氧层;在表面包括所述含氧层的所述浅沟槽内填充设定高度的第一牺牲层,所述设定高度低于所述有源区的高度;在所述第一牺牲层的上表面形成刻蚀停止层;去除所述刻蚀停止层下方的所述第一牺牲层,以形成空气间隔;在所述浅沟槽中所述刻蚀停止层之上填充隔离层,以形成包含所述空气间隔的浅沟槽隔离结构;刻蚀所述有源区和所述浅沟槽隔离结构,以形成字线沟槽,其中所述浅沟槽隔离结构内的字线沟槽的底部高于所述设定高度。
  • 半导体器件制备方法
  • [发明专利]半导体结构的制作方法及半导体结构-CN202110291828.7在审
  • 张炜超 - 长鑫存储技术有限公司
  • 2021-03-18 - 2022-09-27 - H01L21/8242
  • 本发明提出一种半导体结构的制作方法及半导体结构,半导体结构的制作方法包括:提供衬底,衬底包括有源区和隔离区,隔离区包括第一沟槽形成于第一沟槽的隔离层;去除部分隔离层,以形成第一凹槽;形成第一掩膜层,第一掩膜层覆盖有源区的上表面并填充满第一凹槽;平坦化第一掩膜层,使位于有源区上方的第一掩膜层的上表面与位于隔离区上方的第一掩膜层的上表面齐平;去除部分第一掩膜层、部分隔离层和部分衬底,以形成第二沟槽和第三沟槽;其中,第二沟槽位于隔离区内,第三沟槽位于有源区内,第三沟槽的宽度大于第二沟槽的宽度;于第二沟槽和第三沟槽形成字线结构。
  • 半导体结构制作方法
  • [发明专利]图像传感器及其制造方法-CN202210647954.6在审
  • 董立群;肖海波;林率兵 - 豪威集成电路(成都)有限公司
  • 2022-06-08 - 2022-08-19 - H01L27/146
  • 本发明提供一种图像传感器及其制造方法,包括:提供衬底,衬底具有相对的第一表面和第二表面;执行干法刻蚀,形成前段沟槽;执行湿法刻蚀,将前段沟槽向第二表面一侧(下)以及侧向刻蚀形成后段沟槽;前段沟槽和后段沟槽构成栅极沟槽形成栅极,栅极纵向部填充在栅极沟槽中。本发明的栅极结构,一方面和同样开口尺寸的垂直栅极结构相比,后段沟槽的截面宽度从第一表面一侧到第二表面一侧逐渐变大,即将栅极沟槽的底部尺寸做大从而增大电子底部传输表面积,以提高底部电子传输效率,增加满井容量;另一方面和仅采用干法刻蚀形成的同样深度的垂直栅结构相比,采用先干法后湿法刻蚀可减少干法刻蚀带来的等离子损伤,减少白像素,提高像素质量。
  • 图像传感器及其制造方法

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