专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]掩模坯件的制造方法-CN200580032601.X有效
  • 大久保靖 - HOYA株式会社
  • 2005-11-04 - 2007-08-29 - G03F1/14
  • 掩模坯件基片上形成将成为掩模图案的薄膜的薄膜形成工序和于上述薄膜上形成剂膜的剂膜形成工序的掩模坯件制造方法,此方法包括:保存包含有将上述剂膜形成于上述薄膜上的日期信息的剂膜形成信息的工序;将上述剂膜形成信息与上述掩模坯件相对应的工序;基于上述剂膜形成信息,确定形成于上述掩模坯件上的剂膜的灵敏度变化超过允许范围的掩模坯件的工序;将上述确定的掩模坯件上所形成的剂膜剥离的工序;在剥离了上述剂膜的上述薄膜上再次形成剂膜的工序。
  • 掩模坯件制造方法
  • [发明专利]掩模坯体及转印掩模的制造方法-CN200780034381.3有效
  • 桥本雅广 - HOYA株式会社
  • 2007-09-14 - 2009-08-26 - G03F1/08
  • 本发明提供制作半导体设计规则(DRAM hp65nm以下)的转印掩模时,能够防止剂图案的消失,能够防止图案缺陷的掩模坯体、及掩模。其特征在于,该掩模坯体具备用于在基板上成膜的掩模图案的薄膜、和在该薄膜的上方成膜的剂膜,通过插入有与所述薄膜和所述剂膜接合的附着层,在进行使所述剂膜形成为图案的显影时,防止形成为图案的剂膜的倒塌
  • 掩模坯体转印掩模制造方法
  • [发明专利]沉积掩模的制造方法-CN201610227809.7有效
  • 郑性基;姜圭修 - 三星显示有限公司
  • 2016-04-13 - 2020-07-28 - C23C14/04
  • 本发明一实施方式公开了沉积掩模的制造方法,该方法包括以下步骤:在衬底的外表面上涂覆第一光致剂层;在第一光致剂层上布置第一光掩模,并且在调节第一光致剂层与第一光掩模之间的距离的同时曝光第一光致剂层的一部分;对第一光致剂层进行显影以在第一光致剂层中形成第一掩模图案孔;在第一掩模图案孔中镀上第一金属层;以及去除第一光致剂层。
  • 沉积用掩模制造方法
  • [发明专利]图形形成法-CN96108243.7无效
  • 李相均 - 三星航空产业株式会社
  • 1996-07-18 - 2004-04-28 - C23F1/02
  • 一种图形形成法包括下列工序:在基板上形成不溶于刻蚀溶液的金属电镀薄膜;在电镀薄膜上形成光致薄膜;预定的光掩模图形将光致薄膜曝光然后显影,由此制取光致图形;用光致图形作为掩模制取电镀薄膜图形;完全清除光致图形;用电镀薄膜图形作为刻蚀掩模刻蚀基片,然后完全清除电镀薄膜图形。本发明由于用电镀薄膜图形代替了光致图形作为基片刻蚀工序中的刻蚀掩模,故可准确精密加工引线框架。
  • 图形形成
  • [发明专利]蒸镀掩模的制造方法-CN202211142523.0在审
  • 福田加一 - 株式会社日本显示器
  • 2022-09-20 - 2023-03-31 - C23C14/04
  • 本发明提供一种简单的方法来制造蒸镀效率优异的蒸镀掩模的制造方法。蒸镀掩模的制造方法包括:将剂图案作为掩模来形成第一镀层的步骤;使所述剂图案变形的步骤;和将变形后的所述剂图案作为掩模,在所述第一镀层之上形成第二镀层的步骤。通过使所述剂图案变形,可以使变形后的所述剂图案与所述第一镀层的一部分重叠。
  • 蒸镀掩模制造方法
  • [发明专利]电流控制TFT基板的制造方法-CN201010237355.4有效
  • 井上一吉;矢野公规;田中信夫 - 出光兴产株式会社
  • 2007-04-10 - 2010-12-15 - H01L21/77
  • 电流控制TFT基板制造方法,层叠导电体层及第1剂层,第1掩模形成扫描线、开关管栅极及栅极线;层叠开关管栅极绝缘膜;层叠具有非晶Si或多晶Si的活性层或氧化物半导体层、导电体层及第2剂层,第2半色调掩模形成数据线、开关管源极线、源极、沟道部、漏极、漏极线、驱动管栅极线及栅电极;层叠驱动管栅极绝缘膜;层叠氧化物半导体层及第3剂层,第3掩模形成驱动管活性层;层叠氧化物导电体层及第4剂层,第4掩模或第4半色调掩模形成EL驱动线、驱动管源极线、源极、沟道部、漏极、漏极线及像素电极;和层叠绝缘保护膜及第5剂层,第5掩模使扫描线凸台、数据线凸台、EL驱动线凸台及像素电极露出。
  • 电流控制tft制造方法
  • [发明专利]介电器件的制造方法和灰化方法-CN201180060675.X无效
  • 吉田善明;小风豊 - 株式会社爱发科
  • 2011-12-19 - 2013-08-21 - H01L21/311
  • 本发明提供了能够抑制剂残留物的介电器件的制造方法和灰化方法。在所述灰化方法中,将通过由有机材料形成的掩模(6)含氯气体或氟碳类气体的等离子体对表面进行刻蚀的基材配置在腔室内,在所述腔室内通过氧离子对所述掩模(6)进行轰击处理,在所述腔室内通过氧自由基去除所述掩模根据所述灰化方法,通过氧离子进行的轰击处理,物理去除粘附于所述掩模表面的刻蚀反应物。由此,可抑制由刻蚀反应物引起的剂残留物的产生,可有效地从所述基材表面去除所述掩模
  • 器件制造方法灰化
  • [发明专利]半导体元件搭载基板的制造方法-CN201480013843.3有效
  • 细樅茂 - 友立材料株式会社
  • 2014-03-11 - 2018-02-27 - H01L23/12
  • 为了提高电极层与树脂之间密合性强度,提供一种增加电极层的厚度并且为了咬入树脂而使电极层的截面形状形成为具有凹凸的形状的半导体元件搭载基板。该半导体元件搭载基板的制造方法依次经过以下工序使用主感光波长不同的两种干膜剂在基板(1)表面形成多个层(10、11)的工序;第1曝光工序,自多个层的上方使用第1曝光用掩模(20)从多个层中选择性地使特定的层(10)以第1图案感光;第2曝光工序,自多个层的上方使用第2曝光用掩模(21)从多个层中选择性地使特定的层(11)以第2图案感光;显影工序,去除多个层的未曝光部分(30、31)而使基板的表面局部露,出从而形成具有开口部(40、41)的掩模(10、11);对基板的表面的暴露的部分实施镀敷从而形成镀层(2)的工序;以及去除掩模的工序。
  • 半导体元件搭载用基板制造方法
  • [发明专利]含有具有仲氨基的酚醛清漆聚合物的剂下层膜形成组合物-CN201480070504.9有效
  • 西卷裕和;桥本圭祐;坂本力丸;远藤贵文 - 日产化学工业株式会社
  • 2014-12-15 - 2019-12-06 - G03F7/11
  • 本发明的目的在于提供具有良好的硬掩模功能、并能够形成良好的图案形状的剂下层膜。本发明提供了用于光刻工序的剂下层膜形成组合物,含有通过具有仲氨基的芳香族化合物与醛化合物的反应而得的酚醛清漆聚合物。酚醛清漆聚合物为含有式(1)所示的结构单元的聚合物。本发明还提供了半导体装置的制造方法,包括下述工序:利用本发明的剂下层膜形成组合物在半导体基板上形成剂下层膜的工序;在该下层膜上形成硬掩模的工序;进而在该硬掩模上形成剂膜的工序;通过光或电子束的照射和显影来形成剂图案的工序;利用所形成的剂图案对硬掩模进行蚀刻的工序;利用图案化了的硬掩模对该剂下层膜进行蚀刻的工序;及利用图案化了的剂下层膜对半导体基板进行加工的工序。
  • 含有具有氨基酚醛清漆聚合物抗蚀剂下层形成组合

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