专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体开关-CN201310253316.7在审
  • 王柏之 - 瑞昱半导体股份有限公司
  • 2013-06-24 - 2014-12-24 - H03K17/08
  • 一种半导体开关,包含一开关单元,其包含:一晶体管,具有一漏、一栅极以及一;一漏偏压电阻,耦接漏;一漏偏压选择电路,于晶体管导通时耦接漏偏压电阻与一第一漏偏压,于晶体管不导通时耦接漏偏压电阻与一第二漏偏压;一栅极偏压电阻,耦接栅极;一栅极偏压选择电路,于晶体管导通时耦接栅极偏压电阻与一第一栅极偏压,于晶体管不导通时耦接栅极偏压电阻与一第二栅极偏压;一偏压电阻,耦接;以及一偏压选择电路,于晶体管导通时耦接偏压电阻与一第一偏压,于晶体管不导通时耦接偏压电阻与一第二偏压,其中第一与第二漏偏压不同,第一与第二栅极偏压不同,第一与第二偏压不同。
  • 半导体开关
  • [发明专利]半导体开关-CN201911267096.7在审
  • 闻林 - 闻林
  • 2019-12-11 - 2021-06-11 - H03K17/687
  • 一种半导体开关,包含一开关单元,其包含:一晶体管,具有一漏、一栅极以及一;一漏偏压电阻,耦接漏;一漏偏压选择电路,于晶体管导通时耦接漏偏压电阻与一第一漏偏压,于晶体管不导通时耦接漏偏压电阻与一第二漏偏压;一栅极偏压电阻,耦接栅极;一栅极偏压选择电路,于晶体管导通时耦接栅极偏压电阻与一第一栅极偏压,于晶体管不导通时耦接栅极偏压电阻与一第二栅极偏压;一偏压电阻,耦接;以及一偏压选择电路,于晶体管导通时耦接偏压电阻与一第一偏压,于晶体管不导通时耦接偏压电阻与一第二偏压,其中第一与第二漏偏压不同,第一与第二栅极偏压不同,第一与第二偏压不同。
  • 半导体开关
  • [发明专利]一种晶体管器件以及电子设备-CN201811424390.X有效
  • 刘召军;王河深 - 南方科技大学
  • 2018-11-27 - 2021-11-09 - H01L29/786
  • 该晶体管器件包括依次层叠设置的栅极栅极绝缘层、有源层以及层;层包括彼此间隔设置的和漏覆盖部分有源层以及部分栅极绝缘层;漏覆盖部分有源层以及部分栅极绝缘层;栅极绝缘层上的垂直投影与漏栅极绝缘层上的垂直投影不重合;栅极绝缘层包括电解质;晶体管器件还包括保护层;保护层位于栅极绝缘层之间;和/或,保护层位于漏栅极绝缘层之间。
  • 一种晶体管器件以及电子设备
  • [发明专利]半导体装置-CN202211252308.6在审
  • 闵信喆;千健龙;高明东;朴容喜;李尚炫;金洞院;申宇胜;李炯锡 - 三星电子株式会社
  • 2022-10-13 - 2023-04-18 - H01L27/092
  • 提供了一种半导体装置,所述半导体装置包括具有下图案和与下图案间隔开的片图案的有源图案、在下图案上并具有围绕每个片图案的栅电极和栅极绝缘膜的栅极结构、在栅极结构上的栅极覆盖图案、在栅极覆盖图案和栅极结构之间的栅极蚀刻停止图案、沿着栅极覆盖图案的侧壁的栅极间隔件、在栅极结构上的/漏图案、穿过栅极覆盖图案并连接到栅电极的栅极接触件以及在/漏图案上并连接到/漏图案的/漏接触件,栅极接触件的上表面和栅极间隔件的上表面共面
  • 半导体装置
  • [发明专利]光感测装置的光感测单元-CN202110382748.2在审
  • 林圣佳;蔡清丰 - 和鑫光电股份有限公司
  • 2021-04-09 - 2022-10-18 - H01L27/146
  • 光感测元件包括栅极、半导体层、栅极绝缘层、以及漏栅极与半导体层设置于基板上,栅极绝缘层将栅极与半导体层分隔开,且与漏分别连接于半导体层。以及漏的其中至少一个由光通过导电层所形成。半导体层设置于以及漏的其中一个与栅极之间,并且沿着基板的法线方向观看,栅极重叠于以及漏的所述其中一个,且栅极不重叠于以及漏的其中另一个。
  • 光感测装置单元
  • [发明专利]半导体器件-CN202110207134.0在审
  • 廖忠志 - 台湾积体电路制造股份有限公司
  • 2021-02-24 - 2021-12-07 - H01L29/417
  • 第一晶体管包括位于第一和第二/漏部件之间的第一沟道构件、包围在第一沟道构件周围的第一栅极结构、设置在第一/漏部件上方的第一/漏接触件以及设置在第一栅极结构与第一/漏接触件之间的第一顶部栅极间隔件第二晶体管包括位于第三和第四/漏部件之间的第二沟道构件、包围在第二沟道构件周围的第二栅极结构、设置在第三/漏部件上方的第二/漏接触件以及设置在第二栅极结构与第二/漏接触件之间的第二顶部栅极间隔件第二栅极间隔件和第二/漏接触件之间的距离大于第一栅极间隔件和第一/漏接触件之间的距离。
  • 半导体器件
  • [发明专利]一种CMOS全加器-CN202210602693.6有效
  • 周玉梅;黎涛;乔树山;尚德龙 - 中科南京智能技术研究院
  • 2022-05-31 - 2022-08-09 - H03K19/20
  • 全加器中管P1的连接至VDD,管P1的栅极与管N1的漏及管N2的栅极相连,管P1的漏与管P2的相连;管P2的栅极接A,管P2的漏与管N1的、管N2的、管N4的栅极、管N5的栅极、管P4的栅极及管P5的栅极相连;管N1的栅极和管N2的漏接A,管P3的接VDD,管P3的漏与管N3的漏、管P4的相连,管P3的栅极与管N3的栅极相连,并接入CIN,管N3的接VSS,管P4的漏与管N4的相连,管N4的漏接CIN;管P5的接CIN,管P5的漏与管N5的相连,管N5的漏接A。
  • 一种cmos全加器
  • [发明专利]栅极变化的场效晶体管结构及其制造方法、芯片装置-CN202110486545.8有效
  • 任炜强 - 深圳真茂佳半导体有限公司
  • 2021-04-30 - 2022-05-17 - H01L29/06
  • 本发明涉及一种多栅极变化的场效晶体管结构及其制造方法、芯片装置,晶体管包括位于底层的漏外延层、位于顶层的层以及嵌入于漏外延层内的延伸倒鳍、第一栅极与第二栅极;第一栅极排列在延伸倒鳍之间,第二栅极对准在延伸倒鳍上,第一栅极与第二栅极的两侧各形成有成对由层至漏外延层内部并联的对称型沟道;优选示例中,漏外延层在对应延伸倒鳍的底部部位形成屏蔽栅底部浮空反型柱底结。本发明提供的场效晶体管架构为多栅极变化的密集化,具有衬底背面漏与顶面电子流分区均匀化的效果、以及减少开槽工艺的效果。
  • 栅极变化晶体管结构及其制造方法芯片装置
  • [发明专利]一种半导体器件及其制造方法-CN202111436365.5有效
  • 林智伟;陈维邦;郑志成;郭哲劭 - 晶芯成(北京)科技有限公司
  • 2021-11-30 - 2022-02-11 - H01L21/336
  • 本发明提供一种半导体器件及其制造方法,半导体器件的制造方法通过在栅极结构上方形成绝缘结构层;以及形成栅极接触孔,并形成接触、漏接触和栅极接触,接触孔的孔底暴露出和绝缘结构层,漏接触孔的孔底暴露出漏和所述绝缘结构层,通过在栅极结构上方形成绝缘结构层,使得绝缘结构层保护所述栅极结构,从而使得接触和漏接触可以有效的电连接并绝缘于栅极结构的区域,提升了接触和漏接触制程的容许范围,减少了接触和漏接触分别与栅极结构之间接触短路,从而减少了栅极接触与漏接触,及栅极接触与接触短路的可能,有效提高了半导体器件的良率,达到了增加产量及营收的效果。
  • 一种半导体器件及其制造方法
  • [发明专利]半导体结构-CN202010662141.5在审
  • 翁翊轩;李威养;杨丰诚;陈燕铭 - 台湾积体电路制造股份有限公司
  • 2020-07-10 - 2021-02-02 - H01L29/78
  • 本发明实施例提供一种半导体结构,其包括多个半导体层的堆叠、第一金属栅极堆叠、第二金属栅极堆叠、/漏结构以及/漏接点。多个半导体层的一堆叠位于基板上;第一金属栅极堆叠位于半导体层的堆叠上;第二金属栅极堆叠交错于半导体层的堆叠之间;/漏结构位于半导体层的堆叠中;/漏接点位于/漏结构上。在许多例子中,/漏结构与第二金属栅极堆叠的侧壁隔有第一气隙,且/漏接点与第一金属栅极堆叠的侧壁隔有第二气隙。
  • 半导体结构
  • [发明专利]半导体装置的形成方法-CN202110717995.3在审
  • 方婷;蔡忠浩;林芮萍;姚佳贤;李振铭;杨复凯;王美匀 - 台湾积体电路制造股份有限公司
  • 2021-06-28 - 2021-11-30 - H01L21/8234
  • 工作件包含栅极结构;第一栅极间隔物部件;第二栅极间隔物部件;在栅极结构、第一栅极间隔物部件以及第二栅极间隔物部件上方的栅极顶部介电质部件;在第一/漏区上方的第一/漏部件;在第二/漏区上方的第二/漏部件;在第一/漏部件上方的第一介电层;以及在第二/漏部件上方的第二介电层。方法还包含以第一硬遮罩层取代第一介电层的顶部部分;在第二介电层被暴露的同时,在第一硬遮罩层上方形成第二硬遮罩层;蚀刻第二介电层以形成/漏接触件开口并且暴露出第二/漏部件;以及在第二/漏部件上方形成/漏接触件。
  • 半导体装置形成方法

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