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- [发明专利]半导体开关-CN201310253316.7在审
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王柏之
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瑞昱半导体股份有限公司
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2013-06-24
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2014-12-24
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H03K17/08
- 一种半导体开关,包含一开关单元,其包含:一晶体管,具有一漏极、一栅极以及一源极;一漏极偏压电阻,耦接漏极;一漏极偏压选择电路,于晶体管导通时耦接漏极偏压电阻与一第一漏极偏压,于晶体管不导通时耦接漏极偏压电阻与一第二漏极偏压;一栅极偏压电阻,耦接栅极;一栅极偏压选择电路,于晶体管导通时耦接栅极偏压电阻与一第一栅极偏压,于晶体管不导通时耦接栅极偏压电阻与一第二栅极偏压;一源极偏压电阻,耦接源极;以及一源极偏压选择电路,于晶体管导通时耦接源极偏压电阻与一第一源极偏压,于晶体管不导通时耦接源极偏压电阻与一第二源极偏压,其中第一与第二漏极偏压不同,第一与第二栅极偏压不同,第一与第二源极偏压不同。
- 半导体开关
- [发明专利]半导体开关-CN201911267096.7在审
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闻林
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闻林
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2019-12-11
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2021-06-11
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H03K17/687
- 一种半导体开关,包含一开关单元,其包含:一晶体管,具有一漏极、一栅极以及一源极;一漏极偏压电阻,耦接漏极;一漏极偏压选择电路,于晶体管导通时耦接漏极偏压电阻与一第一漏极偏压,于晶体管不导通时耦接漏极偏压电阻与一第二漏极偏压;一栅极偏压电阻,耦接栅极;一栅极偏压选择电路,于晶体管导通时耦接栅极偏压电阻与一第一栅极偏压,于晶体管不导通时耦接栅极偏压电阻与一第二栅极偏压;一源极偏压电阻,耦接源极;以及一源极偏压选择电路,于晶体管导通时耦接源极偏压电阻与一第一源极偏压,于晶体管不导通时耦接源极偏压电阻与一第二源极偏压,其中第一与第二漏极偏压不同,第一与第二栅极偏压不同,第一与第二源极偏压不同。
- 半导体开关
- [发明专利]半导体器件-CN202110207134.0在审
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廖忠志
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台湾积体电路制造股份有限公司
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2021-02-24
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2021-12-07
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H01L29/417
- 第一晶体管包括位于第一和第二源极/漏极部件之间的第一沟道构件、包围在第一沟道构件周围的第一栅极结构、设置在第一源极/漏极部件上方的第一源极/漏极接触件以及设置在第一栅极结构与第一源极/漏极接触件之间的第一顶部栅极间隔件第二晶体管包括位于第三和第四源极/漏极部件之间的第二沟道构件、包围在第二沟道构件周围的第二栅极结构、设置在第三源极/漏极部件上方的第二源极/漏极接触件以及设置在第二栅极结构与第二源极/漏极接触件之间的第二顶部栅极间隔件第二栅极间隔件和第二源极/漏极接触件之间的距离大于第一栅极间隔件和第一源极/漏极接触件之间的距离。
- 半导体器件
- [发明专利]一种CMOS全加器-CN202210602693.6有效
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周玉梅;黎涛;乔树山;尚德龙
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中科南京智能技术研究院
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2022-05-31
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2022-08-09
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H03K19/20
- 全加器中管P1的源极连接至VDD,管P1的栅极与管N1的漏极及管N2的栅极相连,管P1的漏极与管P2的源极相连;管P2的栅极接A,管P2的漏极与管N1的源极、管N2的源极、管N4的栅极、管N5的栅极、管P4的栅极及管P5的栅极相连;管N1的栅极和管N2的漏极接A,管P3的源极接VDD,管P3的漏极与管N3的漏极、管P4的源极相连,管P3的栅极与管N3的栅极相连,并接入CIN,管N3的源极接VSS,管P4的漏极与管N4的源极相连,管N4的漏极接CIN;管P5的源极接CIN,管P5的漏极与管N5的源极相连,管N5的漏极接A。
- 一种cmos全加器
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