专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]的形成方法及-CN202210628366.8在审
  • 池田梢 - 富士胶片株式会社
  • 2022-06-06 - 2022-12-20 - H01L21/56
  • 本发明涉及的形成方法及,所述通过上述的形成方法形成。上述的形成方法使用了在常温下高粘度且因加热而上述粘度降低的,上述的形成方法能够形成厚为300μm以上且面内膜厚变动在10%以内的。上述的形成方法包括:工序A,在基材上赋予23℃下的粘度为1000mPa·s~30000mPa·s的,从而形成上述;工序B,对配置在由限制上述流出的限制部件包围的区域内的上述进行热处理;及工序C,隔着片材对配置在通过设置将上述调整为所期望厚度的调整部件而形成的区域内的、上述热处理后的上述进行热压。
  • 抗蚀剂膜形成方法
  • [发明专利]用于制备光致图案的方法-CN201010517468.X无效
  • 畑光宏;桥本和彦 - 住友化学株式会社
  • 2010-10-19 - 2011-05-04 - G03F7/00
  • 本发明提供用于制备光致图案的方法,所述方法包括步骤(1)至(11):(1)在基底上涂覆第一光致组合物,接着进行干燥,由此形成第一光致,(2)预焙烘第一光致,(3)将预烘焙的第一光致曝光于辐射,(4)烘焙曝光的第一光致,(5)用第一碱性显影液将烘焙的第一光致显影,由此形成第一光致图案,(6)在第一光致图案上形成涂层,(7)在涂层上涂覆第二光致组合物,接着进行干燥,由此形成第二光致,(8)预焙烘第二光致,(9)将预烘焙的第二光致曝光于辐射,(10)烘焙曝光的第二光致,和(11)用第二碱性显影液将烘焙的第二光致显影,由此形成第二光致图案
  • 用于制备光致抗蚀剂图案方法
  • [发明专利]的形成方法-CN202210627987.4在审
  • 池田梢 - 富士胶片株式会社
  • 2022-06-06 - 2022-12-20 - H01L21/56
  • 本发明提供一种的形成方法,其使用了在常温下具有高粘度且因加热而上述粘度降低的,在所述的形成方法中,能够形成气泡减少的。所述的形成方法包括:工序A,在基板上赋予23℃下的粘度为1000mPa·s~30000mPa·s的,从而形成上述;及工序B,对上述进行热处理,上述工序B包括:工序B‑1,通过逐级地或连续地提高上述的温度而降低上述的粘度;及工序B‑2,在真空环境下加热粘度为5000mPa·s以下的上述
  • 抗蚀剂膜形成方法
  • [发明专利]具有砜结构及胺结构的含硅下层形成组合物-CN201380032731.8有效
  • 菅野裕太;高濑显司;中岛诚;武田谕;若山浩之 - 日产化学工业株式会社
  • 2013-06-19 - 2017-06-16 - C07F7/18
  • 本发明提供光刻用下层形成组合物。解决手段是采用下述式(1‑a)或式(1‑b)表示的硅烷化合物。该光刻用下层形成组合物包含作为硅烷的水解性有机硅烷、其水解物及其水解缩合物中的至少1种,且该硅烷包含式(1‑a)或式(1‑b)表示的硅烷化合物。还提供半导体装置的制造方法,其包含通过将下层形成组合物涂布在半导体基板上并进行烧成而形成下层的工序、在上述下层上涂布用组合物而形成的工序、对上述进行曝光的工序、曝光后对抗进行显影而得到图案化的的工序、按照图案化的对抗下层进行蚀刻的工序、以及按照图案化下层加工半导体基板的工序。
  • 具有结构含硅抗蚀剂下层形成组合
  • [发明专利]掩模坯件的制造方法-CN200580032601.X有效
  • 大久保靖 - HOYA株式会社
  • 2005-11-04 - 2007-08-29 - G03F1/14
  • 于掩模坯件用基片上形成将成为掩模图案的薄膜的薄膜形成工序和于上述薄膜上形成形成工序的掩模坯件制造方法,此方法包括:保存包含有将上述形成于上述薄膜上的日期信息的形成信息的工序;将上述形成信息与上述掩模坯件相对应的工序;基于上述形成信息,确定形成于上述掩模坯件上的的灵敏度变化超过允许范围的掩模坯件的工序;将上述确定的掩模坯件上所形成的剥离的工序;在剥离了上述的上述薄膜上再次形成的工序。
  • 掩模坯件制造方法
  • [发明专利]接触孔的形成方法和半导体器件的制造方法-CN200410083750.6无效
  • 小林祐二 - 株式会社东芝
  • 2004-10-14 - 2005-04-20 - H01L21/30
  • 用以规定的间隔2维状地配置有掩模图形的第1光掩模使在半导体基板上边形成的曝光,对上述进行显影处理,在上述上形成与上述掩模图形对应的接触孔图形,缩小在上述上形成的上述接触孔图形的开口尺寸,采用使用已形成了规定的图形的第2光掩模使上述曝光的办法,使作为与上述规定的图形对应的上述的部分的第1的熔化开始温度设定得比上述第1以外的第2的熔化开始温度相对地高,采用在上述第2的熔化开始温度或其以上而且在不到上述第1的熔化开始温度的温度对上述半导体基板进行加热处理的办法,使上述第2熔化,消灭在上述第2上形成的上述接触孔图形。
  • 接触形成方法半导体器件制造
  • [发明专利]用于制造半导体器件的方法-CN202110019174.2在审
  • 渡边整;平崎贵英 - 住友电气工业株式会社
  • 2021-01-07 - 2021-07-16 - H01L21/027
  • 该用于制造半导体器件的方法包括以下步骤:在半导体衬底上形成第一光致,并且在第一光致上形成与第一光致比具有更高的酸度的第二光致;通过使第一光致和第二光致图案化来形成用于暴露半导体衬底的表面的开口;对第二光致的上表面和开口的内部涂布收缩材料,并且通过对第一光致、第二光致和收缩材料进行热处理来在开口的内部使收缩材料和第二光致起反应;以及去除第二光致的上表面和开口的内部的未与第二光致起反应的未反应的收缩材料
  • 用于制造半导体器件方法
  • [发明专利]制造半导体器件的方法及图案形成方法-CN201010219713.9无效
  • 宫本宏之 - 索尼公司
  • 2010-06-29 - 2011-01-12 - H01L21/00
  • 制造半导体器件的方法包括:第一形成工艺,使用正型光致材料在处理的目标表面上形成第一;第一图案形成工艺,在曝光之后进行显影而形成第一图案,在曝光中曝光光照射到第一上;第二形成工艺,使用光致材料在形成有第一图案的处理的目标表面上形成第二;以及第二图案形成工艺,通过进行曝光并然后进行显影来形成第二图案,在曝光中曝光的光照射到第二上该方法还包括不溶解化处理工艺,用于使第一图案不溶解于第二图案形成工艺中使用的显影和光致材料的溶剂。
  • 制造半导体器件方法图案形成
  • [发明专利]正型干及蚀刻方法-CN201980082011.X在审
  • 入泽宗利;中村优子;梶谷邦人 - 三菱制纸株式会社
  • 2019-12-13 - 2021-07-23 - G03F7/004
  • 本发明的课题在于提供一种在将正型干贴附于基材后,能够容易地将(a)支撑体和(b)剥离层从(c)正型感光性层与(b)剥离层的界面剥离,另外,在将正型干切割或分切时不易发生破裂的正型干及使用了该正型干的蚀刻方法,通过正型干及使用了该正型干的蚀刻方法,解决了上述课题,所述正型干的特征在于,至少依次层叠有(a)支撑体、(b)剥离层和(c)正型感光性层,(b)剥离层包含聚乙烯醇,并且(c)正型感光性层包含酚醛树脂和醌二叠氮磺酸酯作为主成分。
  • 正型干膜抗蚀剂蚀刻方法

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