专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体结构及其制造方法-CN201310263520.7有效
  • 林镇元;詹景琳;林正基;连士进 - 旺宏电子股份有限公司
  • 2013-06-27 - 2017-04-12 - H01L27/06
  • 本发明公开了一种具有一高电压区及一低电压区的半导体结构包括一基板,其为一第一导电类型,容纳所述高电压区及所述低电压区。一电阻,位于所述基板上,连接所述高电压区及所述低电压区,且所述电阻实质上驻留于所述高电压区中。所述结构进一步包括一第一掺杂区域,其为所述第一导电类型,位于所述基板中,处于所述高电压区与所述低电压区之间;及一第二掺杂区域,其为一第二导电类型,处于所述基板与所述第一掺杂区域之间。此外,一绝缘层形成于所述电阻与所述第一掺杂区域之间。
  • 半导体结构及其制造方法
  • [发明专利]半导体装置及其制造方法与操作方法-CN201310018592.5有效
  • 詹景琳;林镇元;林正基;连士进 - 旺宏电子股份有限公司
  • 2013-01-18 - 2014-07-23 - H01L29/06
  • 本发明公开了一种半导体装置及其制造方法与操作方法。半导体装置包括衬底、深阱、第一阱、第一掺杂电极区、第二掺杂电极区以及高截止电压通道区。衬底具有第一导电型。深阱位于衬底内,并具有与第一导电型相反的第二导电型。第一阱位于深阱内,并具有第一导电型或第二导电型至少其中之一。第一掺杂电极区具有第一导电型并位于第一阱内。第二掺杂电极区具有第二导电型,位于第一阱内且邻近第一掺杂电极区。高截止电压通道区由衬底的表面向下扩展且覆盖部份的第二掺杂电极区的表面,其覆盖第二掺杂电极区的比例越高,半导体装置的输出电流越大。
  • 半导体装置及其制造方法操作方法
  • [发明专利]高压 ED NMOS 元件嵌入高压横向 NJFET-CN201310126266.6有效
  • 陈永初;陈立凡;林镇元 - 旺宏电子股份有限公司
  • 2013-04-12 - 2014-07-16 - H01L27/085
  • 本发明公开了一种高压ED NMOS元件嵌入高压横向NJFET及其制造方法,该高压ED NMOS元件嵌入高压横向NJFET包含一高压(HV)n型金属氧化物半导体(NMOS)嵌入HV结栅极场效应晶体管(JFET)的半导体装置被提供。根据第一示例实施例,具有嵌入HV JFET的HV NMOS可包含衬底、被设置为邻近该衬底的N型阱区、被设置为邻近该N型阱区的P型阱区、以及被设置为邻近该N型阱区且在该P型阱区相对侧的第一及第二N+掺杂区。该P型阱区可包含P+掺杂区、第三N+掺杂区以与栅极结构,该第三N+掺杂区介于该P+掺杂区以及该栅极结构之间。
  • 高压ednmos元件嵌入横向njfet
  • [发明专利]半导体结构及其制造方法-CN201110115558.0有效
  • 林镇元;林正基;连士进;吴锡垣 - 旺宏电子股份有限公司
  • 2011-05-03 - 2012-11-07 - H01L29/423
  • 本发明公开了一种半导体结构及其制造方法。该半导体结构包括一第一掺杂阱、一第一掺杂电极、一第二掺杂电极、多个掺杂条纹与一掺杂顶区。掺杂条纹位于第一掺杂电极与第二掺杂电极之间的第一掺杂阱上。掺杂条纹互相分开。掺杂顶区位于掺杂条纹上,并延伸于掺杂条纹之间的第一掺杂阱上。第一掺杂阱与掺杂顶区具有一第一导电类型。掺杂条纹具有相反于第一导电类型的一第二导电类型。本发明各实施例的结构和方法能降低装置的开启阻抗,提升开启电流与效能。
  • 半导体结构及其制造方法

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