专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体结构-CN202210933727.X在审
  • 李维中;丘世仰 - 南亚科技股份有限公司
  • 2022-08-04 - 2023-10-24 - H10B20/25
  • 本发明提供一种半导体结构,包括半导体基板、主动区、晶体管栅极、熔丝栅极、第一介电图案、第二介电图案以及多条金属线。主动区设置于半导体基板中。晶体管栅极具有沿着第一方向延伸穿过主动区的第一线段和第二线段。位于第一线段与第二线段之间的熔丝栅极沿第一方向延伸穿过主动区。第一介电图案设置于主动区和晶体管栅极之间。第二介电图案设置于主动区和熔丝栅极之间。位于晶体管栅极相对两侧的多条金属线电性连接至主动区。
  • 半导体结构
  • [发明专利]玻璃基板上的一次编程非挥发性存储单元-CN202110067401.9有效
  • 孙文堂;萧婉匀 - 力旺电子股份有限公司
  • 2021-01-19 - 2023-10-17 - H10B20/25
  • 本发明公开一种玻璃基板上的一次编程非挥发性存储单元,其中该一次编程非挥发性存储单元具有一存储元件,该存储元件包括:一玻璃基板、一缓冲层、一多晶硅层与二金属层。缓冲层位于该玻璃基板上。多晶硅层位于该缓冲层上。该多晶硅层包括一P型掺杂区与一N型掺杂区。该二金属层分别接触于该N型掺杂区与该P型掺杂区。该二金属层、该第一N型掺杂区与该第一P型掺杂区形成一二极管。在一编程动作时,该二极管接收一编程电压,使得该二极管为逆向偏压,且该二极管由一第一存储状态变成一第二存储状态。在一读取动作时,该二极管接收一读取电压,使得该二极管为逆向偏压,且该二极管产生一读取电流。
  • 玻璃基板上一次编程挥发性存储单元
  • [发明专利]OTP存储器件及电子设备-CN202210301575.1在审
  • 徐由;潘越;刘畅;布明恩;张宗宪;刘燕翔 - 华为技术有限公司
  • 2022-03-25 - 2023-10-10 - H10B20/25
  • 本申请提供了一种OTP存储器件及电子设备。OTP存储器件包括衬底和存储结构,衬底具有第一表面,第一表面包括有源区;存储结构包括第一金属氧化物半导体MOS晶体管,第一MOS晶体管包括:源极,源极设于有源区;漏极,漏极设于有源区;栅氧化层,栅氧化层设于有第一表面,栅氧化层上具有凹陷部,凹陷部包括沿第一方向设置的第一凹陷部以及沿第二方向设置的第二凹陷部,第一方向与第二方向之间具有夹角;栅极,栅极设于栅氧化层上,源极或漏极位于栅极的一侧。本申请能够提高OTP存储器件编程的成功率。
  • otp存储器件电子设备
  • [发明专利]一种半导体结构及其制作方法-CN202210304778.6在审
  • 吴铁将;朱玲欣 - 长鑫存储技术有限公司
  • 2022-03-22 - 2023-10-03 - H10B20/25
  • 本公开实施例涉及半导体领域,提供一种半导体结构及其制作方法,其中,半导体结构包括:基底,以及位于基底表面的栅氧层;栅极堆叠层,栅极堆叠层位于栅氧层的表面;隔离层,隔离层至少覆盖栅极堆叠层的第一侧壁;接触结构,接触结构至少位于基底的表面;介质层,介质层至少位于接触结构与栅极堆叠层的第二侧壁之间,第一侧壁与第二侧壁相对设置,介质层的厚度小于隔离层的厚度。至少可以降低熔丝结构的击穿难度。
  • 一种半导体结构及其制作方法
  • [发明专利]半导体结构及其制备方法-CN202110086754.3有效
  • 曹先雷 - 长鑫存储技术有限公司
  • 2021-01-22 - 2023-09-26 - H10B20/25
  • 本发明属于半导体技术领域,具体涉及一种半导体结构及其制备方法,用于解决反熔丝器件结构的编程电压较高的技术问题。该半导体结构的制备方法包括:提供衬底,衬底包括核心器件区和反熔丝器件区;形成第一介质层,其覆盖核心器件区和反熔丝器件区;形成第二介质层,其覆盖第一介质层,第二介质层的介电常数大于第一介质层的介电常数;去除反熔丝器件区上的第二介质层;形成导电层,其覆盖反熔丝器件区上的第一介质层和核心器件区上的第二介质层。通过去除反熔丝器件区上的第二介质层,使得反熔丝器件区上位于导电层和衬底之间的膜层厚度较薄且介电常数较小,从而降低后续形成的反熔丝器件结构的编程电压。
  • 半导体结构及其制备方法
  • [发明专利]一次性可编程器件的制造方法及一次性可编程器件-CN202010164411.X有效
  • 田志;李娟娟;邵华;陈昊瑜 - 上海华力微电子有限公司
  • 2020-03-10 - 2023-09-15 - H10B20/25
  • 本发明提供了一次性可编程器件的制造方法及一次性可编程器件,包括:有源区、位于有源区一侧的浅沟槽隔离结构、位于有源区上的第一氧化硅层、位于浅沟槽隔离结构和第一氧化硅层上的栅极结构、位于栅极结构两侧的侧墙、依次位于栅极结构上的难熔硅化物层和第二氮化硅层,以及连接难熔硅化物层的接触孔,浅沟槽隔离结构表面高于所述第一氧化硅表面。阴极端放置在浅沟槽隔离结构区域,阳极端放置在有源区,由于浅沟槽隔离结构区域和有源区形成了台阶,难熔硅化物层也形成台阶,在台阶处难熔硅化物的晶粒尺寸与平面处存在差异,有利于阴极端金属离子的迁移,迁移后的金属离子不易重新返回阴极端,提高了可靠性。
  • 一次性可编程器件制造方法
  • [实用新型]记忆体装置-CN202321015078.1有效
  • 刘相玮 - 台湾积体电路制造股份有限公司
  • 2023-04-28 - 2023-09-01 - H10B20/25
  • 一种记忆体装置包括第一记忆体单元,此第一记忆体单元包括串行地彼此电性耦接的第一晶体管及第一反熔丝结构。第一晶体管包括跨主动区域延伸的第一栅极结构、在主动区域的第一部分中设置的第一源极/漏极结构、及在主动区域的第二部分中设置的第二源极/漏极结构。第一反熔丝结构包括电性耦接到第一源极/漏极结构的第一电极、在第一虚拟栅极结构上方设置的第二电极、及横向插入第一电极与第二电极之间的第一绝缘体。
  • 记忆体装置
  • [发明专利]反熔丝存储结构、反熔丝阵列存储结构以及存储器-CN202310621394.1在审
  • 侯闯明 - 长鑫存储技术有限公司
  • 2023-05-26 - 2023-07-28 - H10B20/25
  • 本公开实施例提供一种反熔丝存储结构、反熔丝阵列存储结构以及存储器。反熔丝存储结构包括:有源区,有源区包括沿第一方向上依次排布的第一部分、第二部分、第三部分、第四部分和第五部分;多个第一反熔丝结构,每个第一反熔丝结构包括与第一部分交叠的第一反熔丝栅极;多个第二反熔丝结构,每个第二反熔丝结构包括与第五部分交叠的第二反熔丝栅极;第一选择晶体管以及第二选择晶体管,第一选择晶体管包括与第二部分交叠的第一选择栅极,第二选择晶体管包括与第四部分交叠的第二选择栅极,第一选择栅极和第二选择栅极沿第一方向间隔排布;与第三部分电连接的位线结构。本公开实施例至少有利于提升反熔丝存储结构的性能。
  • 反熔丝存储结构阵列以及存储器
  • [发明专利]半导体结构及其制造方法-CN202210022035.X在审
  • 丁丽 - 长鑫存储技术有限公司
  • 2022-01-10 - 2023-07-21 - H10B20/25
  • 本公开实施例涉及一种半导体结构及其制造方法,半导体结构包括:衬底,包括第一掺杂区;第一隔离结构,第一隔离结构位于第一掺杂区内,且第一隔离结构的深度大于第一掺杂区的深度;第一栅极结构,第一栅极结构位于第一掺杂区的衬底表面,第一栅极结构横跨第一隔离结构,且第一栅极结构在衬底上的投影宽度大于第一隔离结构在衬底上的投影宽度;第二栅极结构,第二栅极结构位于衬底表面,第二栅极结构位于第一栅极结构的两侧。本公开实施例有利于缩小半导体器件的尺寸。
  • 半导体结构及其制造方法
  • [发明专利]反熔丝阵列结构和存储器-CN202111602098.4在审
  • 杨桂芬;池性洙 - 长鑫存储技术有限公司
  • 2021-12-24 - 2023-06-30 - H10B20/25
  • 本公开涉及半导体电路设计领域,特别涉及一种反熔丝阵列结构和存储器,其中,反熔丝阵列结构包括:多个反熔丝集成结构,分别沿位线延伸方向和字线延伸方向设置,其中,位线延伸方向和字线延伸方向相交;其中,在位线延伸方向上,部分反熔丝集成结构与相邻反熔丝集成结构共用同一有源区;第一晶体管,基于相邻反熔丝集成结构共用的有源区设置,通过第一晶体管增大反熔丝存储单元之间电气元件的电隔离效果,相比于隔离区第一晶体管所需占用的面积更小;另外,通过设置第一晶体管,使相邻反熔丝集成结构可以设置在同一有源区上,进一步减小反熔丝阵列结构的版图布局面积。
  • 反熔丝阵列结构存储器

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