[实用新型]芯片封装结构有效
申请号: | 201320002562.0 | 申请日: | 2013-05-24 |
公开(公告)号: | CN203205401U | 公开(公告)日: | 2013-09-18 |
发明(设计)人: | 陈石矶 | 申请(专利权)人: | 标准科技股份有限公司 |
主分类号: | H01L23/31 | 分类号: | H01L23/31;H01L23/498;H01L23/367 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 曹玲柱 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 芯片 封装 结构 | ||
技术领域
本实用新型揭露了一种芯片封装结构,利用晶片级封装工艺及简单的打线工艺来形成芯片封装结构,特别是一种将闪存芯片以打线工艺来形成芯片封装结构。
背景技术
半导体技术的发展非常地快速,特别是半导体芯片(semiconductor dice)有趋于小型化的倾向。然而,半导体芯片的功能需求却有相对多样化的倾向。换句话说,半导体芯片在一较小区域中需要更多的输入/输出垫(pads),所以引脚(pins)的密度也随之快速的提高。其导致半导体芯片的封装变得更困难且降低优良率。封装结构的主要目的在于保护芯片免受外部损伤。然而,大部分封装技术是先将一晶片上芯片切割成多个单一芯片,然后再封装与测试每一颗单一芯片。另外,一种称为「晶片级封装」(wafer levelpackage;WLP)的封装技术,可以在分割芯片成为单一芯片之前,在一晶片上封装芯片。晶片级封装技术有一些优点,例如生产周期较短、成本较低以及不需要填充物(under-fill)。
实用新型内容
本实用新型的主要目的在于揭露一种芯片封装结构,在电路基板上形成多个封装基板区块,且将电路基板及其上的多个封装基板区块经由对准设置后固着在具有多个芯片的晶片上,使得在晶片上的每一个芯片的一侧边上的焊垫与封装基板区块上的连接点以打线电性连接,并经由另一封装体封装之后曝露出封装基板区块上的外部连接端点,经切割之后得到多个具有基板的芯片封装结构。
本实用新型的再一目的是在于本实用新型的芯片封装结构,特别适用在大型芯片的封装工艺,例如存储器,特别是NAND闪存芯片(NANDFlash)、NOR闪存芯片(NOR Flash)、通信芯片及一些特殊应用芯片(Application-specific Ic;ASIC)。
本实用新型的又一目的在于所揭露的封装结构,其一面是曝露出多个外部连接端点,作为对外连接的端点,而相对于外部连接端点的另一面则是芯片的背面,因此本实用新型的封装结构可以达到良好的散热效果,而此一散热效果对于大型芯片是非常重要的。
根据以上所述的目的,本实用新型是提供一种芯片封装结构,包括:芯片,具有主动面及背面,在芯片的主动面的侧边上具有多个焊垫;封装基板区块,具有正面及背面,且在封装基板区块的一侧边配置有贯穿封装基板区块的正面及背面的多个连接点,且在多个连接点与封装基板区块的侧边之间配置有一开口,及在封装基板区块的多个连接点的相邻侧边上配置有多个外部连接端点;将封装基板区块的背面通过黏着层与芯片固接,使得芯片的侧边上的多个焊垫于封装基板区块的开口曝露出来;多条金属导线,将封装基板区块的侧边上的多个连接端点电性连接于芯片的侧边的多个焊垫;封装体,包覆封装基板区块、芯片及多条金属导线,且曝露出在封装基板区块上的多个连接点的相邻侧边的多个外部连接端点;以及多个导电元件,配置在多个外部连接端点上。
优选地,本实用新型芯片封装结构中,该封装基板区块为一印刷电路板。
优选地,本实用新型芯片封装结构中,该封装基板区块为一可挠性电路板。
优选地,本实用新型芯片封装结构中,该封装基板区块的一尺寸小于该芯片的一尺寸。
优选地,本实用新型芯片封装结构中,该些导电元件的高度至少与该封装基板区块与该封装体的一总高度相同。
本实用新型还揭露另外一种芯片封装结构,包括:芯片,具有主动面及背面,在芯片的主动面的侧边上具有多个焊垫;封装基板区块,具有正面及背面,且在封装基板区块的侧边配置有贯穿封装基板区块的正面及背面的多个连接点,且在多个连接点与封装基板区块的侧边之间配置有一开口,及在封装基板区块的多个连接点的相邻侧边上配置有多个外部连接端点;将封装基板区块的背面通过黏着层与芯片固接,使得芯片的侧边上的多个焊垫于封装基板区块的开口中曝露出来,且封装基板区块上的多个外部连接端点向外延伸大于芯片的侧边;多条金属导线,将封装基板区块的侧边上的多个连接端点电性连接于芯片的侧边的多个焊垫;以及封装体,包覆封装基板区块、芯片的主动面及多条金属导线,且将多个外部连接端点曝露在封装体的外侧。
优选地,本实用新型芯片封装结构中,该封装基板区块为印刷电路板。
优选地,本实用新型芯片封装结构中,该封装基板区块为可挠性电路板。
优选地,本实用新型芯片封装结构中,该封装基板区块的一尺寸小于该芯片的一尺寸。
优选地,本实用新型芯片封装结构中,该些外部连接端点为具有内引脚及外引脚的一导线架。
本实用新型的上述及其他目的与优点,不难从下述所选用实施例的详细说明与附图中,获得深入了解。
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