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[发明专利]基于DevOps的流水线编排方法、装置及系统-CN202310385820.6有效
发明人：陈士花;杜广源;李洪宇;戚玮;赵海鹰;付和平;孟祥凯;李哲;张伟;马文娴 -专利权人：昆仑数智科技有限责任公司;中国石油天然气集团有限公司
申请日： 2023-04-12 - 公布日： 2023-06-20 - 主分类号： G06F8/34 文献下载
摘要：本文涉及ERP‑研发运营领域，尤其涉及一种基于DevOps的流水线编排方法、装置及系统。包括，按照流水线组件编排需求确定一个或多个对象，创建自定义列表文件；构建用于解析所述自定义列表文件，得到自定义列表文件中的对象，并对解析到的对象进行编排的流水线核心脚本；根据流水线组件编排需求构建调用流水线核心脚本库中的流水线核心脚本的流水线编排过程任务；执行流水线编排过程任务，以便于流水线编排过程任务调用流水线编排过程任务中的流水线核心脚本，对自定义列表文件进行解析得到自定义列表文件中的对象，并对解析到的对象进行编排和处理。
基于 devops 流水线编排方法装置系统

[发明专利]基于流水线结构的安全处理器-CN201711082754.6在审
发明人：汪家祥;吴亚坤;于柏森;李晗璐 -专利权人：中天安泰（北京）信息技术有限公司
申请日： 2017-11-06 - 公布日： 2019-05-14 - 主分类号： G06F21/71 文献下载
摘要：本发明提出了一种安全处理器，该安全处理器的内部设置有流水线结构的处理器核心，在核心流水线上设置有与所述核心流水线并行工作的旁路审核逻辑电路；所述旁路审核逻辑电路用于对所述核心流水线上处理的指令进行审核，并利用审核结果判定该指令在所述核心流水线上是否允许提交。本发明的实施例提出了新型处理器架构，实现了直接干预核心流水线的安全处理器，安全处理器的运行提高了计算设备的安全性；并且旁路设置审核单元以保证处理器运行的高效性。
安全处理器核心流水线旁路审核流水线结构指令处理器核心新型处理器计算设备内部设置审核结果高效性处理器并行判定架构干预保证

[发明专利]串行审核结构的安全处理器-CN201711082753.1在审
发明人：汪家祥;吴亚坤;于柏森;王明 -专利权人：中天安泰（北京）信息技术有限公司
申请日： 2017-11-06 - 公布日： 2019-05-14 - 主分类号： G06F9/38 文献下载
摘要：本发明提出了一种安全处理器，该安全处理器的内部设置有流水线结构的处理器核心，在核心流水线上的各级之间设置有串行审核逻辑电路；所述串行审核逻辑电路用于对所述核心流水线上处理的指令进行审核，判定该指令是否进入下一流水级本发明的实施例提出了新型处理器架构，实现了直接干预核心流水线的安全处理器，安全处理器的运行提高了计算设备的安全性。
安全处理器核心流水线审核指令处理器核心流水线结构新型处理器计算设备内部设置流水级判定架构干预

[发明专利]运行时间可配置的虚拟视频流水线-CN200480009384.8有效
发明人： S·杜塔;J·伦纳特 -专利权人：皇家飞利浦电子股份有限公司
申请日： 2004-04-02 - 公布日： 2006-09-13 - 主分类号： G06F15/78 文献下载
摘要：一个多流水线系统(300)包括一个辅助功能块(A－E 335)的池(330)，所述辅助功能块被按照需要提供给所选流水线。该多流水线系统(300)中的每条流水线(320)被配置成包括一组同构核心功能(F1－F6)。提供了一个辅助功能(A－E 335)的池(330)，以便将辅助功能(A－E 335)选择性地插入所选流水线的核心功能(F1－F6)之间。每个辅助功能包括一个多路复用器，该多路复用器允许将该辅助功能选择性地耦合在每条流水线内。
运行时间配置虚拟视频流水线

[发明专利]提供增强的图形流水线的系统和方法-CN200510064920.0有效
发明人： A·帕特尔;C·N·博伊德;D·R·布莱斯;J·M·J·诺尔;M·A·特勒;S·H·怀特 -专利权人：微软公司
申请日： 2005-04-04 - 公布日： 2005-11-30 - 主分类号： G06T1/20 文献下载
摘要：提供了一种增强的图形流水线，使得公共核心硬件能够表现为图形流水线的不同组件，流水线中的组件对包括线和三角形的图元的可编程性，以及在流水线中用数据绘制图形显示之前或同时的流输出。编程者不必优化代码，因为公共核心将平衡必要的功能的负荷，并动态地将那些指令分配到公共核心硬件上。编程者可使用算法来对图元编程，以通过用线和三角形构成的拓扑来替代来简化所有的顶点运算。通过使用增强的图形流水线，编程者可优化流水线中的硬件的使用，对顶点、线或三角形拓扑全体进行编程，而不是仅对每个顶点单独进行编程，并且可从流水线能够输出计算出的信息的存储器中读取任何计算出的数据。
提供增强图形流水线系统方法

[发明专利]工业场景下敏态交付的实现方法及系统-CN202110970372.7在审
发明人：李长春;毛玲燕;王建纲;王学平;孙磊;吴师 -专利权人：上海宝信软件股份有限公司
申请日： 2021-08-23 - 公布日： 2023-02-24 - 主分类号： G06F9/455 文献下载
摘要：本发明提供一种工业场景下敏态交付的实现方法及系统，涉及软件开发技术领域，包括：根据各类构建场景，制作Jenkins slave容器；基于流水线模板，提供创建流水线的方式，将Jenkins Pipeline核心步骤封装为模板，管理员维护相关步骤模板信息，提供对应的参数；通过可视化页面，将流水线模板和构建环境的选择开放给普通用户，通过流水线模板初始化流水线，普通用户根据自身需要进行流水线相关步骤的编排，输入相关参数，选择对应的构建环境，创建符合自身应用需求的流水线。本发明通过集成Jenkins流水线以及Kubernetes容器集群，基于编译环境的维护和流水线模板，搭建可以快速创建应对各类场景的流水线以及覆盖各类编译环境的敏态交付系统DevOps平台。
工业场景下敏态交付实现方法系统

[发明专利]微处理器-CN201711082971.5在审
发明人：汪家祥;吴亚坤;刘振娟;展少华 -专利权人：中天安泰（北京）信息技术有限公司
申请日： 2017-11-06 - 公布日： 2019-05-14 - 主分类号： G06F21/71 文献下载
摘要：本发明提出了一种微处理器，处理器核心为流水线结构，在流水线上设置审核逻辑部件；所述审核逻辑部件由筛选单元、审核单元组成；其中，所述筛选单元被配置在流水线上，用于分离流水线上的指令流；所述审核单元被配置与所述筛选单元和流水线交互，用于审核被分离出的指令流，并将审核后的指令流送回流水线。本发明的实施例提出了具有安全机制的处理器架构，可实现安全的处理器流水线，从核芯解决计算设备安全性的问题。
流水线审核筛选单元指令流微处理器逻辑部件处理器流水线处理器核心处理器架构流水线结构安全机制计算设备从核配置安全

[发明专利]一种面向电力行业研发测试流水线构建方法-CN201910292665.7在审
发明人：曾纪钧;刘晔;龙震岳 -专利权人：广东电网有限责任公司信息中心
申请日： 2019-04-12 - 公布日： 2019-07-16 - 主分类号： G06F11/36 文献下载
摘要：本发明公开了一种面向电力行业研发测试流水线构建方法，将研发测试工作的一般流程，通过构建的流水线方法，自动化实现，从而把更多的精力放到核心的代码功能设计研发阶段；从代码检查编译到测试环境发布均为自动执行，生产环境发布为手动执行，通过流水线的构建，能够迅速定位问题所在，提交回归研发，并再次进行研发测试流水线的构建；完成一次完整的流水线构建后，即可将代码发布到生产环境中。本发明将流水线中的每一步通过构建工具执行命令，代替人工自动化的执行每一个阶段；提高了开发测试过程的效率，实现了信息化系统的敏捷交付、持续集成，从而把更多的精力放到核心的代码功能设计研发阶段。
构建研发流水线测试流水线代码功能电力行业生产环境自动化信息化系统测试过程测试环境代码发布代码检查定位问题手动执行自动执行编译发布交付测试回归开发

[发明专利]流水线微处理器的循环高速缓冲存储器及高速缓存控制器-CN01121139.3有效
发明人： R·H·斯凯尔斯 -专利权人：德克萨斯仪器股份有限公司
申请日： 2001-05-31 - 公布日： 2002-01-02 - 主分类号： G06F9/38 文献下载
摘要：该微处理器包括从一个指令流水线接收指令的多重执行单元,一个循环高速缓存存储器(210)与指令流水线通信,一个循环高速缓存控制器(214)控制指令流。最好由软件指令通知存控制器开始建立一个规定规模的软件流水线循环到缓存器。然后将指令从指令流水线累积到缓存器;当软件流水线循环的核心被建立到缓存器时,控制器最好停顿该指令流水线并使用缓存的指令执行循环。在循环完成后,恢复指令流水线。可减少所需的程序规模并减少功率消耗。
流水线微处理器循环高速缓冲存储器高速缓存控制器

[发明专利]基于性能监测信息进行数据驱动低功率状态控制的系统、装置和方法-CN201980006858.X在审
发明人：迈克尔·W·切诺维思;拉杰什里·查布克斯瓦尔;埃利泽·韦斯曼;杰森·W·布兰特;亚历山大·亨德勒;艾哈迈德·亚辛;帕特里克·康索;斯内哈·戈哈德;威廉·弗里拉夫 -专利权人：英特尔公司
申请日： 2019-02-28 - 公布日： 2020-08-07 - 主分类号： G06F1/3293 文献下载
摘要：在一个实施例中，一种处理器包括：一个或多个核心，一个或多个核心包括缓存存储器层级；性能检测器，该性能监测器耦合到一个或多个核心，该性能监测器用于监测一个或多个核心的性能，该性能监测器用于至少部分地基于与缓存存储器层级相关联的计数信息来计算流水线成本元数据；以及功率控制器，该功率控制器耦合到性能监测器，该功率控制器用于接收流水线成本元数据并且至少部分地基于该流水线成本元数据来确定一个或多个核心要进入的低功率状态。
基于性能监测信息进行数据驱动功率状态控制系统装置方法

[发明专利]高速缓冲存储器控制装置及流水线控制方法-CN200780053367.8有效
发明人：清水野光宪;石村直也 -专利权人：富士通株式会社
申请日： 2007-06-20 - 公布日： 2010-03-24 - 主分类号： G06F12/08 文献下载
摘要：一种高速缓冲存储器控制装置以及流水线控制方法。作为缓解用于例如多核系统中的高速缓冲存储器访问的流水线的拥塞的目的，高速缓冲存储器控制装置具有：判定部，其判定例如从各个核心提供的命令是其执行时对高速缓冲存储器进行访问的命令，还是不进行访问的命令；以及路径切换部，其用于将判定为进行访问的命令投入到流水线处理，将判定为不进行访问的命令直接输出到外部，而不将其投入到流水线处理。
高速缓冲存储器控制装置流水线方法

[发明专利]一种包装流水线高速运转装置-CN201410623440.2在审
发明人：李永胜 -专利权人：徐州绿庄园食品有限公司
申请日： 2014-11-07 - 公布日： 2015-03-11 - 主分类号： G05B19/418 文献下载
摘要：本发明涉及一种包装流水线高速运转装置，其包括：可视化上位机界面、RS-232/RS-485转换器模块、PLC控制模块、Profibus-DP协议、包装流水线系统，所述的上述各模块相连构成了包装流水线高速运转装置协议并通过RS-232/RS-485转换器模块与PLC控制模块相连，所述的PLC控制模块可以通过Profibus的DP通信接口接入Profibus现场总线网络并扩大PLC的使用范围，所述的PLC控制模块与包装流水线系统相连并控制其运转本发明一种包装流水线高速运转装置，以上位机、单片机控制为核心，在编程过程中采用不可中断方式和多缓冲区结构,实现了可靠且高速的通信方式，从而保证包装流水线的高速、稳定的运行。
一种包装流水线高速运转装置

[发明专利]可重构平台上固化全网络层的卷积神经网络硬件加速器-CN202010965915.1在审
发明人：宫磊;王超;朱宗卫;李曦;陈香兰;周学海 -专利权人：中国科学技术大学
申请日： 2020-09-15 - 公布日： 2020-12-22 - 主分类号： G06N3/063 文献下载
摘要：本发明公开了一种可重构平台上固化全网络层的卷积神经网络硬件加速器，包括：控制模块，用于协调和控制加速过程，包括对片上的其它模块的初始化和同步，以及启动各计算核心与片外内存间不同类型数据的交互；数据传输模块，包括内存控制器和多个DMA，用于各片上各数据缓存与片外内存间的数据交互；计算模块，包括多个用于计算的计算核心，各计算核心与卷积神经网络的不同网络层一一对应；各计算核心均各自作为流水线的一级，所有计算核心共同构成完整的粗粒度流水线结构；各计算核心内部包含一个细粒度的计算流水线。
可重构平台固化网络卷积神经网络硬件加速器

[发明专利]数据处理方法和装置-CN201680079091.X有效
发明人：埃温·利兰 -专利权人：斯瓦姆64有限责任公司
申请日： 2016-11-30 - 公布日： 2022-11-29 - 主分类号： G06F9/30 文献下载
摘要：数据处理装置包括：处理器核心，能够操作用于执行多个程序线程的指令序列，所述处理器核心具有多个流水线级，所述流水线级之一是具有调度逻辑的指令调度级，所述调度逻辑能够操作用于：响应于程序线程内的线程暂停指令，阻止调度来自所述程序线程的在所述线程暂停指令之后的指令，而是调度来自另一个程序线程的指令以在所述多个流水线级内执行。这显著简化了处理器核心的操作。
数据处理方法装置

[发明专利]一种实现卷积神经网络前向计算的硬件结构-CN201710119915.8在审
发明人：曹伟;黄峰;孙亚洲;杨贤;王伶俐;周学功;李慧敏;范锡添;焦黎 -专利权人：智擎信息系统(上海)有限公司
申请日： 2017-03-01 - 公布日： 2017-08-18 - 主分类号： G06F9/38 文献下载
摘要：本申请公开了一种实现卷积神经网络前向计算的硬件结构，包括数据片外缓存模块，用于将外部输入的各张待处理图片中的参数数据缓存在该模块中，等待被多级流水线加速模块读取出来；多级流水线加速模块，与所述数据片外缓存模块连接，用于从数据片外缓存模块中读取参数，实现卷积神经网络的核心计算；参数读取仲裁模块，与所述多级流水线加速模块连接，用于处理多级流水线加速模块中多个读取参数请求，使多级流水线加速模块获取需要的参数；参数片外缓存模块本申请采用并行流水方式的硬件架构来实现算法，具有较高的资源利用率和较高的性能。
一种实现卷积神经网络计算硬件结构

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