专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]微处理器-CN201010033646.1有效
  • 何虎;刘源;章道陵 - 清华大学
  • 2010-01-04 - 2010-06-23 - G06F9/30
  • 本发明公开了一种微处理器,该微处理器包括:指令获取模块,其用于获取将要执行的指令;指令分发模块,其用于将从指令获取模块得到的指令进行分发;指令执行模块,其用于对从指令分发模块得到的指令进行解码并执行指令;寄存堆,其用于存储指令执行结果;管理系统,管理指令执行过程中的程序和数据,指令执行模块包括完成算术逻辑运算和移位计算的A单元、完成乘法运算的M单元、实现管理系统存取和程序跳转的D单元以及完成浮点运算的该微处理器采用超长指令结构,并利用增加的F单元来进行浮点运算,使其同时具备了单周期多指令和单指令多数据的特点,提高了微处理器的操作性能。
  • 微处理器
  • [发明专利]微处理器-CN201110374840.0有效
  • 马岛吉英;阿部真喜男 - 三美电机株式会社
  • 2011-11-16 - 2012-07-18 - G06F15/78
  • 本发明的目的在于:能够变更存储在不可改写的存储中的中断处理程序。本发明的微处理器在第一存储(13)中设置:对每个向量存储了通过多种中断进行处理的多个程序的地址的第一中断向量表;在上述第一中断向量表的各向量所示的地址中存储处理程序的区域,在第二存储(14)中设置内容与第一中断向量表相同的第二中断向量表,该微处理器具备:地址变换单元(22),将对第一中断向量表进行存取的地址变换为对第二中断向量表进行存取的地址;写入单元(43),根据从外部设备(30)供给的指令,将第二中断向量表的任意向量的地址和存储在任意向量所示的地址中的处理程序写入到第二存储
  • 微处理器
  • [发明专利]微处理器-CN200510083257.9有效
  • 春木洋美;桥本干生;川端健 - 株式会社东芝
  • 2005-07-07 - 2006-01-11 - G06F1/00
  • 本申请涉及微处理器。具体地,是在流水线结构中执行程序的微处理器。其包括:任务寄存管理单元,如果在多个单元执行第一任务时发出了切换到第二任务的切换指令,则在完成第一任务的执行之后将任务寄存的值切换到执行第二任务时使用的第二寄存信息;以及任务管理,在所述值被切换到第二寄存信息之后,将任务标识信息寄存的值切换到第二任务标识信息,并允许所述多个单元中的每一个执行所述第二任务。
  • 微处理器
  • [发明专利]微处理器-CN200510080936.0有效
  • 春木洋美;桥本干生;川端健 - 株式会社东芝
  • 2005-06-24 - 2005-12-28 - G06F1/00
  • 本申请涉及微处理器,其包括:当所获取的信息为加密信息时,对要由处理内核使用的信息解密以获取明文信息的解密单元;将明文信息存储起来的明文信息存储单元。该微处理器还包括:根据是否执行了解密,对所述明文信息添加表示保护或者不保护的受保护属性的受保护属性添加单元;获取对所述明文信息的访问请求的访问请求获取单元;识别所述访问请求的请求类型的请求类型识别单元;
  • 微处理器
  • [发明专利]微处理器-CN200510084387.4有效
  • 鬼头亮辅;辻雅之 - 富士通株式会社
  • 2005-07-19 - 2006-09-13 - G06F9/38
  • 处理核心采用流水线处理方法,并且具有互锁机制。内置加速代替处理核心执行特定处理。当由内置加速执行处理,并且不存在由处理核心执行的处理时,互锁机制分别响应于内置加速处理启动和处理完成来停止和重新启动流水线处理。通过使用互锁机制来实现对内置加速处理完成等待操作,因此可以容易地减少处理核心在内置加速处理期间的无用功耗。
  • 微处理器
  • [发明专利]微处理器-CN200410038672.8无效
  • 宫森高;矢野达男 - 株式会社东芝;安捷伦技术有限公司
  • 1995-12-28 - 2004-10-27 - G06F11/36
  • 本发明涉及一种微处理器,其特征在于,包括:一个处理内核,用以执行程序;一个中断电路,用以在一个存取地址与一个设定的地址相符合时或在一个存取地址和数据与一个设定地址和数据相符合时,产生一个中断请求或设置一个触发请求信号送到所述的处理内核;和一个程序计数跟踪,用以提供一个外部状态信号,用以指示在中断电路设置同样信号之后触发请求信号已经发出。
  • 微处理器
  • [发明专利]微处理器-CN02127757.5无效
  • 藤本谦作;白川健治;桥本干生;寺本圭一;尾崎哲 - 株式会社东芝
  • 2002-08-08 - 2004-02-11 - G06F12/14
  • 本发明提供一种可以在维持耐窜改性、性能的同时或以容易地对应于多重处理、多用户环境等的微处理器。在接通电源时、复位时,随机数发生部104发生从微处理器100外部不能推测的随机数,根据发生的随机数生成处理临时键Kc。该处理临时键Kc被保持在随机数保持部件105中,当异常检测部件108检测出中断、处理的切换等的异常状态时,运算处理部件103指令在加密处理部件109保留寄存102内的各寄存值等的上下文。与此对应,加密处理部件109由处理临时键Kc对上下文加密,被加密的上下文存储在外中存储1中。
  • 微处理器
  • [发明专利]微处理器-CN97113401.4无效
  • 高田由香里;佐藤贡;近藤弘郁;泽井克典 - 三菱电机株式会社
  • 1997-05-23 - 2003-03-26 - G06F13/10
  • 一种外部也有总线主控微处理器,它将DRAM及超高速缓存安装在内部。在微处理器(101)中,通过写入缓冲(5)、选择(7)或DRAM(27)、超高速缓存(28)、IQ(8)分别连接在总线D上。用数据总线D连接总线ID、微处理器(101)和外部存储(4)、外部总线主控(41),中间装有BIU(3)。用地址总线(58)、控制总线(56、57)连接微处理器(101)、外部存储(4)、外部总线主控(41)。BIU(3)控制对微处理器的内部存储及其外部连接的存储的访问。
  • 微处理器

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