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- [发明专利]微处理器-CN201010033646.1有效
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何虎;刘源;章道陵
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清华大学
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2010-01-04
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2010-06-23
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G06F9/30
- 本发明公开了一种微处理器,该微处理器包括:指令获取模块,其用于获取将要执行的指令;指令分发模块,其用于将从指令获取模块得到的指令进行分发;指令执行模块,其用于对从指令分发模块得到的指令进行解码并执行指令;寄存器堆,其用于存储指令执行结果;管理系统,管理指令执行过程中的程序和数据,指令执行模块包括完成算术逻辑运算和移位计算的A单元、完成乘法运算的M单元、实现管理系统存取和程序跳转的D单元以及完成浮点运算的该微处理器采用超长指令结构,并利用增加的F单元来进行浮点运算,使其同时具备了单周期多指令和单指令多数据的特点,提高了微处理器的操作性能。
- 微处理器
- [发明专利]微处理器-CN201110374840.0有效
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马岛吉英;阿部真喜男
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三美电机株式会社
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2011-11-16
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2012-07-18
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G06F15/78
- 本发明的目的在于:能够变更存储在不可改写的存储器中的中断处理程序。本发明的微处理器在第一存储器(13)中设置:对每个向量存储了通过多种中断进行处理的多个程序的地址的第一中断向量表;在上述第一中断向量表的各向量所示的地址中存储处理程序的区域,在第二存储器(14)中设置内容与第一中断向量表相同的第二中断向量表,该微处理器具备:地址变换单元(22),将对第一中断向量表进行存取的地址变换为对第二中断向量表进行存取的地址;写入单元(43),根据从外部设备(30)供给的指令,将第二中断向量表的任意向量的地址和存储在任意向量所示的地址中的处理程序写入到第二存储器
- 微处理器
- [发明专利]微处理器-CN200510083257.9有效
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春木洋美;桥本干生;川端健
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株式会社东芝
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2005-07-07
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2006-01-11
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G06F1/00
- 本申请涉及微处理器。具体地,是在流水线结构中执行程序的微处理器。其包括:任务寄存器管理单元,如果在多个单元执行第一任务时发出了切换到第二任务的切换指令,则在完成第一任务的执行之后将任务寄存器的值切换到执行第二任务时使用的第二寄存器信息;以及任务管理器,在所述值被切换到第二寄存器信息之后,将任务标识信息寄存器的值切换到第二任务标识信息,并允许所述多个单元中的每一个执行所述第二任务。
- 微处理器
- [发明专利]微处理器-CN02127757.5无效
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藤本谦作;白川健治;桥本干生;寺本圭一;尾崎哲
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株式会社东芝
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2002-08-08
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2004-02-11
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G06F12/14
- 本发明提供一种可以在维持耐窜改性、性能的同时或以容易地对应于多重处理、多用户环境等的微处理器。在接通电源时、复位时,随机数发生部104发生从微处理器100外部不能推测的随机数,根据发生的随机数生成处理器临时键Kc。该处理器临时键Kc被保持在随机数保持部件105中,当异常检测部件108检测出中断、处理的切换等的异常状态时,运算处理部件103指令在加密处理部件109保留寄存器102内的各寄存器值等的上下文。与此对应,加密处理部件109由处理器临时键Kc对上下文加密,被加密的上下文存储在外中存储器1中。
- 微处理器
- [发明专利]微处理器-CN97113401.4无效
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高田由香里;佐藤贡;近藤弘郁;泽井克典
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三菱电机株式会社
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1997-05-23
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2003-03-26
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G06F13/10
- 一种外部也有总线主控器的微处理器,它将DRAM及超高速缓存器安装在内部。在微处理器(101)中,通过写入缓冲器(5)、选择器(7)或DRAM(27)、超高速缓存器(28)、IQ(8)分别连接在总线D上。用数据总线D连接总线ID、微处理器(101)和外部存储器(4)、外部总线主控器(41),中间装有BIU(3)。用地址总线(58)、控制总线(56、57)连接微处理器(101)、外部存储器(4)、外部总线主控器(41)。BIU(3)控制对微处理器的内部存储器及其外部连接的存储器的访问。
- 微处理器
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