专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种厨房布局方法及系统-CN202110289494.X在审
  • 周琳琳;苏旭;郭秉义;袁道鸣;吴翔南;麦广柱 - 广东博智林机器人有限公司
  • 2021-03-17 - 2022-09-27 - G06F30/20
  • 本发明提供了一种厨房布局方法及系统,该方法包括:获取待布局厨房的户型数据及布局模板;基于户型数据和布局模板,利用贪心算法从预设主家具尺寸库中确定待布局厨房各个墙面排布的主家具尺寸;基于户型数据及各个墙面排布的主家具尺寸,确定各个墙面的剩余空间;基于各个墙面的剩余空间及预设橱柜尺寸库,确定各个墙面的橱柜数量及对应的橱柜尺寸;基于预设排布规则确定各个墙面主家具及橱柜的排布顺序,生成待布局厨房的布局方案。实现了厨房家具尺寸的精细化设计,在整个布局设计过程中,充分考虑厨房的实用性,使得所形成的布局方案更加符合用户的实际需求和使用习惯,为设计人员提供更加实用的设计参考,提高了设计人员的设计效率。
  • 一种厨房布局方法系统
  • [发明专利]一种CPU芯片设计方法、装置及电子设备-CN202011037129.1有效
  • 沈琪;晋大师;王毓千 - 海光信息技术股份有限公司
  • 2020-09-28 - 2023-05-12 - G06F30/392
  • 本发明的实施例公开一种CPU芯片设计方法、装置及电子设备,涉及芯片设计技术领域,解决目前芯片布局布线效率低的问题。所述CPU芯片设计方法,依次包括Assemble步骤、Floorplan步骤、Place步骤、Cts步骤、Route步骤、PrFinish步骤,其中Place包括:通过多个并行布局优化对象对待设计芯片进行布局优化,得到各布局优化对象对应的布局优化结果;根据预设综合指标确定方法,确定各布局优化结果的综合指标;所述Cts步骤包括:根据预设选择策略,选择综合指标最优的布局优化结果作为输入,进行时钟树综合计算。本发明能有效地提高CPU芯片布局布线的效率。
  • 一种cpu芯片设计方法装置电子设备
  • [发明专利]管形布局设计实现管路调频的方法-CN201911068010.8在审
  • 刘伟;岳珠峰 - 西北工业大学
  • 2019-11-04 - 2020-02-18 - F02C7/00
  • 本发明涉及航空发动机技术领域,提出一种管形布局设计实现管路调频的方法。该方法首先确定所述管路所在系统的脉冲频率;然后获取多个不同管形布局的管路一一对应的多组多阶参考固有频率;最后获取所述多阶参考固有频率在阈值范围内与所述脉冲频率均不相同的管路所对应的管形布局。相较于现有技术,在多种管形布局中选取完全不与发共计脉冲频率相同的参考固有频率对应的管路所对应的管形布局来实现管路调频,完全避开了共振,有目的性的选择管形布局,精度较高,且为之后的设计提供参考;无需刚度加固,只需要在改变管形布局使得管路的固有频率避开脉冲频率范围即可,减少了成本。
  • 布局设计实现管路调频方法
  • [发明专利]一种布局设计方法及其相关装置-CN202210584585.0在审
  • 符强;何书涵 - 北京邮电大学
  • 2022-05-27 - 2022-08-09 - G06F30/13
  • 本申请提供了一种布局设计方法及其相关装置,涉及计算机图形学领域。该方法包括:获取待设计范围;基于预定义的多种基础瓦片,对待设计范围的内部进行填充,得到对待设计范围的至少一种内部布局,每种内部布局下的待设计范围包括基于多个瓦片划分得到的一个或多个区域,该多种基础瓦片包括至少一种带有分割线的基础瓦片,每种带有分割线的基础瓦片包括与瓦片边界相交的一种分割线,上述一个或多个区域的边界由填充在待设计范围内的多个瓦片的分割线连接得到;基于待设计范围的至少一种内部布局,以及待设计范围的外边界,得到待设计范围的至少一种布局布局图由此,能够弱化布局设计对约束条件的依赖,更为灵活地提供布局方案。
  • 一种布局设计方法及其相关装置
  • [发明专利]芯片设计布局规划方法及相关设备-CN202211366329.0在审
  • 张新城;沈波 - 芯行纪科技有限公司
  • 2022-10-31 - 2023-05-23 - G06F30/392
  • 本申请提供一种芯片设计布局规划方法及相关设备。该方法,包括:读取所述芯片设计的初始布局规划数据;确定所述初始布局规划数据中的待处理的一组硬核;根据所述一组硬核的硬核尺寸,确定单元格尺寸;确定约束模板的行列数;根据所述行列数和所述单元格尺寸,生成所述约束模板;将所述一组硬核匹配到所述约束模板的单元格中;响应于确定匹配完成的所述一组硬核之间存在封闭区域或不规则区域,对匹配完成的所述一组硬核进行优化布局以消除所述封闭区域或所述不规则区域;基于优化布局后的所述一组硬核,输出布局规划数据。
  • 芯片设计布局规划方法相关设备
  • [发明专利]一种碧道布局设计展示装置-CN202211649056.0在审
  • 金亮;仵凤清;甘静 - 燕山大学
  • 2022-12-20 - 2023-03-14 - A47F7/00
  • 本发明涉及展示装置技术领域的一种碧道布局设计展示装置,包括安装结构,所述安装结构转动连接有竖直的支撑结构,所述支撑结构上端设有用于放置碧道布局模型的展示台,所述展示台两端部均设有能够沿展示台长度方向向内移动,实现夹持固定放置在展示台上台面的碧道布局模型的夹持组件。本发明通过对展示台施加扭转力,展示台的转动使得支撑弹簧发生扭转变形,进而带动立柱转动,此时展示台发生水平转动,进而带动碧道布局模型转动,因此可以使得不同角度的观看者观看,解决了现有技术中不能对模型进行转动的技术问题
  • 一种布局设计展示装置
  • [发明专利]集成电路布局设计的检验方法-CN200810084523.3有效
  • 苏士益 - 奇景光电股份有限公司
  • 2008-03-21 - 2009-09-23 - G06F17/50
  • 本发明公开了一种集成电路布局设计的检验方法,包括以下步骤:选择一电路设计布局进行检查,根据一判断规则,判断电路设计布局中的位于不同层间导线重叠处的接触孔(via)排列是否太狭长,或接触孔数量是否不够。在一实施例中,电路设计布局包括位于一第一金属层的导线和位于一第二金属层的导线,第一金属层的导线和第二金属层的导线至少在一重叠区域彼此重叠,且第一金属层的导线和第二金属层的导线通过多个接触孔电性连接,判断重叠区域中接触孔的总面积和上述重叠区域的面积的比例是否小于一警示值,以判断电路设计布局中,位于不同层间导线重叠处的接触孔(via)排列是否太狭长,或接触孔数量是否不够。
  • 集成电路布局设计检验方法
  • [发明专利]半导体集成电路的布局设计方法-CN200710181214.3有效
  • 野中义弘 - 日本电气株式会社
  • 2003-09-11 - 2008-04-09 - G06F17/50
  • 一种半导体集成电路的布局设计方法,包括:搜索步骤,用于搜索一组路径:通路对任何一个晶体管只通过一次且一组中路径的组合能够覆盖电路数据所表示的整个电路网络;抽选步骤,从所述搜索一组路径的步骤发现的作为搜索结果的各组路径中,选出具有最小路径数的一组路径;确定布局宽度的步骤,确定的依据为:每个晶体管的源极和漏极的宽度、源极和漏极之间区域的宽度、未结合成公共电极的一些相邻晶体管对的源极和漏极之间区域的宽度、晶体管的数目、以及由所述抽选一组路径的步骤选出的路径组中所包含的路径数;形成关于布局的信息的步骤,其中,包括在所述电路中的晶体管的源极、漏极和栅极都位于小宽度区域内,该小宽度区域的宽度由所述确定布局宽度的步骤确定;输出布局信息的步骤,该布局信息由所述形成关于布局的信息的步骤确定
  • 半导体集成电路布局设计方法
  • [发明专利]半导体集成电路的布局设计仪器-CN200710181212.4有效
  • 野中义弘 - 日本电气株式会社
  • 2003-09-11 - 2008-04-16 - G06F17/50
  • 本发明涉及一种布局设计仪器,含有:存储装置,用于存储由多个晶体管构成的电路的电路数据;搜索装置,用于搜索一组路径,使得通路对任何一个晶体管只通过一次且一组中路径的组合能够覆盖电路数据所表示的整个电路网络;抽选装置,用于从所述搜索装置发现作为搜索结果的各组路径中选出具有最小路径数的一组路径;布局宽度确定装置,用于确定布局宽度,其依据为,每个晶体管的源极和漏极的宽度、源极和漏极之间区域的宽度、未结合成公共电极的一些相邻晶体管对的源极和漏极之间区域的宽度、晶体管的数目、以及由所述抽选装置选出的路径组中所包含的路径数;布局确定装置,用于形成关于布局的信息,其中,包括在所述电路中的晶体管的源极、漏极和栅极都位于小宽度区域内,该小宽度区域的宽度由所述布局宽度确定装置确定;以及输出装置,用于输出由所述布局确定装置确定的布局信息。
  • 半导体集成电路布局设计仪器
  • [发明专利]芯片设计中填补环的自动布局方法-CN202010236834.8有效
  • 赵少峰 - 安徽省东科半导体有限公司
  • 2020-03-30 - 2021-04-09 - G06F30/392
  • 本发明公开了一种芯片设计中填补环的自动布局方法,包括:根据选定工艺库的信息和封装约束信息,确定芯片的信号引线模块的种类和数量,并结合设计总功耗数据确定电源引线模块的种类和对应每组电源引线模块种类的基本需求数量;基于信号引线模块和电源引线模块的种类、数量和封装约束信息,得到四条边界各自的待布局引线模块的分组;对每条边界执行第一自动布局,插入一个边界模块后,依次轮询调用第二子程序和第三子程序,分别用于插入信号引线模块,第一电源引线模块组和/或第二电源引线模块组;根据该边界执行第一自动布局后的剩余间隙的尺寸执行随机自动布局
  • 芯片设计填补自动布局方法
  • [发明专利]基于MSVR的机翼装配定位布局设计方法-CN201911029620.7有效
  • 李西宁;赵志浩;成娇;王悦舜 - 西北工业大学
  • 2019-10-28 - 2023-03-24 - G06F30/15
  • 本发明公开了一种基于MSVR的机翼装配定位布局设计方法,用于解决现有机翼装配定位布局设计方法效率低的技术问题。技术方案是首先构建MSVR模型,然后基于粒子群‑遗传算法优化MSVR模型参数,最终实现以温度、定位器载荷、定位器空间位置、机翼关键测点等为输入条件,快速设计出符合机翼装配现场的定位布局。由于本发明以影响定位布局的温度、定位器载荷、定位器空间位置、机翼关键测点等装配现场感知数据为基础,与背景技术相比,更加符合装配现场实际,可以实现机翼装配布局的精准确定,减少算法的计算复杂度,进而提高了机翼装配效率
  • 基于msvr机翼装配定位布局设计方法

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