[发明专利]半导体结构与其制作方法有效
申请号: | 201910105271.6 | 申请日: | 2019-02-01 |
公开(公告)号: | CN109904060B | 公开(公告)日: | 2021-05-04 |
发明(设计)人: | 熊文娟;张鹏;刘若男;李志华;李俊峰;赵超;王文武;亨利·H·阿达姆松 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L21/02 | 分类号: | H01L21/02 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 韩建伟 |
地址: | 100029 *** | 国省代码: | 北京;11 |
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摘要: | 本申请提供了一种半导体结构与其制作方法。该方法包括应力大于或者等于1GPa的结构层的制作过程,结构层的制作过程包括:多个沉积步骤,沉积步骤为在基底的表面上或者已经沉积的预结构子层的表面上沉积一个预结构子层,预结构子层的厚度在100~400nm之间;刻蚀步骤,在沉积步骤之后,刻蚀步骤为在一个预结构子层的厚度或者多个预结构子层的总厚度大于400nm的情况下,对厚度大于400nm的一个预结构子层进行退火或者对总厚度大于400nm的多个预结构子层进行刻蚀,至少一个刻蚀步骤使得刻蚀后的各预结构子层在基底表面的投影重合;退火步骤,刻蚀步骤后有一个退火步骤。该制作方法得到的半导体结构中的结构层的裂纹较少。 | ||
搜索关键词: | 半导体 结构 与其 制作方法 | ||
【主权项】:
1.一种半导体结构的制作方法,包括应力大于或者等于1GPa的结构层的制作过程,其特征在于,所述结构层的制作过程包括:多个沉积步骤,各所述沉积步骤为在基底的表面上或者已经沉积的预结构子层的表面上沉积一个预结构子层,各所述预结构子层的厚度在100~400nm之间,且各所述预结构子层的材料相同且材料的应力大于1GPa;至少一个刻蚀步骤,在一个或者多个所述沉积步骤之后,所述刻蚀步骤为在一个所述预结构子层的厚度或者多个所述预结构子层的总厚度大于400nm的情况下,对厚度大于400nm的一个所述预结构子层进行退火或者对总厚度大于400nm的多个所述预结构子层进行刻蚀,至少一个所述刻蚀步骤使得刻蚀后的各所述预结构子层在所述基底表面的投影重合;退火步骤,所述退火步骤的个数大于或者等于所述刻蚀步骤的个数,各所述刻蚀步骤后有一个所述退火步骤,所述退火步骤为所述预结构子层或者刻蚀后的所述预结构子层进行退火,经过所述刻蚀步骤和所述退火步骤,各所述预结构子层变为结构子层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造