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[发明专利]一种面向片上网络的步到步纠错路由器-CN201810516942.3在审
发明人：袁驰坤;黄乐天 -专利权人：电子科技大学
申请日： 2018-05-25 - 公布日： 2018-11-27 - 主分类号： H04L12/771 文献下载
摘要：本发明涉及片上网络可靠性设计，提出了一种高可靠性的片上网络路由器。数据包中包含纠错编码，在每个路由器中对其进行纠错，实现了高可靠性的步到步纠错。本发明把纠错编码的解码器拆分成两部分，嵌入新增的数据流水线中，这种方法在保证高可靠性的同时，消除了纠错专用的一个时钟周期。路由器的数据流水线和控制流水线有相同的深度，可到达完全重叠的流水线执行，降低平均包延迟的同时增加了片上网络的吞吐率。
纠错高可靠性片上网络路由器数据流水线纠错编码片上网络路由器解码器可靠性设计流水线执行时钟周期数据包吞吐率专用的流水线嵌入延迟保证

[发明专利]一种基于单向传输路径的片上网络测试封装-CN201810516625.1在审
发明人：詹俊楷;黄乐天 -专利权人：电子科技大学
申请日： 2018-05-25 - 公布日： 2018-11-20 - 主分类号： H04L12/26 文献下载
摘要：半导体制造工艺的进步和特征尺寸的缩小，使得片上多核系统的可靠性愈发重要。本发明是一种基于单向传输路径的片上网络测试封装。该测试封装以单向传输路径作为测试对象，并将其代替传统的路由器和链路结构作为片上网络的基本组成单元。单向传输路径定义为相邻片上网络资源节点之间的单向数据通路，以及与该单向数据通路功能耦合紧密的控制逻辑单元。基于该测试封装，能够对片上网络中空闲的单向路径进行在线测试，利用内建自测试检测固定型和桥接型等故障，并能够高效地将故障定位到某一条单向传输路径上，且该测试方式不会对系统中运行的应用产生负面影响。该发明可以有效地提高多核片上系统的可测性和可观测性，进而提高数字系统的可靠性。
单向传输路径片上网络封装测试单向数据半导体制造工艺多核片上系统控制逻辑单元片上多核系统内建自测试测试对象测试方式单向路径负面影响故障定位可观测性链路结构数字系统通路功能网络资源在线测试组成单元耦合传统的固定型可测性路由器相邻片有效地桥接空闲检测应用

[发明专利]一种多旋翼无人机的降落系统-CN201810483073.9在审
发明人：朱银广;徐正夫;黄乐天;黄亚明;吴国寿 -专利权人：智飞智能装备科技东台有限公司
申请日： 2018-05-18 - 公布日： 2018-11-02 - 主分类号： G05D1/08 文献下载
摘要：本发明公开了一种多旋翼无人机的降落系统，包括主控模块、自动导航模块、飞行信息获取模块、超声波测距模块、手持触发模块、惯性测量模块、无线通讯模块、高度控制模块、外置传感器模块和远程控制模块，所述自动导航模块、飞行信息获取模块、超声波测距模块、手持触发模块、外置传感器模块和无线通讯模块分别与主控模块通讯相连。本发明实现了驱动多旋翼无人机的飞行控制，铅垂方向升力与水平推力的驱动保证控制系统的简单可靠，多旋翼无人机的降落整个过程实现了自主飞行，可以实现无人机安全降落及回收。
旋翼无线通讯模块超声波测距外置传感器触发模块飞行信息获取模块降落系统主控模块自动导航惯性测量模块远程控制模块驱动安全降落飞行控制高度控制过程实现控制系统铅垂方向水平推力升力回收降落飞行通讯保证

[发明专利]一种利用正确性反馈训练神经网络的伪标签生成器-CN201810516876.X在审
发明人：程红旭;黄乐天 -专利权人：电子科技大学
申请日： 2018-05-25 - 公布日： 2018-11-02 - 主分类号： G06N3/08 文献下载
摘要：本发明提出了一个利用对神经网络推断结果的正确性反馈训练神经网络的方法，即设计一个伪标签生成器，根据对神经网络推断结果正确性的反馈生成相应的伪标签，然后用于神经网络的训练，解决了嵌入式场景下现场获得的训练样本没有标签的问题。
神经网络标签生成器反馈训练推断标签训练样本嵌入式场景反馈

[发明专利]一种自适应路由单周期片上网络路由器-CN201810516357.3在审
发明人：袁驰坤;黄乐天 -专利权人：电子科技大学
申请日： 2018-05-25 - 公布日： 2018-10-23 - 主分类号： H04L12/771 文献下载
摘要：片上网络是一种应用于多核或众核芯片的片上互连方式，其具有高带宽高扩展性的特点。本发明提出了一种使用自适应路由算法的单周期的片上网络路由器设计。本路由器只需要一个周期来转发数据包，同时自适应路由使其网络负载更加平均地分布。每个方向上的直行通道避免了自适应路由带来的死锁问题。这些设计使得本路由器网络获得了极低的传输延迟和很高的吞吐率。
自适应路由片上网络路由器路由器网络传输延迟高扩展性互连方式片上网络网络负载单周期高带宽核芯片路由器数据包吞吐率自适应多核死锁算法直行转发应用

[发明专利]一种防故障坠毁的无人机-CN201810482391.3在审
发明人：朱银广;徐正夫;黄乐天;黄亚明;吴国寿 -专利权人：智飞智能装备科技东台有限公司
申请日： 2018-05-18 - 公布日： 2018-10-19 - 主分类号： B64D17/80 文献下载
摘要：本发明公开了一种防故障坠毁的无人机，包括无人机，无人机上设置有备胀气囊和降落伞，在无人机的顶部设置有降落伞舱，降落伞舱包括伞舱盖和伺服机，伞舱盖上端设有自黏式固定座，伞舱盖通过合页连接有垂直尾翼，垂直尾翼与所述自黏式固定座上均设有通孔，垂直尾翼与所述自黏式固定座之间通过所述通孔绕接有一皮筋，皮筋两端与所述通孔之间均设有铝夹头，伺服机上设有伺服机摇臂，降落伞舱内置有收缩的降落伞，在无人机腹部的两侧对称设置有备胀气囊，降落伞舱的舱门由失电触发开关控制。本发明能准确有效的判断无人机是否处于失电的状态，无人机腹部的备胀气囊能更好的保护无人机，无论是落在陆地还是落在水里都不会使无人机损坏。
降落伞舱垂直尾翼固定座伞舱盖气囊通孔降落伞防故障伺服机皮筋失电腹部伺服触发开关顶部设置对称设置合页连接上端舱门铝夹内置绕接摇臂收缩陆地

[发明专利]一种面向异步FIFO的折叠式容错方法-CN201810177787.7在审
发明人：侯翔云;黄乐天 -专利权人：电子科技大学
申请日： 2018-03-05 - 公布日： 2018-09-28 - 主分类号： G06F11/07 文献下载
摘要：当前集成电路的特征尺寸越来越小，芯片集成度越来越高，芯片的可靠性也显得越发重要。在不可靠的底层元件上设计可靠数字系统成为设计者需要考虑的问题。针对在数字系统中广泛使用的异步FIFO，本发明提出一种容错方法提高其可靠性。该方法通过优化异步FIFO的控制逻辑绕过故障单元，使得异步FIFO在出现一定数量故障以后依然能够正常工作。其特点是，故障发生以后，选择2的幂次方个无故障单元作为工作组，屏蔽其余单元。该方法能够有效的提高异步FIFO的容错能力，从而提高整个数字系统的可靠性。
异步FIFO 故障单元数字系统芯片集成度底层元件故障发生可靠数字控制逻辑容错能力折叠式屏蔽绕过集成电路芯片工作组优化

[发明专利]一种生成高精度时钟的数字振荡器频率合成的方法和装置-CN201810192753.5在审
发明人：周百柯;黄乐天 -专利权人：电子科技大学
申请日： 2018-03-09 - 公布日： 2018-08-10 - 主分类号： H03L7/18 文献下载
摘要：该发明公开了一种生成高精度时钟的数字振荡器频率合成的方法和装置，本发明提供的内容主要是通过两种频率锁定模式对振荡频率进行锁定输出。快速锁定模式先通过所有频率点的扫描输出，校准实际输出频率并记录在存储器中。再根据频率控制码字选择所需频率直接输出，达到快速频率输出的效果。逐级调节模式，经过两级振荡器的调节，将高精度的振荡频率分频输出。本发明的装置，主要包括，频率控制模块，DCO粗调模块，DCO精调模块，分频器模块，以实现上述方法。该方法和装置一方面可以在快速锁定模式实现频率的快速锁定输出，另一方面能够在逐级调节模式中输出高精度时钟，提高了频率输出的单调性。发明达到了可移植性高、低功耗的目的。
输出方法和装置高精度时钟快速锁定数字振荡器频率合成频率控制模块振荡频率分频分频器模块存储器可移植性快速频率码字选择模式实现频率控制频率输出频率锁定扫描输出实际输出振荡频率单调性低功耗频率点振荡器校准粗调精调两级锁定记录

[发明专利]一种改进的高速缓存伪最近最少使用数据替换方法-CN201711210107.9在审
发明人：梁成豪;黄乐天 -专利权人：电子科技大学
申请日： 2017-11-28 - 公布日： 2018-06-19 - 主分类号： G06F12/12 文献下载
摘要：本发明涉及多路组相连高速缓存架构的伪最近最少使用替换方法的改进。利用额外的数量较少的寄存器数目以及标志位数目来改善高速缓存的伪最近最少使用替换方法，使之更加逼近真实最近最少使用替换方法。随着路数的增加，对于接近根节点的伪最近最少使用控制树的节点，可以适当放松对其辅助移位寄存器记录值的要求来在选择替换数据时进行猜测选择。
最近最少使用替换高速缓存高速缓存架构移位寄存器数据替换替换数据标志位根节点寄存器多路路数逼近改进放松记录

[发明专利]一种基于共享缓存的片上多核处理器静态架构-CN201510302580.4有效
发明人：李嵩;褚廷斌;黄乐天;袁正希 -专利权人：电子科技大学
申请日： 2015-06-04 - 公布日： 2018-06-15 - 主分类号： G06F15/167 文献下载
摘要：本发明公开了一种基于共享缓存的片上多核处理器静态架构，它包括n个节点，n为大于0的偶数，所述的节点包括n/2个A类节点和n/2个B类节点；A类节点包括处理核心core、本地私有高速缓存L1和路由器R；B类节点包括处理核心core、本地私有高速缓存L1、路由器R和共享缓存l2bank；节点之间通过路由器进行通信；A类节点和B类节点成间歇式分布；所述的共享缓存l2bank的容量为通用架构中的共享缓存的两倍。本发明提供了一种基于共享缓存的片上多核处理器静态架构，在不增加整个片上网络的访问延时和不增加整个片上网络的拥塞程度的基础上，节省了最后一级高速缓存的硬件开销和面积，节省了高速缓存的静态功耗。 1
共享缓存片上多核处理器高速缓存路由器处理核心片上网络架构一级高速缓存访问延时静态功耗通用架构硬件开销间歇式拥塞通信

[发明专利]一种基于OpenCL与SoC-FPGA的K近邻分类加速方法-CN201510294882.1有效
发明人：蒲宇亮;黄乐天;彭军;贺江 -专利权人：电子科技大学
申请日： 2015-06-02 - 公布日： 2018-05-01 - 主分类号： G06F9/38 文献下载
摘要：本发明公开了一种基于OpenCL与SoC‑FPGA的K近邻分类加速方法，它包括以下步骤S1构建SoC‑FPGA异构平台模型；S2在ARM主机端构建控制作用的OpenCL主机程序；S3ARM主机端的主机程序创建内核；S4ARM主机端配置并调用FPGA设备端的内核程序，将数据传输至FPGA设备端；S5第一内核程序负责计算待分类数据距离训练集数据的欧氏距离，产生距离矩阵；S6第二内核程序对距离矩阵的每一行进行不完全排序，筛选出每行的最小K个距离，并找到对应的训练集元素类型，传回ARM主机端处理；S7ARM主机端进行类别统计并归类。本发明运用OpenCL标准，实现K近邻分类算法的FPGA并行优化，并在ARM端和FPGA端形成系统级流水，相比传统的GPU异构计算系统，本发明功耗更低，获得了更高的能量效率。
一种基于 opencl soc fpga 近邻分类加速方法

[发明专利]基于SoC-FPGA的自重构K-means聚类技术实现方法-CN201510308043.0有效
发明人：蒲宇亮;黄乐天;彭军;贺江 -专利权人：电子科技大学
申请日： 2015-06-08 - 公布日： 2018-05-01 - 主分类号： G06K9/62 文献下载
摘要：本发明公开了一种基于SoC‑FPGA的自重构K‑means聚类技术实现方法，它包括以下步骤S1构建ARM主机端和FPGA设备端协作的SoC‑FPGA异构平台模型；S2ARM主机端构建OpenCL主机程序，创建内核，完成内存分配与映射；S3主机程序调用FPGA设备端的内核程序，将数据传输至FPGA设备端；S4第一OpenCL内核程序并行流水地计算欧式距离，产生一个距离矩阵；S5自重构第二OpenCL内核程序，筛选出每行最小的元素并记录其对应质心；S6自重构第三OpenCL内核程序，实现各个质心簇中所有样本点的距离累加以及数量统计工作；S7主机程序计算出新质心数据；S8主机程序进行迭代判断。本发明不仅提升了K‑means聚类算法的执行速度，获得了更高的能量效率，而且通过内核自重构，解决了FPGA硬件资源不足的问题。
基于 soc fpga 自重 means 技术实现方法

[发明专利]一种应用于Mesh拓扑片上网络的故障信息传播方法-CN201510436479.8有效
发明人：王君实;黄乐天;张晓帆 -专利权人：电子科技大学
申请日： 2015-07-23 - 公布日： 2018-02-27 - 主分类号： H04L12/703 文献下载
摘要：本发明公开了一种应用于Mesh拓扑片上网络的链路故障信息传播方法，包括以下步骤S1.设定链路故障信息的正交方向传播的宽度，链路故障信息的正交方向传播的宽度表示为N；S2.获取新增链路故障信息，将该新增链路故障信息传播到以故障链路为中心的传播区域内；S3. 故障区域为相互之间会产生相互干扰的故障链路组成的区域，各路由器根据接收到的新增链路故障信息更新当前故障区域；S4.在当前故障区域内传播各路由器还未记录的链路故障信息。本发明通过对正交方向传播的宽度的设定，以及对故障区域的自适应检测，确定故障传播区域，将链路故障信息传播到此区域内的每一个路由器，可以满足不同优化目标的容错路由算法对于链路故障信息的要求。
一种应用于 mesh 拓扑网络故障信息传播方法

[发明专利]一种包含数据包接收模块的网络路由器-CN201510302588.0有效
发明人：张晓帆;黄乐天;王君实 -专利权人：电子科技大学
申请日： 2015-06-04 - 公布日： 2018-01-02 - 主分类号： H04L12/703 文献下载
摘要：本发明公开了一种包含数据包接收模块的网络路由器，包括数据包接收单元、输入单元、逻辑控制单元、交换传输单元和输出单元；所述的数据包接收单元的输出端分别与输入单元和输出单元连接，输入单元的输出端与逻辑控制单元连接，逻辑控制单元的输出端与交换传输单元连接，交换传输单元的输出端与输出单元连接。本发明提供了一种包含数据包接收模块的网络路由器，克服现有数据包接收过程无法在控制逻辑故障发生时提供可靠接收服务的缺点，在硬件实现时，本发明电路结构简单，能有效减少运行时所受不利因素影响，提高片上网络数据包接收服务质量。
一种包含数据包接收模块网络路由器

[发明专利]时域下数字化温度传感器-CN201710563996.0在审
发明人：李梦雨;张岱南;黄乐天;周雄;李强 -专利权人：电子科技大学
申请日： 2017-07-12 - 公布日： 2017-12-22 - 主分类号： G01K7/01 文献下载
摘要：一种基于两个环形振荡器的时域下数字化温度传感器。本发明包含三个部分第一部分使用两个对温度有不同敏感度的震荡环作为传感器温度的检测部分；第二部分为震荡环频率到与温度相关数字码的转换部分，其使用纯数字逻辑器件构成的TDC(时间‑数字转换器)作为转换单元；第三部分为频率的算术运算和片外校准部分，本发明需要两个已知温度点作为校准的参考点来获取所测量的绝对温度值。
时域数字化温度传感器

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