[实用新型]一种高雪崩耐量的屏蔽栅MOSFET器件有效
申请号: | 202121100113.0 | 申请日: | 2021-05-21 |
公开(公告)号: | CN214956891U | 公开(公告)日: | 2021-11-30 |
发明(设计)人: | 王艳颖 | 申请(专利权)人: | 上海道之科技有限公司 |
主分类号: | H01L29/06 | 分类号: | H01L29/06;H01L29/423;H01L21/336;H01L29/78 |
代理公司: | 杭州九洲专利事务所有限公司 33101 | 代理人: | 陈琦;陈继亮 |
地址: | 201800*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 雪崩 屏蔽 mosfet 器件 | ||
本实用新型公开了一种高雪崩耐量的屏蔽栅MOSFET器件,屏蔽栅MOSFET器件分为终端区和原胞区,且终端区和原胞区均主要包括依次设置的衬底层和外延层,外延层上设置有沟槽;其制造方法包括如下步骤:在选定的外延硅衬底上进行沟槽刻蚀;生长牺牲氧化层;利用一块掩膜版去掉原胞区的牺牲氧化层,保留终端沟槽中的氧化层;通过热氧化或热氧化加沉积氧化层方式制备场氧化层;屏蔽栅多晶硅填充;栅氧化层生长;栅多晶硅填充;体区注入及退火;光刻源区并进行源区注入;光刻接触孔,刻蚀绝缘层,溅射顶层金属,光刻刻蚀顶层金属,淀积钝化层,光刻刻蚀钝化层,完成顶层结构的制作;最后进行圆片减薄以及背面金属淀积。
技术领域
本实用新型涉及半导体技术领域,具体涉及一种高雪崩耐量的屏蔽栅MOSFET器件。
背景技术
屏蔽栅MOSFET器件和传统的沟槽型MOSFET相比具有导通电阻低,开关损耗低的优点,因此在中低压功率半导体市场的应用逐渐增加。近年来,屏蔽栅MOSFET器件作为开关器件在新能源电动汽车、新型光伏发电、节能家电等领域的电机驱动系统、逆变器系统及电源管理系统中的应用越来越广泛,作为核心功率控制部件,对其性能和可靠性的要求越来越高。而在实际的可靠性测试和系统应用中发现,具有高雪崩耐量的器件是高可靠性器件的重要指标。造成器件雪崩耐量低的原因有很多,其中一种就是击穿不均匀导致的EAS失效,目前业界量产的屏蔽栅MOSFET器件的终端区都是采用与原胞区类似的沟槽结构,这种结构的终端区尤其在转角处会造成电场更集中,所以击穿会首先发生在终端区。终端区只占器件面积的很小部分,雪崩电流在终端区集中,导致终端区温度迅速上升从而导致器件烧毁,所以器件的雪崩耐量会比较低。因此在器件的设计过程中应该避免击穿发生在器件的终端区。
发明内容
本实用新型要解决的技术问题在于,针对现有技术的上述缺陷,提供一种与现有工艺兼容且更加安全可靠的高雪崩耐量的屏蔽栅MOSFET器件及其制作方法。
本实用新型的目的是通过如下技术方案来完成的,一种高雪崩耐量的屏蔽栅MOSFET器件,包括MOSFET器件本体,所述MOSFET器件本体分为终端区和原胞区,且所述终端区和原胞区均主要包括依次设置的衬底层和外延层,该外延层上设置有向内凹陷的沟槽;所述终端区的沟槽内设置有屏蔽栅多晶硅及布置在屏蔽栅多晶硅和沟槽之间的终端厚场氧化层,终端区的上表面由内到外依次设置有牺牲氧化层、场氧化层、栅氧化层及介质层;所述原胞区的沟槽内设置有屏蔽栅多晶硅及布置在屏蔽栅多晶硅和沟槽之间的场氧化层,原胞区的上表面刻蚀有与原胞区内的沟槽连通的刻蚀槽,该刻蚀槽内布置有栅多晶硅和栅氧化层,且相邻两刻蚀槽之间设置有上下依次布置的源区和体区;所述栅多晶硅和栅氧化层的上表面设置有介质层,该介质层内设置有若干接触孔。
进一步地,所述终端区内的终端厚场氧化层包括由内到外依次设置的牺牲氧化层和场氧化层,终端区内介质层的厚度大于牺牲氧化层、场氧化层和栅氧化层的厚度之和;所述原胞区内的刻蚀槽深度为0~1um。
一种屏蔽栅MOSFET器件的制作方法,主要包括如下步骤:
1)在选定的N外延硅衬底上淀积厚度为1~1.5um的氧化层作为硬掩模,使用第一张掩膜版在N外延硅衬底上光刻出沟槽并进行深沟槽刻蚀,同时形成原胞区和终端区的沟槽;
2)进行牺牲氧化层生长,即在原胞区和终端区的沟槽及硅表面生成厚度约500A~3000A的热氧化层;
3)利用第二张掩膜版选择性的在去掉原胞区沟槽及硅表面的牺牲氧化层,保留终端区沟槽及硅表面的牺牲氧化层;
4)根据器件击穿电压的需求,在原胞区和终端区的上表面和沟槽内通过热氧化或热氧化加沉积氧化层的方式制备相应厚度的场氧化层,且终端区沟槽内的牺牲氧化层和场氧化层的厚度之和大于原胞区沟槽内的场氧化层厚度;
5)在终端区和原胞区的沟槽内淀积屏蔽栅多晶硅,并通过化学机械抛光或湿法刻蚀回刻到硅表面;
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