[发明专利]接触孔和多晶硅图形的套刻偏差的检测方法有效

专利信息
申请号: 202011387239.0 申请日: 2020-12-02
公开(公告)号: CN112635344B 公开(公告)日: 2022-08-16
发明(设计)人: 宁威;李磊 申请(专利权)人: 华虹半导体(无锡)有限公司
主分类号: H01L21/66 分类号: H01L21/66
代理公司: 上海浦一知识产权代理有限公司 31211 代理人: 郭四华
地址: 214028 江*** 国省代码: 江苏;32
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摘要:
搜索关键词: 接触 多晶 图形 偏差 检测 方法
【说明书】:

发明公开了一种接触孔和多晶硅图形的套刻偏差的检测方法包括如下步骤:步骤一、利用被检测产品的接触孔和多晶硅图形的套刻偏差和电子束检测设备扫描形成的接触孔的图像亮度具有相关性的特点,预先形成被检测产品对应的接触孔和多晶硅图形的套刻偏差和对应的接触孔的图像亮度的拟合曲线。步骤二、采用电子束检测设备对被检测产品进行扫描并得到被检测产品上和多晶硅图形相套刻的接触孔的图像亮度。步骤三、结合拟合曲线将被检测产品对应的接触孔的图像亮度转换为被检测产品的接触孔和多晶硅图形的套刻偏差。本发明能在线快速且全面检测出接触孔和多晶硅图形的套刻偏差。

技术领域

本发明涉及一种半导体集成电路制造方法,特别是涉及一种接触孔(CT)和多晶硅图形的套刻偏差(overlay)的检测方法。

背景技术

随着集成电路先进制程的发展,尤其是55nm技术节点平台下,接触孔和有源区(AA)或多晶硅(poly)之间的套刻偏差(overlay)的随机波动会严重影响产品良率。现有方法很难实现接触孔和多晶硅图形如多晶硅栅之间的套刻偏差的在线(Inline)检测,例如Inline overlay检测很难针对静电随机存储器(SRAM)等产品的局部区域量测并定性是否漏电风险。

发明内容

本发明所要解决的技术问题是提供一种接触孔和多晶硅图形的套刻偏差的检测方法,能在线快速且全面检测出接触孔和多晶硅图形的套刻偏差。

为解决上述技术问题,本发明提供的接触孔和多晶硅图形的套刻偏差的检测方法包括如下步骤:

步骤一、利用被检测产品的接触孔和多晶硅图形的套刻偏差和电子束检测(E-Beam Inspection,EBI)设备扫描形成的所述接触孔的图像亮度具有相关性的特点,预先形成所述被检测产品对应的所述接触孔和所述多晶硅图形的套刻偏差和对应的所述接触孔的图像亮度的拟合曲线。

步骤二、提供所述被检测产品,所述被检测产品上形成有所述多晶硅图形和所述接触孔;采用所述电子束检测设备对所述被检测产品进行扫描并得到所述被检测产品上和所述多晶硅图形相套刻的所述接触孔的图像亮度。

步骤三、结合所述拟合曲线将所述被检测产品对应的所述接触孔的图像亮度转换为所述被检测产品的所述接触孔和所述多晶硅图形的套刻偏差。

进一步的改进是,步骤一中,形成所述拟合曲线的分步骤包括:

步骤11、通过在测试片上形成和所述被检测产品相同的所述接触孔和所述多晶硅图形,而且在所述测试片上对所述接触孔和所述多晶硅图形之间的间距进行拉偏从而形成一系列大小不同的所述接触孔和所述多晶硅图形的套刻偏差。

步骤12、采用所述电子束检测设备扫描所述测试片形成的第一扫描图片。

步骤13、在所述第一扫描图片上确定各所述接触孔的图像亮度。

步骤14、将各所述接触孔的图像亮度和对应的所述套刻偏差进行拟合形成所述拟合曲线。

进一步的改进是,步骤11中,所述测试片上,按照所述套刻偏差的大小按照一个反向逐渐增加或者逐渐减少以及各所述接触孔按照所述套刻偏差渐变的方向排列,使得在所述套刻偏差渐变的方向上,所述接触孔的位置和所述套刻偏差的大小一一对应。

步骤13中,各所述接触孔的图像亮度在所述第一扫描图片中的位置和对应的所述接触孔在所述测试片上的位置相对应,通过所述接触孔的图像亮度在所述第一扫描图片中的位置确定所述接触孔的图像亮度所对应的所述套刻偏差大小。

进一步的改进是,所述被检测产品包括多个。

进一步的改进是,当各所述被检测产品的类型相同时,各所述被检测产品共用相同的所述拟合曲线,所述拟合曲线仅需要在对第一个所述被检测产品进行检测之前形成即可。

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