[发明专利]碳化硅层叠基板及其制造方法有效
申请号: | 201880010575.8 | 申请日: | 2018-01-30 |
公开(公告)号: | CN110301034B | 公开(公告)日: | 2023-07-11 |
发明(设计)人: | 小西久美子;大内洁;小林庆亮;岛明生 | 申请(专利权)人: | 株式会社博迈立铖 |
主分类号: | H01L21/20 | 分类号: | H01L21/20;C30B29/36;H01L21/205;H01L21/336;H01L29/06;H01L29/12;H01L29/78;H01L29/861;H01L29/868 |
代理公司: | 北京尚诚知识产权代理有限公司 11322 | 代理人: | 龙淳 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 碳化硅 层叠 及其 制造 方法 | ||
1.一种碳化硅层叠基板,具有:
第一导电型的第一基板,其为包含碳化硅的六方晶系半导体基板;
所述第一导电型的第一半导体层,其形成于所述第一基板上且包含碳化硅;
所述第一导电型的第二半导体层,其形成于所述第一半导体层上且包含碳化硅;和
所述第一导电型的第三半导体层,其形成于所述第二半导体层上且包含碳化硅,
所述第一半导体层与所述第一基板的上表面相接触,
所述第一半导体层的第一杂质浓度比所述第二半导体层的第二杂质浓度和所述第一基板的所述上表面的第四杂质浓度均低、且比所述第三半导体层的第三杂质浓度高,所述第二杂质浓度比所述第三杂质浓度高,所述第四杂质浓度比所述第二杂质浓度高,
所述第一半导体层的所述第一杂质浓度比1×1016cm-3大且为1×1017cm-3以下,
所述第一基板的所述上表面的所述第四杂质浓度比1×1018cm-3大且为1×1019cm-3以下。
2.根据权利要求1所述的碳化硅层叠基板,其中,
所述第二杂质浓度为1×1017cm-3以上且低于1×1019cm-3。
3.根据权利要求1所述的碳化硅层叠基板,其中,
所述第一半导体层、所述第二半导体层和所述第三半导体层为外延层。
4.一种碳化硅层叠基板,具有:
第一导电型的第二基板,其为包含碳化硅的六方晶系半导体基板;
所述第一导电型的第五半导体层,其形成于所述第二基板上且包含碳化硅;
所述第一导电型的第一半导体层,其形成于所述第五半导体层上且包含碳化硅;
所述第一导电型的第二半导体层,其形成于所述第一半导体层上且包含碳化硅;和
所述第一导电型的第三半导体层,其形成于所述第二半导体层上且包含碳化硅,
所述第一半导体层与所述第五半导体层的上表面相接触,
所述第一半导体层的第一杂质浓度比所述第二半导体层的第二杂质浓度和所述第五半导体层的所述上表面的第五杂质浓度均低、且比所述第三半导体层的第三杂质浓度高,所述第二杂质浓度比所述第三杂质浓度高,所述第二基板的第六杂质浓度比所述第二杂质浓度低,
所述第二基板的所述第六杂质浓度为5×1017cm-3以下,
所述第五杂质浓度为1×1017cm-3以上,
在作为基板表面的所述第三半导体层和所述第五半导体层之间,形成有所述第一杂质浓度比1×1016cm-3大且为1×1017cm-3以下的一层的所述第一半导体层。
5.根据权利要求4所述的碳化硅层叠基板,其中,
所述第二杂质浓度为1×1017cm-3以上且低于1×1019cm-3。
6.根据权利要求4所述的碳化硅层叠基板,其中,
所述第五半导体层、所述第一半导体层、所述第二半导体层和所述第三半导体层为外延层。
7.根据权利要求4所述的碳化硅层叠基板,其中,
所述第五半导体层的下表面具有比所述第五杂质浓度低的第九杂质浓度,
所述第五半导体层具有随着从所述第五半导体层的所述下表面去往所述第五半导体层的所述上表面杂质浓度逐渐变高的浓度梯度。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造