[发明专利]半导体装置及其制造方法有效
申请号: | 201210059659.5 | 申请日: | 2012-03-08 |
公开(公告)号: | CN102683343A | 公开(公告)日: | 2012-09-19 |
发明(设计)人: | 井上亚矢子;津村和宏 | 申请(专利权)人: | 精工电子有限公司 |
主分类号: | H01L27/06 | 分类号: | H01L27/06;H01L21/822 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 李辉;马建军 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 半导体 装置 及其 制造 方法 | ||
1.一种半导体装置的制造方法,该半导体装置在同一半导体衬底上具有晶体管元件、电容元件以及电阻元件,其特征在于,该制造方法包括以下步骤:
步骤a,在半导体衬底上形成有源区域和具有高于所述有源区域的表面高度的表面的元件分离区域;
步骤b,在沿着所述有源区域上的所述半导体衬底的一个主面形成的第一导电型的阱区域上形成所述晶体管元件的栅氧化膜;
步骤c,在所述半导体衬底上形成第一多晶硅膜;
步骤d,对所述第一多晶硅膜进行图案化,由此在所述有源区域形成所述晶体管元件的栅电极和所述电容元件的下部电极;
步骤e,向所述栅电极和下部电极导入第二导电型杂质;
步骤f,将所述栅电极作为掩模,向所述第一导电型的阱区域表面导入第二导电型杂质,形成所述晶体管元件的源区以及漏区;
步骤g,在所述电容元件的下部电极上形成电容绝缘膜;
步骤h,在所述半导体衬底上形成第二多晶硅膜;
步骤i,对所述第二多晶硅膜进行图案化,由此形成所述电容元件的上部电极和所述电阻元件;
步骤j,向所述上部电极导入第二导电型杂质;
步骤k,向所述电阻元件导入第一导电型杂质;
步骤l,在所述半导体衬底上形成第一层间绝缘膜;
步骤m,至少将所述第一层间绝缘膜和所述电阻元件削至所述电阻元件成为期望的膜厚;
步骤n,在所述半导体衬底上形成第二层间绝缘膜;以及
步骤o,在所述第二层间绝缘膜形成接触孔。
2.根据权利要求1所述的半导体装置的制造方法,其特征在于,
采用LOCOS法来形成所述步骤a的元件分离区域。
3.根据权利要求1所述的半导体装置的制造方法,其特征在于,
采用作为现有的平坦化技术的CMP法来进行所述步骤m。
4.根据权利要求1所述的半导体装置的制造方法,其特征在于,
将所述第一层间绝缘膜作为平坦化膜,在所述步骤m中使用回蚀。
5.根据权利要求1所述的半导体装置的制造方法,其特征在于,
同时进行所述步骤e和所述步骤f、或者所述步骤f和所述步骤j。
6.一种半导体装置,该半导体装置在同一半导体衬底上具有晶体管元件、电容元件以及电阻元件,其特征在于,该半导体装置具有:
半导体衬底;
配置在所述半导体衬底上的第一有源区域以及第二有源区域和表面高度高于所述有源区域的表面高度的元件分离区域;
沿着所述第一有源区域上的所述半导体衬底的一个主面形成的第一导电型的阱区域;
配置在所述阱区域上的栅氧化膜;
由第一多晶硅膜形成的配置在所述栅氧化膜上的栅电极以及配置在所述第二有源区域上的用于电容元件的下部电极;
隔着所述栅电极配置在所述阱区域表面的第二导电型的源区以及漏区;
配置在所述下部电极上的电容绝缘膜;以及
由第二多晶硅膜形成的配置在所述电容绝缘膜上的用于所述电容元件的上部电极以及配置在所述元件分离区域上的电阻元件,
构成所述电阻元件的所述第二多晶硅膜的厚度比构成所述上部电极的所述第二多晶硅膜的厚度薄,
所述电阻元件的上部表面位于比所述上部电极的上部表面高的位置或者处于相同的高度。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的