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[发明专利]存储设备-CN201910858006.5在审
发明人：刘永健;薛昶圭;金贤愚;宋炯昔 -专利权人：三星电子株式会社
申请日： 2019-09-11 - 公布日： 2020-03-31 - 主分类号： G06F3/06 文献下载
摘要：提供了一种存储设备。所述存储设备包括：第一存储器设备，其包括多个第一存储器单元；第二存储器设备，其包括具有与多个第一存储器单元相同的类型的多个第二存储器单元；以及控制器，其通过第一存储器接口与第一存储器设备通信，并且通过具有高于第一存储器接口的操作速度的操作速度的第二存储器接口与第二存储器设备通信
存储设备

[发明专利]包括非易失性存储器的存储器存储设备和电子设备-CN202211643018.4在审
发明人：刘善美;李荣息;金贞银;金慧珠;黄素淡 -专利权人：三星电子株式会社
申请日： 2022-12-20 - 公布日： 2023-07-07 - 主分类号： G06F3/06 文献下载
摘要：提供一种包括非易失性存储器的存储器存储设备和电子设备。所述存储器存储设备包括：非易失性存储器，所述非易失性存储器包括多个存储块；以及存储器控制器，所述存储器控制器被配置为控制所述非易失性存储器，所述存储器控制器还被配置为向所述非易失性存储器提供包括写入数据的主机数据，所述存储器控制器还被配置为：当所述多个存储块的空闲块计数小于第一阈值时，对所述多个存储块执行垃圾收集操作以向所述非易失性存储器提供垃圾收集数据，其中，所述存储器控制器还被配置为：当所述多个存储块的所述空闲块计数大于比所述第一阈值小的第二阈值并且所述多个存储块中的第一存储块的有效页计数小于第三阈值时
包括非易失性存储器存储器存储设备电子设备

[发明专利]存储器设备、存储器控制器和存储器系统-CN200710135818.4有效
发明人：川久保智广;山口秀策;池田仁史;内田敏也;小林广之;神田达哉;山本喜史;白川晓;宫本哲生;大塚龙志;高桥秀长;栗田昌德;镰田心之介;佐藤绫子 -专利权人：富士通株式会社
申请日： 2007-07-13 - 公布日： 2008-06-25 - 主分类号： G11C11/406 文献下载
摘要：本发明提供了存储器设备、存储器控制器和存储器系统。一种响应于来自存储器控制器的命令而被操作的存储器设备具有多个存储体，该多个存储体分别具有包括存储器单元阵列和解码器的存储器核心并且被存储体地址选择；以及控制电路，该控制电路响应于后台刷新命令，致使由存储器控制器设置的刷新目标存储体内的存储器核心相继执行刷新操作多次，次数对应于由存储器控制器设置的刷新突发长度，并且在由刷新目标存储体内的存储器核心执行的刷新操作期间，该控制电路响应于正常操作命令，还致使除刷新目标存储体之外的被存储体地址选择的存储体内的存储器核心执行与正常操作命令相对应的正常存储器操作
存储器设备控制器系统

[发明专利]数据的存储方法和装置、存储介质、电子装置-CN202010723811.X在审
发明人：王贺 -专利权人：北京金山云网络技术有限公司
申请日： 2020-07-24 - 公布日： 2020-11-13 - 主分类号： G06F3/06 文献下载
摘要：本申请公开了一种数据的存储方法和装置、存储介质、电子装置。其中，该方法包括：获取第一存储器的第一使用率，第一存储器为存储系统内的存储器，第一使用率为第一存储器中已经使用的数据存储空间与第一存储器中全部数据存储空间之间的比值；在第一使用率满足目标条件的情况下，将目标数据从第一存储器和第二存储器中的一个存储器转移至第一存储器和第二存储器中的另一个存储器进行保存，第二存储器为存储系统内的存储器，从第一存储器获取目标数据时的数据传输速度高于从第二存储器获取目标数据时的数据传输速度。本申请解决了相关技术中数据存储实现方案的成本较高的技术问题。
数据存储方法装置介质电子

[发明专利]校正脉冲占空比的存储器装置和包括其的存储器系统-CN202210389813.9在审
发明人：洪在亨;孔仁锡;金馆遇;朴宰永;孙琯琇;安顺成;杨大浩;玉成华;张俊瑞;郑尧韩;崔恩志 -专利权人：爱思开海力士有限公司
申请日： 2022-04-14 - 公布日： 2023-04-04 - 主分类号： G11C7/22 文献下载
摘要：本公开涉及校正脉冲占空比的存储器装置和包括其的存储器系统。本公开涉及一种校正脉冲占空比的存储器装置和包括该存储器装置的存储器系统，并且涉及一种校正存储器装置控制信号的首脉冲的占空比的存储器装置和包括该存储器装置的存储器系统。
校正脉冲存储器装置包括系统

[发明专利]有热插拔功能的存储器系统-CN200610067981.7有效
发明人：阿部崇 -专利权人：日本电气株式会社
申请日： 2006-03-27 - 公布日： 2006-09-27 - 主分类号： G06F3/06 文献下载
摘要：一种存储器系统，它包括串联连接的正常存储器模块、备份存储器模块，以及用备份存储器模块代替各正常存储器模块中发生故障的存储器模块的开关电路。开关电路将备份存储器模块插入到除发生故障的正常存储器模块之外的正常存储器模块的串联连接中。
有热插拔功能存储器系统

[发明专利]存储器模块、存储器系统和存储器控制器的操作方法-CN202211241025.1在审
发明人：申院济;金成峻;金熙东;裵敏秀;徐一雄;李美珍;李昇周;李贤淑;崔仁寿;韩基悳 -专利权人：三星电子株式会社
申请日： 2022-10-11 - 公布日： 2023-04-14 - 主分类号： G11C29/42 文献下载
摘要：公开了一种存储器模块、存储器系统和存储器控制器的操作方法。所述存储器系统包括存储器模块和存储器控制器，存储器模块包括第一存储器装置至第四存储器装置和第一纠错码(ECC)装置，存储器控制器通过8条数据线与第一存储器装置至第四存储器装置中的每个存储器装置交换第一用户数据存储器控制器包括ECC引擎，ECC引擎基于第一ECC数据纠正第一用户数据的32位随机错误。
存储器模块系统控制器操作方法

[发明专利]存储器控制器及其操作方法-CN201910434524.4有效
发明人：文敏焕;李宣周;韩正哲 -专利权人：爱思开海力士有限公司
申请日： 2019-05-23 - 公布日： 2023-06-16 - 主分类号： G06F3/06 文献下载
摘要：本文描述了存储器控制器及其操作方法。在被配置为控制包括多个存储器块的存储器装置的存储器控制器中，存储器控制器包括：存储器接口，其被配置为与存储器装置交换数据；预编程控制器，其被配置为当存储器装置处于空闲状态时对擦除目标存储器块中的多个页的编程序列的最后页执行读取操作，并且根据通过执行读取操作所获得的结果对擦除目标存储器块执行预编程操作，其中擦除目标存储器块是在多个存储器块之中的要对其执行擦除操作的存储器块，并且其中在执行预编程操作之后执行对擦除目标存储器块的擦除操作
存储器控制器及其操作方法

[发明专利]检查非易失性存储器装置的错误的设备和方法-CN202110456878.6在审
发明人：金正爱;金志烈 -专利权人：爱思开海力士有限公司
申请日： 2021-04-27 - 公布日： 2022-04-15 - 主分类号： G11C29/12 文献下载
摘要：本发明涉及一种存储器系统。该存储器系统包括：存储器装置，包括多个存储器组，每个存储器组包括多个非易失性存储器单元；以及控制器，被配置为向存储器装置传输命令从而存储器装置在多个存储器组之中的至少一个存储器组内执行数据输入/输出操作，从存储器装置接收针对该命令的响应以及关于至少一个存储器组的状态数据，并且基于响应和状态数据来确定数据输入/输出操作已经成功还是已经失败。
检查非易失性存储器装置错误设备方法

[发明专利]具有嵌入式内联运算逻辑的非易失性存储器组-CN202010486577.3在审
发明人： M·安娜沙瑞 -专利权人：科洛斯巴股份有限公司
申请日： 2020-06-01 - 公布日： 2020-12-01 - 主分类号： G11C13/00 文献下载
摘要：本文公开了一种非易失性存储器装置，该非易失性存储器装置具有嵌入该非易失性存储器装置的存储器组中的处理逻辑。例如，用于控制处理逻辑的命令可以向主机装置公开，使得主机装置能够与存储器操作结合来启动存储器组的处理能力。在读取或写入由存储器操作识别的数据时，可以由通过主机装置传输的数据命令指示处理能力。读取数据可以在被输出到与存储器组连接的数据接口之前通过存储器组处理。同样，在存储器组接收到的写入数据可以与将写入数据存储在非易失性存储器装置中结合而被处理。因此，公开的存储器装置可以与向包括两端子非易失性存储器的各个存储器组的存储器装置读取或写入数据结合来实施内部处理。
具有嵌入式内联运算逻辑非易失性存储器

[发明专利]存储器控制器-CN201210473722.X有效
发明人：潘塔斯·苏塔迪嘉 -专利权人：马维尔国际贸易有限公司
申请日： 2008-04-10 - 公布日： 2013-03-27 - 主分类号： G06F12/02 文献下载
摘要：一种存储器控制器，包括类型确定模块，被配置为在所述存储器控制器操作期间，确定所述存储器控制器所连接的存储器的类型，其中，所述存储器包括包含多个页的存储器块，并且其中，每个页包括多个存储器单元；页配置模块，被配置为基于被确定为与所述存储器控制器连接的存储器的类型来生成存储器映射，其中，所述存储器映射针对存储器块中的每个页指定(i)用于存储数据的存储单元的数目以及(ii)用于存储开销的存储单元的数目，其中，所述多个页中的第一页中用于存储数据的存储单元的数目和用于存储开销的存储单元的数目被配置为与所述多个页中的第二页中用于存储数据的存储单元的数目和用于存储开销的存储单元的数目不同。
存储器控制器

[发明专利]针对存储器设备定制编程脉冲期间的电流幅度和持续时间-CN201910148338.4在审
发明人： K·班纳吉;L·刘;S·兰格恩 -专利权人：英特尔公司
申请日： 2019-02-28 - 公布日： 2019-10-11 - 主分类号： G11C7/12 文献下载
摘要：描述了用于存储器设备的技术。存储器设备可以包括存储器单元的阵列和存储器控制器。存储器控制器可以接收对存储器单元的阵列内的存储器单元进行编程的请求。存储器控制器可以基于存储器单元的存取极性、存储器单元的先前写入周期的数量以及存储器单元与存储器单元的阵列内的字线/位线解码器之间的电气距离来针对编程设定脉冲选择电流幅度和电流幅度的持续时间。存储器控制器可以响应于该请求而启动编程设定脉冲，以对存储器单元的阵列内的存储器单元进行编程。可以在编程设定脉冲期间施加所选择的电流幅度和所选择的电流幅度的持续时间。
存储器单元电流幅度存储器控制器编程存储器设备位线解码器编程脉冲电气距离脉冲期间脉冲选择时间描述写入周期脉冲字线存取施加响应

[发明专利]用于并发地存取多个存储器单元的系统及技术-CN201980083113.3在审
发明人： F·皮奥 -专利权人：美光科技公司
申请日： 2019-12-13 - 公布日： 2021-07-30 - 主分类号： G11C13/00 文献下载
摘要：提供用于并发地存取存储器图块的两个存储器单元的技术。存储器图块可包含使用行解码器及列解码器可寻址的多个自选存储器单元。存储器控制器可使用对所述存储器图块的第一自选存储器单元具有第一极性的第一脉冲来存取所述第一自选存储器单元。所述存储器控制器还可与存取所述第一自选存储器单元并发地使用具有与所述第一极性不同的第二极性的第二脉冲来存取所述存储器图块的第二自选存储器单元。所述存储器控制器可确定所述脉冲的特性以缓解对所述存储器图块的未选定自选存储器单元的干扰。
用于并发存取存储器单元系统技术

[发明专利]存储器储存装置及其存储器控制器与数据写入方法-CN201110455539.2有效
发明人：叶志刚 -专利权人：群联电子股份有限公司
申请日： 2011-12-30 - 公布日： 2013-07-03 - 主分类号： G06F12/02 文献下载
摘要：本发明公开了一种存储器储存装置及其存储器控制器与数据写入方法，其中存储器储存装置，包括连接器、可复写式非易失性存储器模组、第二暂存存储器以及具有第一暂存存储器的存储器控制器。存储器控制器用以接收写入指令与写入数据，并将写入数据暂存至第一暂存存储器。存储器控制器还将写入数据复制到第二暂存存储器中且根据写入指令将写入数据写入至可复写式非易失性存储器模组中。此外，存储器控制器还用以判断在执行此写入指令时是否发生程序错误，若发生程序错误，则从第二暂存存储器中读取写入数据，重新执行此写入指令。藉此，存储器储存装置的写入速度可有效地被提升。
存储器储存装置及其控制器数据写入方法

[发明专利]具有处于相同分级层级的易失性及非易失性存储器装置的存储器系统及方法-CN200780049323.8有效
发明人：迪安·A·克莱因 -专利权人：美光科技公司
申请日： 2007-12-07 - 公布日： 2009-11-04 - 主分类号： G11C11/00 文献下载
摘要：本发明揭示一种基于处理器的系统，其包含通过处理器总线耦合到核心逻辑的处理器。所述基于处理器的系统包含动态随机存取存储器(“DRAM”)存储器缓冲器控制器。所述DRAM存储器缓冲器控制器通过存储器总线耦合到处在距所述处理器相同分级层级的多个动态随机存取存储器(“DRAM”)模块及快闪存储器模块。所述DRAM模块中的每一者均包含通向所述存储器总线且通向多个动态随机存取存储器装置的存储器缓冲器。所述快闪存储器模块包含耦合到所述存储器总线且耦合到至少一个快闪存储器装置的快闪存储器缓冲器。所述快闪存储器缓冲器包含可操作以将DRAM存储器请求转换为快闪存储器请求的DRAM至快闪存储器转换器，所述快闪存储器请求接着被施加到所述快闪存储器装置。
具有处于相同分级层级易失性非易失性存储器装置存储器系统方法