[发明专利]半导体器件及制造半导体器件的方法在审
申请号: | 201810374912.3 | 申请日: | 2018-04-24 |
公开(公告)号: | CN108735759A | 公开(公告)日: | 2018-11-02 |
发明(设计)人: | 阿部真一郎 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H01L27/11563 | 分类号: | H01L27/11563;H01L27/11568 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 李辉 |
地址: | 日本*** | 国省代码: | 日本;JP |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 构成存储单元的栅极绝缘膜的最上层的绝缘膜包含氧化硅膜,并且是添加金属或金属氧化物的层。绝缘膜的形成步骤包括以下步骤:形成氧化硅膜;以及通过溅射工艺将金属或金属氧化物以原子或分子状态添加到氧化硅膜上。金属的氧化物的介电常数高于氧化硅的介电常数,并且金属氧化物的介电常数高于氧化硅的介电常数。高K添加层因此用作构成存储单元的栅极绝缘膜的绝缘膜,从而可以保持阈值电压的高饱和水平同时减小驱动电压(用于擦除或写入的施加电压),这带来存储单元的可靠性的提高。 | ||
搜索关键词: | 介电常数 存储单元 氧化硅膜 绝缘膜 金属或金属氧化物 半导体器件 栅极绝缘膜 氧化硅 金属氧化物 分子状态 驱动电压 施加电压 阈值电压 高饱和 添加层 最上层 氧化物 擦除 减小 溅射 写入 金属 制造 | ||
【主权项】:
1.一种半导体器件,包括:半导体衬底;以及非易失性存储器单元,被设置在所述半导体衬底的第一区域中,其中所述非易失性存储器单元包括:第一栅极电极,被设置在所述半导体衬底之上;以及第一绝缘膜,被形成在所述第一栅极电极与所述半导体衬底之间,并且在内部具有电荷存储部分;其中所述第一绝缘膜包括:第一膜,包括形成在所述半导体衬底之上的氧化硅膜;第二膜,包括形成在所述第一膜之上的氮化硅膜,并且所述第二膜用作所述电荷存储部分;以及第三膜,形成在所述第二膜之上并且包含氧化硅膜,其中所述第三膜包括:氧化硅膜,以及以原子或分子状态而被添加到所述氧化硅膜上的金属和金属氧化物之一,其中所述金属的氧化物具有比氧化硅的介电常数高的介电常数,并且其中所述金属氧化物具有比氧化硅的介电常数高的介电常数。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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