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- [发明专利]存储器控制单元-CN00800757.8无效
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近藤大辅;青木透
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松下电器产业株式会社
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2000-04-21
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2001-07-04
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G06F12/06
- 提供一种存储器控制单元,它阻止对SDRAM的同一存储单元的连续存取,以增大其处理速度。本发明的存储器控制单元(3)控制SDRAM(2),后者具有两个存储单元0、1,并能够以多存储单元模式连续存取,在多存储单元模式中通过对存储单元分别预充电,在存储单元之间无缝地交替改变至存储单元0、1的地址输入由通过存储器控制单元(3)对SDRAM(2)存取的块(4、5)提供的存储器地址被转换成这样的地址,即使得存储器地址被交替地输入到SDRAM(2)的存储单元。
- 存储器控制单元
- [发明专利]DMA系统-CN200810212396.0有效
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王松荣
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安辰电脑股份有限公司
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2008-09-08
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2010-03-17
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G06F13/28
- 一种DMA系统，包含有：一存储器单元；一存储器控制单元；一存储器总线；一中介控制单元，电性连接于该存储器总线，用以透过该存储器总线来接收该存储器的数据；以及多个DMA单元，各DMA单元主要具有一DMA控制器以及一数据进出单元，其中该DMA控制器电性连接于该中介控制单元以及该存储器控制单元，该数据进出单元电性连接于该DMA控制器以及该中介控制单元，通过该DMA控制器来控制该数据进出单元接收该中介控制单元所传出的数据。因此，可达到减少存储器总线的频宽负担以及加快数据传输的速度的功效。
- dma系统
- [发明专利]存储器装置-CN201910660657.3有效
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陈忱;司强
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上海兆芯集成电路有限公司
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2019-07-22
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2021-08-24
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G11C11/406
- 本发明提供一种存储器装置，该装置包括：存储器控制单元及写输出时钟装置。存储器控制单元用以提供写输入时钟及第一控制值。写输出时钟装置依据写输入时钟产生多个内部时钟，且依据存储器控制单元的控制，从该等内部时钟中选择目标内部时钟，再依据第一控制值加以延迟后，作为写输出时钟至存储器单元。存储器单元依据写输出时钟产生数据信号。存储器控制单元接收数据信号以判断写输出时钟是否符合存储器单元运作的时序需求。若判断为不符合时序需求，存储器控制单元改变第一控制值和/或改变所选择的目标内部时钟，进而改变写输出时钟。
- 存储器装置
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