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[发明专利]锁相环Ⅲ型数字鉴相器在低电平调谐环路的稳定工作方法-CN201310680691.X有效
发明人：李鹏展;殷治国;张天爵;纪彬;赵振鲁;雷钰;付晓亮;宋国芳 -专利权人：中国原子能科学研究院
申请日： 2013-12-12 - 公布日： 2014-04-02 - 主分类号： H03L7/085 文献下载
摘要：本发明涉及一种锁相环Ⅲ型数字鉴相器在低电平调谐环路的稳定工作方法,该方法通过在脉冲模式下对锁相环Ⅲ型数字鉴相器的输出结果进行甄别，选择大多数脉冲响应值为锁相环Ⅲ型数字鉴相器的相位工作区间，据此设置锁相环Ⅲ型数字鉴相器工作的初始状态，指定锁相环Ⅲ型数字鉴相器两路输入信号的其中一路作为参考信号源，从而限定锁相环Ⅲ型数字鉴相器的相位工作区间，将不满足该相位工作区间的输出电压值校正为选定的相位工作区间，消除工作状态的不确定性本发明实现了锁相环Ⅲ型数字鉴相器在低电平系统脉冲和连续模式调谐环路的稳定工作。
锁相环数字鉴相器电平调谐环路稳定工作方法

[发明专利]一种采样型鉴频鉴相器电路-CN202111331972.5在审
发明人：徐豪杰;高翔 -专利权人：浙江大学
申请日： 2021-11-11 - 公布日： 2022-03-04 - 主分类号： H03L7/091 文献下载
摘要：本发明公开一种采样型鉴频鉴相器电路，该电路包括鉴频器、采样型鉴相器、比较器、逻辑选择电路和信号交换器。本发明通过对采样型鉴相器进行改进实现了具有鉴频功能的采样型鉴频鉴相器。采用该结构的采样型鉴频鉴相锁相环具有更大的频率捕捉范围以及更好的鲁棒性。同时将本发明的采样型鉴频鉴相器电路应用于采样型锁相环中时，采样型锁相环不需要额外的频率锁定环路来实现锁相环频率锁定，同时避免了锁相环在锁定过程中由于锁频环路和锁相环之间的切换带来的环路扰动以及导致的环路锁定时间的增加当然该发明也可以使用在亚采样型锁相环中。
一种采样型鉴频鉴相器电路

[发明专利]频率校正电路及其频率校正方法-CN201010177968.3无效
发明人：冯向光;陶晶晶;顾奇龙 -专利权人：无锡辐导微电子有限公司
申请日： 2010-05-14 - 公布日： 2010-09-15 - 主分类号： H03L1/02 文献下载
摘要：本发明涉及一种时钟频率校正电路，其包括第一锁相环和第二锁相环，其中每一锁相环包括相互串联的鉴相器、积分器电荷泵、压控振荡器。参考频率输入鉴相器的其中一个输入端，第一锁相环的压控振荡器的输出经过第一分频器反馈给第一锁相环的鉴相器的输入端。第一锁相环的输出经过第二分频器输入第二锁相环的鉴相器的输入端，第二锁相环的压控振荡器的输出经过第三分频器反馈给第二锁相环的鉴相器的输入端，第二锁相环的输出经过第四分频器输出。使用一个双环路锁相环电路，通过改变锁相环的分频器的模改变输出频率的精度。输出频率的长期频率精度以及短期频率精度具有相同的精度，稳定性高；并且输出频率为占空比为50％的脉冲。
频率校正电路及其方法

[实用新型]一种多环锁相频率合成器-CN201320060340.4有效
发明人：梁亮;宰南平;王金花 -专利权人：北京经纬恒润科技有限公司
申请日： 2013-02-01 - 公布日： 2013-07-24 - 主分类号： H03L7/07 文献下载
摘要：本实用新型提供了一种多环锁相频率合成器，包括第一锁相环，第二锁相环和第三锁相环。第三锁相环包括：检测两输入信号的相位差，根据自身极性输出相应电压信号的鉴相器；与鉴相器相连，接收鉴相器输出信号的环路滤波器；与环路滤波器相连，接收环路滤波器输出信号的VCO；与VCO相连，接收VCO输出信号的耦合器；与耦合器相连，接收耦合器耦合端输出信号的分频器；与分频器和第二锁相环相连，接收分频器和第二锁相环的输出信号，输出混频后信号的混频器；与混频器，第一锁相环和鉴相器相连，接收混频器和第一锁相环的输出信号，输出信号给鉴相器的开关阵。本申请为公众提供了一种使得多环锁相频率合成器容易调试的通用实验平台。
一种多环锁相频率合成器

[发明专利]低信噪比下锁相环跟踪性能的改进方法和装置-CN201410032019.4有效
发明人：蒋伟;崔益霏;夏云;潘荣灿;夏海涛;龙秋朦;罗武 -专利权人：北京大学
申请日： 2014-01-23 - 公布日： 2014-04-30 - 主分类号： H03L7/085 文献下载
摘要：一种低信噪比下锁相环跟踪性能的改进装置，在锁相环的鉴相器后添加鉴相器系数修正装置，该修正装置将鉴相器的输出结果除以鉴相器系数，然后把做完除法之后得到的结果输出到环路滤波器。本发明通过对鉴相器的系数修正，改善了低信噪比下锁相环设计带宽部分失效的情况，使得锁相环的设计带宽即为实际有效的带宽，能够有效抵抗其能力范围内的多普勒效应影响。
低信噪下锁相环跟踪性能改进方法装置

[发明专利]防止扫频锁相环鉴相器输出溢出方法、装置及毫米波雷达-CN202310658015.6在审
发明人：邓伟;闫昂霄;贾海昆;池保勇 -专利权人：清华大学
申请日： 2023-06-05 - 公布日： 2023-09-08 - 主分类号： H03L7/089 文献下载
摘要：本发明提供一种防止扫频锁相环鉴相器输出溢出的方法、装置及毫米波雷达，涉及射频、毫米波集成电路技术领域，包括：将扫频锁相环鉴相器的量程划分为多个区域；获取扫频锁相环鉴相器在相邻周期的第一输出值、第二输出值；根据第一输出值、第二输出值，结合两个输出值各自对应的区域确定扫频锁相环鉴相器的输出是否溢出；在扫频锁相环鉴相器的输出溢出的情况下，将扫频锁相环鉴相器的输出置为0，并根据溢出的方向，修正计数器的计数值。本发明在发生溢出的周期内，不会有错误的频差输入到环路中，提高了扫频线性度，保证了环路状态的稳定，避免因为鉴相器溢出而导致扫频频差的恶化。同时具有实现成本低、鲁棒可靠的特点。
防止扫频锁相环鉴相器输出溢出方法装置毫米波雷达

[发明专利]一种抑制小数锁相环小数杂散的电路及方法-CN201410561889.0在审
发明人：范吉伟;刘亮;樊晓腾;刘青松;郑贤 -专利权人：中国电子科技集团公司第四十一研究所
申请日： 2014-10-13 - 公布日： 2015-01-28 - 主分类号： H03L7/08 文献下载
摘要：本发明提出了一种抑制小数锁相环小数杂散的电路，包括至少两级小数锁相环，前后两级小数锁相环通过分频器连接，前级小数锁相环的输出信号经过分频器分频后作为后级小数锁相环的参考输入信号；前级小数锁相环和后级小数锁相环采用相同结构，包括：压控振荡器的输出信号经过N.F分频器进行小数分频，分频后的信号与参考输入信号在鉴相器进行鉴相操作，鉴相器输出信号送入环路滤波器，环路滤波器产生压控振荡器的压控电压。本发明的电路及方法能直接改变小数杂散的频率，不受电路中鉴相器、分频器等非线性电路的影响，具有更好的杂散抑制效果；小数锁相环的小数杂散频率搬移到锁相环带宽之外，通过环路滤波器滤除，从而达到抑制小数杂散的目的
一种抑制小数锁相环电路方法

[发明专利]一种快速锁定的锁相环-CN201310013696.7有效
发明人：李宝骐 -专利权人：苏州磐启微电子有限公司
申请日： 2013-01-15 - 公布日： 2013-04-17 - 主分类号： H03L7/085 文献下载
摘要：本发明揭示了一种快速锁定的锁相环，包括顺次相连的鉴相器、电荷泵、环路滤波器和压控振荡器以及自输出端连至鉴相器的分频器。特别地，该锁相环设有一个初始相位翻转器，与鉴相器及分频器构成锁相环的数字信号部分，其中初始相位翻转器的输入连至分频器的输出及鉴相器的输出，且其反馈输出连至鉴相器的输入。籍此将传统的锁相环进行数字信号与模拟信号的区分，并对其中数字信号的电路部分引入相位翻转进行数字方式的相位调整，非但能够减小锁相环锁定时间，同时克服了产生输出相位噪声的不良局面。
一种快速锁定锁相环

[发明专利]延迟锁相环电路-CN200910197821.8无效
发明人：段新东 -专利权人：上海宏力半导体制造有限公司
申请日： 2009-10-28 - 公布日： 2010-04-21 - 主分类号： H03L7/085 文献下载
摘要：本发明公开一种延迟锁相环电路，该延迟锁相环电路包括鉴相电路、电荷泵以及压控延迟线，该鉴相电路包括一防错锁电路和一鉴相器，其通过将该防错锁电路输出端耦合至该鉴相器，通过该防错锁电路使该鉴相器在电路启动时延迟一个脉冲，解决了延迟锁相环电路在启动时鉴相器反馈输入信号延时小于0.5TCLK会出现错误锁定的问题。
延迟锁相环电路

[发明专利]锁相环控制电路及方法-CN201610212646.5有效
发明人：宋超;廖建军;黄超;张恒浩;刘洋;李永 -专利权人：中国电子科技集团公司第二十四研究所
申请日： 2016-04-05 - 公布日： 2019-01-22 - 主分类号： H03L7/099 文献下载
摘要：本发明提供一种锁相环控制电路及方法，该电路包括控制装置以及依次连接的鉴相器、滤波器和压控振荡器，控制装置用于分别检测输入至鉴相器的第一信号以及压控振荡器输出的第二信号的频率，并根据第一信号和第二信号的频率，控制使能所述鉴相器。本发明通过检测出锁相环电路输入信号和输出信号的频率，并根据输入信号和输出信号的频率，控制使能鉴相器，可以实现基于输入输出信号来控制锁相环电路工作，从而可以提高锁相环电路应对异常状况的能力，并提高锁相环电路的稳定性
锁相环控制电路方法

[发明专利]一种双环结构的载波跟踪方法-CN201911255544.1有效
发明人：吴彬彬;张黎;夏丽丽;刘菊田;冯素园 -专利权人：南京六九零二科技有限公司
申请日： 2019-12-10 - 公布日： 2021-10-08 - 主分类号： H04B7/185 文献下载
摘要：本发明公开了一种双环结构的载波跟踪方法，通过宽带锁相环和窄带锁相环协同工作，将宽带锁相环输出的频率跟踪信息经过修正之后补偿到窄带锁相环的输入信号，实现低信噪比高动态环境下的载波跟踪；通过MATLAB仿真和VIVADO仿真，对比不同环路参数下的三阶数字锁相环，仿真结果显示，双环结构鉴相器输出的标准方差为5.4度，环路带宽为1/50符号速率的普通三阶锁相环鉴相器输出的标准方差为8.1度，环路带宽为1/100符号速率的普通三阶锁相环鉴相器输出的标准方差为52.4度，已经不能锁定；结果表明在同样的高动态环境下和低信噪比条件下，双环结构能够有效的兼顾高动态和低信噪比，其性能远优于普通的数字三阶锁相环和二阶锁相环
一种结构载波跟踪方法

[发明专利]延迟锁相环、锁相方法、多相位时钟生成电路及电子设备-CN202010296546.1有效
发明人：孙昊鑫;梁利平;王志君;管武;洪钦智 -专利权人：中国科学院微电子研究所
申请日： 2020-04-15 - 公布日： 2022-11-11 - 主分类号： H03L7/08 文献下载
摘要：本发明公开一种延迟锁相环、锁相方法、多相位时钟生成电路及电子设备，涉及电路技术领域，通过相位合成电路的辅助来获得多个时钟相位不同的输出信号，降低延迟锁相环所具有的本征延时，从而提高延迟锁相环的工作频率和分辨率延迟锁相环包括延时线电路、相位合成电路、鉴相器和控制电路。相位合成电路根据延时线电路延时前后的信号输出相位不同的至少两个输出信号。控制电路还用于根据鉴相结果的跳变信息和鉴相结果确定处于工作状态时，更新向延时线电路提供的延时控制信号；根据鉴相结果的跳变信息确定处于锁定状态时，输出锁定信号；根据鉴相结果和延时控制信号确定处于失锁状态时本发明提供的延迟锁相环应用于电子设备中。
延迟锁相环方法多相时钟生成电路电子设备

[实用新型]锁相环-CN202221378096.1有效
发明人：尹项托;史跃文;程军强 -专利权人：中星联华科技（北京）有限公司
申请日： 2022-06-01 - 公布日： 2023-03-07 - 主分类号： H03L7/085 文献下载
摘要：本实用新型提供一种锁相环，涉及电子技术领域，包括：鉴相器、压控振荡器和加法器；鉴相器和压控振荡器通过加法器连接；加法器用于将接收到的目标高斯噪声与鉴相器输出的第一信号进行叠加，获得第二信号，并将第二信号输入至压控振荡器本实用新型提供的锁相环，能在保持锁相环的环路参数固定且不影响锁相环输出信号中固有的超低相位噪声的情况下，实现锁相环输出信号中的相位噪声可调，进而能实现对锁相环输出信号中的相位噪声对与锁相环输出端连接的器件的影响的验证
锁相环

[发明专利]电荷泵型时钟管理电路及其双核模数转换器-CN202211509041.4在审
发明人：马亮 -专利权人：合肥博雅半导体有限公司
申请日： 2022-11-29 - 公布日： 2023-03-28 - 主分类号： H03L7/07 文献下载
摘要：本发明涉及电荷泵型时钟管理电路及其双核模数转换器，时钟管理电路包括依次连接的脉冲产生电路、第一锁相环、第二锁相环和相位运算电路，第一锁相环和第二锁相环均包括依次连接的延时电路、鉴相器和电荷泵，电荷泵的输出端与延时电路的输入端连接，第一锁相环的延时电路的输入端与脉冲产生电路连接，第一锁相环的鉴相器的输出端分别与第二锁相环的延时电路和鉴相器的输入端连接。本发明通过改进电荷泵型锁相环的设计，构建两个闭环回路式型电荷泵锁相环，以及提高电荷泵的性能，以降低时钟管理电路的时钟抖动，提高模数转换器在宽电压下的性能。
电荷时钟管理电路及其双核模数转换器

[发明专利]一种适用于模拟锁相环的锁定检测电路-CN201810834220.2有效
发明人：张潭;周骏;王龙峰;山永启;姚评 -专利权人：四川知微传感技术有限公司
申请日： 2018-07-26 - 公布日： 2023-09-26 - 主分类号： H03L7/095 文献下载
摘要：本发明公开了一种适用于模拟锁相环的锁定检测电路，所述锁定检测电路包括：状态采样电路、状态扩展电路；锁相环鉴相器的输出信号VUP、锁相环鉴相器的输出信号VDN、锁相环的输入时钟信号Fin、锁相环的反馈时钟信号Fbck、使能信号EN接状态采样电路的输入；状态采样电路输出信号为XPL0、FDD信号，XPL0、FDD信号、使能信号EN接状态扩展电路的输入，PLOCK为锁相检测电路输出信号，PLOCK为高表示锁相环处于锁定状态，PLOCK为低表示锁相环处于失锁状态；解决了现有模拟锁相环系统的不足，实现了模拟锁相环状态检测电路简单，可靠性高，可移植性高，成本低。
一种适用于模拟锁相环锁定检测电路

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