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[发明专利]数字鉴相器-CN200310113985.0有效
发明人：洪治 -专利权人：华为技术有限公司
申请日： 2003-11-15 - 公布日： 2005-05-18 - 主分类号： H03L7/08 文献下载
摘要：本发明涉及数字电路中的时钟，公开了一种数字鉴相器，使得在相同频率的鉴相时钟下鉴相精度得到提高。这种数字鉴相器包含：延时模块，用于根据一个鉴相时钟信号产生多个不同相位的鉴相时钟信号；鉴相模块，用于对所述延时模块提供的所述多个不同相位的鉴相时钟信号分别进行鉴相计数，并保存总的鉴相计数值供外部使用。
数字鉴相器

[发明专利]一种鉴频鉴相器和采用该鉴频鉴相器的锁相环-CN02158590.3无效
发明人：吉利久;窦训金;陈中建;冯文楠;葛岩;贾嵩;刘飞;刘凌 -专利权人：北京大学
申请日： 2002-12-26 - 公布日： 2004-05-05 - 主分类号： H03L7/085 文献下载
摘要：本发明提供了一种双边鉴频鉴相器及采用该鉴频鉴相器的锁相环。双边鉴频鉴相器，包括上升边鉴频鉴相逻辑模块，还包括下降边鉴频鉴相逻辑模块，下降边鉴频鉴相逻辑模块与上升边鉴频鉴相逻辑模块并联，构成双边鉴频鉴相器上下半电路的鉴频鉴相逻辑模块一双边鉴频鉴相逻辑模块，双边鉴频鉴相逻辑模块输出端与输出逻辑模块相连，输出逻辑模块将上半电路双边鉴频鉴相逻辑模块和下半电路双边鉴频鉴相逻辑模块的输出脉冲信号进行逻辑操作，使得在输入信号的上升边和下降边都产生正比于两输入信号相差的up/dn信号。本发明的双边鉴频鉴相器鉴频鉴相速度快、增益高、减少相位误差累积、功耗小、电路结构简单，锁相环收敛速度快、稳态相差小、功耗小。
一种鉴频鉴相器采用锁相环

[实用新型]一种压控锁相电路-CN202123384814.4有效
发明人：不公告发明人 -专利权人：江苏屹信航天科技有限公司
申请日： 2021-12-29 - 公布日： 2022-07-26 - 主分类号： H03L7/099 文献下载
摘要：本实用新型公开了一种压控锁相电路，包括单片机、鉴相器和压控振荡器；单片机与鉴相器电连接，用于对鉴相器设置参数；鉴相器的射频输入端输入参考频率信号，鉴相输出端输出鉴相电压信号，鉴相电压信号经过滤波放大后输入至压控振荡器的压控输入端，压控振荡器的输出端输出目标频率信号，目标频率信号还与鉴相器的反馈端电连接。本实用新型通过鉴相器输入的参考频率信号产生鉴相电压信号，该鉴相电压信号驱动压控振荡器输出目标频率信号，该目标频率信号还反馈至鉴相器中，通过单片机对鉴相器进行调试，最终使压控振荡器输出的目标频率信号趋于稳定
一种压控锁相电路

[发明专利]一种基于延迟线的高精度相位调节系统及方法-CN202310307770.X在审
发明人：孙旭;王茂凌;张骏杨;尹茳;张恒;黄才兴;谢平;何定高 -专利权人：电信科学技术第五研究所有限公司
申请日： 2023-03-27 - 公布日： 2023-09-15 - 主分类号： H03L7/089 文献下载
摘要：本发明涉及一种基于延迟线的高精度相位调节系统及方法，它包括：本地原子钟、PLL锁相环、TDC鉴相器、FPGA鉴相器、鉴相处理器、延迟线调相模块和时钟输出电路；PPL锁相环对本地原子钟输出的时钟进行处理后为TDC鉴相器和FPGA鉴相器提供工作时钟；TDC鉴相器通过FPGA鉴相器输出分频时钟与输入的外部时钟进行鉴相，并将鉴相结果输出给所述鉴相处理器；鉴相处理器对采集到的鉴相值进行处理得到调相值，并对调相值进行分析判断进行粗调还是细调后输出
一种基于延迟线高精度相位调节系统方法

[发明专利]一种鉴相器、鉴相单元及延迟锁相环电路-CN202310801748.0在审
发明人：刘京京;吴锐煌;詹文 -专利权人：中山大学
申请日： 2023-06-30 - 公布日： 2023-10-10 - 主分类号： H03L7/085 文献下载
摘要：本发明公开了一种鉴相器、鉴相单元及延迟锁相环电路，包括电路结构相同的第一鉴相单元和第二鉴相单元；第一鉴相单元或第二鉴相单元由动态鉴相结构和下降沿延迟反相器组成。本发明采用下降沿延迟反相器对输入信号进行延迟，有效地延长了鉴相器输出脉冲的宽度，从而解决了鉴相死区的问题；同时本发明中鉴相器在参考信号以及反馈信号两个输入信号相位差较小时，输出的第一、第二脉冲在宽度以及高度上具有较大的差别，从而能够有效克服由于延迟锁相环电荷泵充放电电流不匹配导致的静态相位偏差问题；此外本发明鉴相器输出不会存在缓慢的脉冲，从而能够保证电荷泵开关被及时关闭，亦不会引入额外的泄露电流问题。本发明同时有效地解决了现有鉴相器存在鉴相死区以及静态相位偏差的问题，具有广阔的应用前景和市场需求。
一种鉴相器单元延迟锁相环电路

[发明专利]时钟鉴相装置和方法-CN200610065190.0有效
发明人：黄鸿贵 -专利权人：华为技术有限公司
申请日： 2006-03-27 - 公布日： 2006-11-08 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了一种时钟鉴相装置和方法，用于测量基准信号和被测信号之间的相位差；均需要得到能体现基准信号与被测信号之间相位差的待测相位信号，在待测相位信号相位宽度内累计所能容纳的鉴相时钟信号数量；并通过对持续的鉴相时钟信号进行对称积分，获取待测相位信号相位宽度内的数字量鉴相时钟信号积分结果，再得出获取该鉴相时钟信号积分结果时的鉴相时钟信号相位值；之后，根据得出的所述鉴相时钟信号相位值和累计的鉴相时钟信号数量，计算出待测相位信号的相位宽度本发明装置和方法均可明显提高时钟鉴相精度。
时钟装置方法

[发明专利]一种新型超导回旋加速器调谐系统-CN201711328826.0有效
发明人：宋云涛;陈根;彭振;赵燕平;陈永华;杨庆喜 -专利权人：合肥中科离子医学技术装备有限公司
申请日： 2017-12-13 - 公布日： 2019-12-10 - 主分类号： H05H7/16 文献下载
摘要：本发明公开了一种新型超导回旋加速器调谐系统，模拟IQ鉴相模块用于调制LO信号和RF信号相位差的正弦I和余弦Q，作为模拟IQ鉴相校准模块的输入信号；模拟IQ鉴相校准模块用于校准模拟IQ鉴相模块的测量误差，对模拟IQ鉴相模块实时检测，当模拟IQ鉴相模块校准完成，自动关闭，避免校准模块对模拟IQ鉴相结果的影响。本发明系统采用模拟信号处理系统与数字信号系统相结合的技术提高系统调谐精度和耐噪声性能，以及降低反馈系统因信号处理增加的延迟时间，调谐系统自身携带的模拟IQ鉴相校准模块，提高模拟IQ鉴相模块的自我调整能力和扩展了其适用范围
一种新型超导回旋加速器调谐系统

[发明专利]一种导航卫星时频完好性自主监测系统及方法-CN202010146896.X有效
发明人：李光;任前义;龚文斌;邵丰伟;沈苑;余志洋;沈冠浩;宋彬 -专利权人：中国科学院微小卫星创新研究院;上海微小卫星工程中心
申请日： 2020-03-05 - 公布日： 2021-12-14 - 主分类号： G01S19/20 文献下载
摘要：本发明公开一种导航卫星时频完好性自主监测系统及方法，包括高稳晶振，主钟10MHz鉴相模块，备钟10MHz鉴相模块，10.23MHz鉴相模块，以及健康判决及处理单元。通过主钟10MHz鉴相模块及备钟10MHz鉴相模块根据高稳晶振生成的信号，进行主钟及备钟产生的10MHz信号进行监测，通过10.23MHz鉴相模块根据备钟产生的10MHz信号，对基频处理机产生的10.23MHz信号进行监测，最终通过健康判决及处理单元根据所述主钟10MHz鉴相模块，所述备钟10MHz鉴相模块以及所述10.23MHz鉴相模块的监测结果，进行故障定位。
一种导航卫星完好自主监测系统方法

[发明专利]一种宽动态范围的快速时钟恢复实现方法及装置-CN202110655610.5在审
发明人：不公告发明人 -专利权人：珠海亿智电子科技有限公司
申请日： 2021-06-11 - 公布日： 2021-10-22 - 主分类号： H04L7/033 文献下载
摘要：本发明公开了一种宽动态范围的快速时钟恢复实现方法及装置，其包括鉴相单元，鉴相单元包括两个鉴相器和一个选择器，两个鉴相器的数据输入端均用于输入数据，两个鉴相器的时钟输入端用于时钟输入，两个鉴相器的相位输出端均分别输出相位误差信号至选择器，选择器实时选择正确的一个鉴相器作为相位误差选择信号输出结果。本发明采用了两个鉴相器，并根据鉴相单元的结果选择其中一个鉴相器作为输出，这种操作使得该鉴相器输出的相位误差信号具有一定的频率偏差信息，因而能够直接应用于各种传统的CDR架构，并且因为有较大的频率偏差容忍能力
一种动态范围快速时钟恢复实现方法装置

[发明专利]一种无参考时钟的时钟数据恢复电路-CN202010616919.9有效
发明人：王腾佳;徐豪杰;李浩明;李国儒 -专利权人：杭州城芯科技有限公司
申请日： 2020-07-01 - 公布日： 2020-12-11 - 主分类号： H03L7/08 文献下载
摘要：本发明涉及一种无参考时钟的时钟数据恢复（CDR）电路，所述电路的一个实施方式包括：第一鉴相器、第二鉴相器、鉴频器、译码器、电荷泵、二阶环路滤波器和正交压控振荡器；其中，第一鉴相器、第二鉴相器、鉴频器组成鉴频鉴相器，鉴频鉴相器、译码器、电荷泵、二阶环路滤波器和正交压控振荡器依次连接，正交压控振荡器向鉴频鉴相器进行反馈。该实施方式将电路的鉴频过程与鉴相过程完全分开从而使CDR电路具有更高的鲁棒性。
一种参考时钟数据恢复电路

[发明专利]一种基于双鉴相器的信号发生器及信号产生方法-CN201410342573.2在审
发明人：刘青松;樊晓腾;刘亮;范吉伟;何攀峰;周俊杰;王琨;周玉勇 -专利权人：中国电子科技集团公司第四十一研究所
申请日： 2014-07-14 - 公布日： 2014-10-29 - 主分类号： H03L7/18 文献下载
摘要：本发明提出了一种基于双鉴相器的信号发生器，包括：低噪声参考信号、鉴频鉴相器、双平衡二极管鉴相器、带宽控制电路、积分低通滤波器、宽带压控振荡器和反馈网络；所述宽带压控振荡器输出信号经过反馈网络送入鉴频鉴相器和双平衡二极管鉴相器，低噪声参考信号进入鉴频鉴相器和双平衡二极管鉴相器，鉴频鉴相器和双平衡二极管鉴相器输出的误差电压信号分别送入带宽控制电路，带宽控制电路的输出信号经过积分低通滤波器后送入宽带压控振荡器，使宽带压控振荡器锁定本发明使两个鉴相器各自发挥自己的优势而避开不足，实现的频率合成器既具有宽频带特性，又具有很低的相位噪声。
一种基于双鉴相器信号发生器信号产生方法

[发明专利]一种改进的相关干涉仪鉴相方法-CN201710456000.6有效
发明人：朱栋;张婷;王益乐;王远程;邵华;黄绍斌;王寿峰;赵春光 -专利权人：中国电子科技集团公司第二十八研究所
申请日： 2017-06-16 - 公布日： 2019-06-11 - 主分类号： G01S3/12 文献下载
摘要：本发明公开了一种改进的相关干涉仪鉴相方法，通过对辅助通道射频模块输出的中频信号进行90度移相，形成两路正交的中频信号后分别与参考通道的中频信号进行同时鉴相；两路鉴相结果经过模数转换以后进行象限解模糊，实现在四象限内的复数鉴相与传统的鉴相方法相比，本发明在时间上无需进行先后移相操作，实现方法简单，到达角测量时间大大缩短；采用专用鉴相电路，可获得更大的动态范围；鉴相以后再采样，可使用较低速率数模转换器进行数据采集，设备成本低；鉴相结果用电压幅值表示，且与通道间的相位差呈线性关系。
一种改进相关干涉仪方法

[发明专利]一种导航信号鉴相曲线的过零点偏移测量方法及设备-CN201810831870.1有效
发明人：刘禹圻;陈林;李杨;杨溢;潘虹臣 -专利权人：中国电子科技集团公司第二十九研究所
申请日： 2018-07-26 - 公布日： 2019-09-06 - 主分类号： G01S19/42 文献下载
摘要：本发明公开了一种导航信号鉴相曲线的过零点偏移测量方法，包括步骤：采集导航信号数据；计算采集信号鉴相曲线过零点偏移；计算参考信号鉴相曲线过零点偏移；计算相同相关器间隔下的采集信号鉴相曲线过零点偏移与参考信号鉴相曲线过零点偏移的差值，得到导航信号鉴相曲线的过零点偏移。通过扣除参考信号鉴相曲线过零点偏移，减小了分量间伪码、数据等对偏移量计算影响，获得的不同时间段采集信号的鉴相曲线过零点偏移一致性好，测量精度高，适用于导航载荷失真引起的鉴相曲线过零点计算和分析，为导航载荷的优化设计
鉴相曲线过零点偏移导航信号采集信号偏移测量计算参考信号测量精度高计算和分析偏移量计算快速评估一致性好优化设计有效手段时间段减小伪码失真采集测试交付扣除

[发明专利]一种用于全数字锁相环的低功耗鉴相器-CN201210311259.9有效
发明人：李巍;刘鹏飞;牛杨杨;李宁 -专利权人：复旦大学
申请日： 2012-08-28 - 公布日： 2014-03-12 - 主分类号： H03L7/08 文献下载
摘要：发明属微电子领域，涉及一种用于全数字锁相环的鉴相器；该鉴相器在保证鉴相器功能正确的前提下，能降低鉴相器的功耗。本发明对传统鉴相器进行了改进，其中累加型计数器的输出为各个参考时钟周期内原传统的计数器输出码值累加的结果，而不是单一的一个时钟周期之内的输出码值，因此累加型计数器可直接由DCO的输出信号驱动；交换了时间-数码转换器的输出在数字鉴相器中的运算顺序，使整个鉴相器的运算步骤减少，从而降低了鉴相器结构的功耗，并使电路结构更加简单，易于实现。本发明所述鉴相器适用于全数字锁相环的电路设计，具有重要的实用价值。
一种用于数字锁相环功耗鉴相器

[发明专利]PN码环辅助鉴相电路-CN201310400023.7有效
发明人：曾富华 -专利权人：中国电子科技集团公司第十研究所
申请日： 2013-09-05 - 公布日： 2013-12-18 - 主分类号： H04B1/7075 文献下载
摘要：本发明涉及一种PN码环辅助鉴相电路，旨在提供一种能够提高码环鉴相和环路相位捕获范围，提高码环对初始相位误差容忍能力的辅助鉴相电路。本发明通过下述技术方案予以实现：用两路分别依次串联相关器电路、积分清零滤波器电路和求绝对值电路共端相连一个减法器组成的PN码环鉴相电路和扩展PN码环鉴相电路，且PN码环鉴相电路和扩展PN码环鉴相电路中各自的两路相关器电路分别相连一个PN码环鉴相电路和扩展PN码环鉴相电路经加法电路得到误差电压输出。本发明相比现有技术的初始相位，捕获范围提高了3倍，可消除原有鉴相电路具有的在正负半码片范围内的相关副峰。
pn 辅助电路

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