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[发明专利]基于多核心联合仿真被验证设计的仿真验证平台-CN201810877425.9有效
发明人：郝严;冯文楠;周芝梅;冯曦;杨季;胡毅;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司
申请日： 2018-08-03 - 公布日： 2023-06-23 - 主分类号： G06F30/398 文献下载
摘要：本发明公开了一种基于多核心联合仿真被验证设计的仿真验证平台，包括具有以下结构中的至少一种结构：数字逻辑仿真工具和算法仿真工具分时联合仿真验证平台结构、数字逻辑仿真工具和算法仿真工具同时联合仿真验证平台结构、数字逻辑仿真工具和硬件原型平台联合仿真验证平台结构以及硬件原型平台作和算法仿真工具借助DSP联合仿真验证平台结构。本发明的基于多核心联合仿真被验证设计的仿真验证平台能够联合使用三类仿真验证工具，能够更好的提升定位问题的精准度、功能/算法的覆盖率、执行仿真的速度，大大提升了仿真效率。
基于多核联合仿真验证设计平台

[发明专利]SWP协议处理器-CN201910653347.9有效
发明人：潘金龙;冯曦;冯文楠;胡毅;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2019-07-19 - 公布日： 2022-09-13 - 主分类号： H04L69/00 文献下载
摘要：本发明公开了一种SWP协议处理器，包括：协议处理模块，对接收到的信号进行解调以及协议转换形成数据帧；帧解析模块，用于接收数据帧并对数据帧进行校验；FIFO，与帧解析模块相连接，该帧解析模块用于将校验结果正确的数据帧写入FIFO中；以及帧重组模块，分别与FIFO以及协议处理模块相连接，用于从FIFO中读出待发送的数据并对待发送的数据进行校验，根据校验结果对待发送的数据进行预设方式的填充以形成数据帧，并将数据帧发送至协议处理模块；其中，协议处理模块用于对数据帧进行协议转换以及调制，将调制后的信号进行发送。本发明提供的SWP协议处理器紧凑处理器的结构，减少面积占用，并且使得协议处理模块中各个处理进程间的代码可以复用，增加重用性。
swp 协议处理器

[发明专利]芯片IO布局的方法及装置、SOC芯片-CN202011299820.7有效
发明人：许可敬;甘杰;冯文楠;胡旭;唐晓柯;胡毅;李德建 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网江西省电力有限公司;国家电网有限公司
申请日： 2020-11-18 - 公布日： 2022-07-05 - 主分类号： G06F30/392 文献下载
摘要：本发明涉及芯片设计技术领域，提供一种芯片IO布局的方法及装置、SOC芯片。所述方法包括：根据输入文件确定芯片的尺寸和用于放置所述芯片的IO引脚的预留位置；从所述输入文件获取所述IO引脚的目录，将所述IO引脚的目录导入脚本程序；通过执行所述脚本程序将所述IO引脚的图形按所述目录中的顺序布局到所述预留位置。本发明通过从输入文件获取芯片的IO引脚的目录将其导入脚本程序，通过执行脚本程序将IO引脚的图形按顺序布局到芯片的预留位置，可快速实现芯片IO的版图布局，无需手动对IO排序摆放，节约时间，提高IO版图布局的效率。
芯片 io 布局方法装置 soc

[发明专利]用于快速唤醒芯片的电流偏置电路-CN202011163154.4有效
发明人：胡毅;唐晓柯;王于波;侯佳力;冯文楠;张帆 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-10-27 - 公布日： 2022-05-13 - 主分类号： G05F1/56 文献下载
摘要：本发明提供一种用于快速唤醒芯片的电流偏置电路，属于集成电路技术领域。所述电流偏置电路包括偏置电流产生电路、低精度偏置电流产生电路以及电流输出支路，还包括附加开关电路；所述附加开关电路设置于所述偏置电流产生电路与所述电流输出支路之间，用于在所述电流偏置电路由关断到开启的过程中瞬间拉低所述电流输出支路的工作点的电位，以快速打开所述电流输出支路输出所述偏置电流产生电路产生的偏置电流。本发明通过附加开关电路在电流偏置电路由关断到开启的过程中瞬间拉低电流输出支路的工作点的电位，从而快速打开电流输出支路将偏置电流输出，从而快速启动芯片中的各种关键电路以快速唤醒芯片，解决了芯片唤醒时间长的问题。
用于快速唤醒芯片电流偏置电路

[发明专利]用于芯片的基于基准源的加速启动电路-CN202011166014.2有效
发明人：赵东艳;胡毅;李德建;肖衍;马永旺;甘杰;李振国;冯文楠;尹芸婷;汪宇怀 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-10-27 - 公布日： 2022-02-01 - 主分类号： H03K17/04 文献下载
摘要：本发明涉及集成电路技术领域，提供一种用于芯片的基于基准源的加速启动电路，包括：启动电路、偏置电流产生电路、基准电压产生电路，还包括加速启动电路；所述加速启动电路设于偏置电流产生电路与基准电压产生电路之间，用于将偏置电流产生电路的上电过程与基准电压产生电路的上电过程相隔离，在偏置电流产生电路上电完成后开启基准电压产生电路的上电过程，以阻断在上电过程中偏置电流产生电路与基准电压产生电路之间的相互干扰。本发明一方面减小电路中参与充电的节点数，避免芯片中整体电路参与启动过程而拖慢启动时间；另一方面阻断上电过程中的过冲对基准电压产生电路的影响，极大的加速了芯片中整体电路的启动速度。
用于芯片基于基准加速启动电路

[发明专利]基于数据处理的模数转换装置的校准方法、装置及系统-CN202011212875.X有效
发明人：胡毅;唐晓柯;李振国;王亚彬;冯文楠;尹芸婷;汪宇怀 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-11-03 - 公布日： 2022-02-01 - 主分类号： H03M1/10 文献下载
摘要：本发明涉及集成电路技术领域，提供一种基于数据处理的模数转换装置的校准方法，所述模数转换装置为逐次逼近模数转换装置，该方法包括：步骤一：检测模数转换装置的输出信号，获得所述输出信号的DNL值；步骤二：判断所述DNL值是否满足预设条件；步骤三：若所述DNL值不满足所述预设条件，根据所述DNL值调整可调电容的电容值；其中，所述可调电容的一端与所述电容阵列连接，另一端接地；循环执行步骤一至步骤三，直至所述DNL值满足所述预设条件。本发明提供的技术方案，能够在不改变现有的电容阵列的布局的情况下对逐次逼近模数转换装置进行精确、有效地校准，从而提高逐次逼近模数转换装置在正常工作时输出信号的精度。
基于数据处理转换装置校准方法系统

[发明专利]基于基准源的电流温度系数控制电路-CN202011230892.6有效
发明人：唐晓柯;胡毅;赵东艳;李振国;冯文楠;汪宇怀 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-11-06 - 公布日： 2022-01-28 - 主分类号： G05F3/26 文献下载
摘要：本发明涉及集成电路技术领域，提供一种基于基准源的电流温度系数控制电路，包括：零温度系数电压生成模块，用于生成零温度系数电压；可调温度系数电流生成模块，包括第三电阻R3、第七PMOS管MP7以及第六PMOS管MP6，用于在所述零温度系数电压稳定的情况下，通过所述第七PMOS管MP7的正温度系数电流与所述第六PMOS管MP6的负温度系数电流之和，得到可调温度系数的参考电流，所述参考电流的可调温度系数通过调节施加有负温度系数电流的所述第三电阻R3的阻值得到。本发明实施例在保证基准源中零温度系数电压特性稳定的前提下，实现基准源中电流温度系数的调节。
基于基准电流温度系数控制电路

[发明专利]真随机数发生器-CN201910859035.3有效
发明人：魏子魁;胡毅;金鑫;李振国;冯曦;冯文楠;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2019-09-11 - 公布日： 2021-10-12 - 主分类号： G06F7/58 文献下载
摘要：本发明公开了一种真随机数发生器，该真随机数发生器包括低频时钟单元，所述低频时钟单元具有慢振荡器，该慢振荡器包括：跨阻放大器、迟滞比较器、电荷泵、跨导放大器、第一电容以及电压缓冲器。跨阻放大器包括：运算放大器、第一电阻、第二电阻、第三电阻以及第四电阻。该真随机数发生器的jitter值在低频时钟输出频率确定的情况下只与跨阻放大器的噪声电阻、噪声带宽、噪声电压增益这三个参数相关，在噪声电阻和噪声带宽在比较小的情况下，通过增大噪声电压增益得到比较大的噪声电压标准差，即可以设计出比较大的低频时钟jitter，增大随机数的性能，并且可以减少电路的功耗和面积。
随机数发生器

[发明专利]消除天线效应的方法-CN201910670602.0有效
发明人：张慧;胡旭;冯曦;冯文楠;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2019-07-24 - 公布日： 2021-04-23 - 主分类号： H01L27/02 文献下载
摘要：本发明公开了一种消除天线效应的方法，该消除天线效应的方法用于解决特定版图结构所引起的天线效应，所述特定版图结构由MOM电容和MOS管叠加而成，一个所述MOM电容与多个所述MOS管组成一个电容单元，所述MOM电容的正极与所述MOS管的栅极相连，并连接电源；所述MOM电容的负极与所述MOS管的源极以及漏极均相连，并与P型衬底相接触，所述消除天线效应的方法包括：获取天线效应安全范围内的所述电容单元的个数临界值N；将N个所述电容单元组成的阵列中的其中一个MOS管替换为反接的二极管。该消除天线效应的方法能够以最小的面积消耗为代价消除晶体管和金属电容叠加结构的芯片的天线效应。
消除天线效应方法

[发明专利]带隙基准电路-CN202011302615.1在审
发明人：赵东艳;胡毅;刘兴;唐晓柯;李振国;冯文楠;汪宇怀 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-11-19 - 公布日： 2021-04-02 - 主分类号： G05F3/26 文献下载
摘要：本发明提供一种带隙基准电路，属于集成电路技术领域。所述带隙基准电路包括：电源模块，与电源端相连接，用于输出电流信号；以及误差放大模块，包括运算放大器，与所述电源模块相连接，用于对所述电流信号进行补偿，以使得所述带隙基准电路输出第一参考源电压。通过本发明提供的技术方案，采用由运算放大器构成的误差放大模块对电信号进行补偿，可以得到高精度、低温漂的带隙基准电压，且带隙基准电路的结构简单，可以适用于纯模拟电路领域中。
基准电路

[发明专利]带隙基准电路-CN202011306895.3在审
发明人：王于波;胡毅;刘兴;唐晓柯;李振国;冯文楠;张帆 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网浙江省电力有限公司;国家电网有限公司
申请日： 2020-11-19 - 公布日： 2021-03-30 - 主分类号： G05F1/575 文献下载
摘要：本发明提供一种带隙基准电路，属于集成电路技术领域。所述带隙基准电路包括：电源模块，与电源端相连接，用于输出电流信号；以及误差放大模块，包括两级运算放大电路，与所述电源模块相连接，用于对所述电流信号进行补偿，以使得所述带隙基准电路输出第一参考源电压。通过上述技术方案，采用由两级运算放大电路构成的误差放大模块对电信号进行补偿，可以得到高精度、低温漂的带隙基准电压，且带隙基准电路的结构简单，还可以适用于纯模拟电路领域中。
基准电路

[发明专利]安全芯片的主动屏蔽层电路-CN201910670590.1有效
发明人：高雪莲;胡旭;赵奇;冯文楠;冯曦;胡毅;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2019-07-24 - 公布日： 2021-03-12 - 主分类号： G06F21/76 文献下载
摘要：本发明公开了一种安全芯片的主动屏蔽层电路，包括：金属屏蔽层，包括通过多个贯穿金属屏蔽层的过孔相连接的顶层金属线与次顶层金属线；输入检测电路，用于接收数字逻辑单元发送的检测信号，对检测信号进行放大处理，并将放大处理后的信号传输至次顶层金属线，次顶层金属线将接收到的信号传输至与次顶层金属线相连接的顶层金属线；输出检测电路，用于对顶层金属线传输的信号进行消除天线效应处理，并将处理后的信号传输至数字逻辑单元的输入接口；次顶层金属线覆盖安全芯片的敏感模块。本发明提供的安全芯片的主动屏蔽层电路，可以增加FIB探测难度，提高主动屏蔽层的抗攻击性。
安全芯片主动屏蔽电路

[发明专利]无源无线通信芯片验证平台、构建方法及芯片验证方法-CN202011290063.7有效
发明人：李萌;李德建;苏萌;郝燚;冯文楠;唐晓柯 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司
申请日： 2020-11-18 - 公布日： 2021-02-09 - 主分类号： G06F11/26 文献下载
摘要：本发明提供一种无源无线通信芯片验证平台、构建方法及芯片验证方法。所述无源无线通信芯片验证平台包括：序列单元，用于提供用于无源无线通信芯片验证的三层验证序列；验证顶层单元，用于建立测试接口与被测无源无线通信芯片之间的信号连接，并启动仿真验证；环境层单元，用于在启动仿真验证后向被测无源无线通信芯片发送目标验证序列，并进行响应结果比较计分，得到验证结果；测试接口，用于连接被测无源无线通信芯片。该验证平台结构简洁，运行效率高，可以有效提升无源无线通信芯片的验证质量和验证效率，序列单元提供的三层验证序列可以根据验证的不同芯片和不同环境进行组合调用，不需要重复编写状态进入部分，提高了验证序列编写的效率。
无源无线通信芯片验证平台构建方法

[发明专利]面向对象的芯片级端口互连电路及其端口互连方法-CN202010743200.1在审
发明人：付英春;邵瑾;赵东艳;王于波;冯文楠;徐平江 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2020-07-29 - 公布日： 2021-01-05 - 主分类号： G06F30/32 文献下载
摘要：本发明公开了一种面向对象的芯片级端口互连电路及其端口互连方法，其中，面向对象的芯片级端口互连电路包括：PAD模块，PAD模块用于实现芯片与外部电路的连接；CORE模块，CORE模块包括PINMUX单元、IOCTRL控制单元、CPU单元和多个IP核，其中，PINMUX单元分别与PAD模块和多个IP核连接，CPU单元用于对IOCTRL控制单元进行配置，以使IOCTRL控制单元通过PINMUX单元对PAD模块与各IP核的连接通路进行控制。该芯片级端口互连电路可快速、高质量地完成芯片研发过程中各类IP核端口之间的互连需求。
面向对象芯片级端口互连电路及其方法

[发明专利]分频电路-CN201910964645.X有效
发明人：张济;刘畅;冯曦;冯文楠;胡毅;唐晓柯;刘浩 -专利权人：北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国家电网有限公司
申请日： 2019-10-11 - 公布日： 2020-12-11 - 主分类号： G06F1/06 文献下载
摘要：本发明公开了一种分频电路，包括第一分频器以及第二分频器；第一分频器包括：第一累加器，在接收的时钟信号的每个上升沿来临时计数值加1，且在第一反馈信号的控制下清除第一累加器的计数值；第一比较器，比较第一累加器的计数值和第一分频信号，第一反馈信号为第一比较器的输出信号；第一异或门；第一触发器，第一触发器的输出为第二反馈信号，第一触发器的输出为第一分频器的输出信号div0_clock；第二分频器包括：第二累加器；第二比较器；第二异或门；第二触发器，输出为第二分频器的输出信号div1_clock；其中，div0_clock与div1_clock为相同时钟相位的信号。本发明提供的分频电路可以确保分频时钟先高周期后低周期，以避免不同分频比造成的时钟相位不一致的问题。
分频电路

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