|
钻瓜专利网为您找到相关结果 5982318个,建议您 升级VIP下载更多相关专利
- [发明专利]触发单元的设计方法-CN202210107336.2有效
-
宋卫权;陈向东
-
杭州士兰微电子股份有限公司
-
2022-01-28
-
2022-12-20
-
G06F30/33
- 该设计方法包括:在数字电路中分析时钟控制信号的信号延迟;根据时钟控制信号的信号延迟,在多个不同类型的时钟门控电路中选择时钟门控电路;以及将至少一个边沿触发器和选择的时钟门控电路组合成触发单元,其中,多个不同类型的时钟门控电路根据时钟控制信号启用或屏蔽第一时钟信号以产生第二时钟信号,边沿触发器在第二时钟信号的边沿传输数据。该触发单元的设计方法根据时钟控制信号的延迟条件,从多个不同类型的时钟门控电路选择时钟门控电路,不仅可以消除时钟门控电路产生的时钟信号的毛刺,而且可以减少时钟门控电路的逻辑元件数量和降低时钟门控电路的功耗
- 触发单元设计方法
- [发明专利]显示测试图形在线时钟更新方法-CN200910035219.4无效
-
杨晓伟;李晓华;张宇宁;雷威
-
东南大学
-
2009-09-15
-
2010-02-24
-
G06F1/08
- 显示测试图形在线时钟更新方法是一种适用于多种显示器显示测试图形的自动控制时钟更新方法。该更新方法是由上位机PC控制流程1、下位机USB模块、FPGA主控、时钟模块运行流程2组成。上位机控制通道选择、时钟设定、时钟计算、误差判断、方案选择、数据传输、数据校验;下位机运行接收上位机时钟数据、以I2C总线时序向时钟芯片写入时钟数据,以I2C总线时序从时钟芯片读出时钟数据,向上位机发送时钟数据以校验数据传输的正确性。在上位机界面的控制下,三个时钟信号通道CLK_A、CLK_B、CLK_C输出不同或相同频率的更新时钟信号。
- 显示测试图形在线时钟更新方法
- [发明专利]延迟锁定回路电路-CN200610107595.6无效
-
崔勋
-
海力士半导体有限公司
-
2006-07-26
-
2007-04-04
-
G11C7/10
- 本发明提供一种具有正常模式及省电模式的同步存储器器件,其包括省电模式控制器,用于响应于时钟使能信号而产生省电模式控制信号,进而确定省电模式的起始或终止。时钟缓冲单元响应于该省电模式控制信号而缓冲外部时钟信号,且输出第一内部时钟信号及第二内部时钟信号。时钟选择单元基于该省电模式控制信号而选择该第一内部时钟信号及该第二内部时钟信号中的一个,以将选定信号作为中间输出时钟信号予以输出。相位更新单元通过使用该中间输出时钟信号而执行相位更新操作,以输出延迟锁定回路(DLL)时钟信号,该第一内部时钟信号的频率不同于该第二内部时钟信号的频率。
- 延迟锁定回路电路
- [发明专利]时钟产生电路、收发器以及时钟产生方法-CN200910179279.3有效
-
颜敬贤
-
慧荣科技股份有限公司
-
2009-09-25
-
2011-04-27
-
H03K3/02
- 本发明涉及一种时钟产生电路,包含有:一相位侦测器用来侦测一输入时钟与一参考时钟的一相位差以产生一控制信号;一滤波器耦接于该相位侦测器,用来对该控制信号进行滤波操作以产生一滤波控制信号;一可控制振荡器耦接于该滤波器,用来依据该滤波控制信号来产生多个输出时钟;一相位选择器耦接于该可控制振荡器,用来依据一相位选择信号来从该多个输出时钟中选取一输出时钟来做为一延授时钟;以及一延授电路耦接于该相位侦测器与该相位选择器,用来依据该延授时钟产生该输入时钟本发明还涉及一种收发器以及时钟产生方法。本发明通过控制一相位选择器来选择多个输出时钟中之一作为一延授时钟以合成一精确同步于一数据信号的输出时钟,节省了成本。
- 时钟产生电路收发以及方法
- [实用新型]一种信号发生器-CN201521010558.4有效
-
孙敏;宋烨曦;杨光
-
四川九洲电器集团有限责任公司
-
2015-12-08
-
2016-04-20
-
H03L7/16
- 本申请公开了一种信号发生器,包括:控制单元;时钟信号发生器,与所述控制单元相连,其中,所述控制单元控制所述时钟信号发生器产生第一时钟信号;频率合成器,与所述控制单元及所述时钟信号发生器相连,其中,所述时钟信号发生器将所述第一时钟信号发送至所述频率合成器,所述频率合成器基于所述第一时钟信号,生成第一信号以及第二时钟信号,所述第一时钟信号为所述频率合成器的时钟信号,所述第二时钟信号为所述控制单元的时钟信号,所述频率合成器将所述第二时钟信号发送至所述控制单元
- 一种信号发生器
|