专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]多数字号码的加密、解密方法以及加密、解密服务器-CN201711344638.7有效
  • 黄荣存;梁汉泉;杨辉 - 卫盈联信息技术(深圳)有限公司
  • 2017-12-15 - 2019-05-17 - H04L9/06
  • 本发明涉及一种多数字号码的加密、解密方法以及加密、解密服务器,该加密方法包括:在接收到预设类型的待加密多数字号码后,根据预先确定的加密数字确定规则,确定第一预设位数待加密号码段,以及除所述待加密号码段以外的非加密号码段;使用该待加密多数字号码对应的预先定义的加密密码学算法和密钥,对确定的非加密号码段进行运算处理生成运算值;采用预先确定的加密混合运算算法对所述待加密号码段和生成的运算值进行加密混合运算,得到第一预设位数的混合加密号码段;在所述预设类型的待加密多数字号码中将所述待加密号码段替换为所述混合加密号码段,生成加密后的多数字号码。本发明提升对多数字号码保护的安全性。
  • 多数号码加密解密方法以及服务器
  • [发明专利]一种定点加法结果位宽限制的处理方法和装置-CN201611258279.9有效
  • 周沈刚;李任伟 - 青岛专用集成电路设计工程技术研究中心
  • 2016-12-30 - 2019-05-17 - G06F7/50
  • 本发明公开了一种定点加法结果位宽限制的处理方法和装置,基于加法器输入操作数的高位部分获得上溢预判值和下溢预判值,基于运算结果中次高位向最高位的进位,获得运算结果是否超出加法器输入宽的溢出判断和运算结果的符号判断;结合上溢预判值、下溢预判值、溢出判断、符号判断和加法器运算结果判断运算结果是否上溢出或下溢出。这种采用在加法器运算结果获得之前对运算结果进行预判,并在加法器运算结果得到之后的约一级门延时后,基于预判结果和运算结果能够立刻判断出是否需要进行饱和运算的处理方法,相比于现有技术中得到运算结果后再判断是否需要对运算结果进行饱和处理的处理方式,提升了加法器限制宽操作的处理速度。
  • 一种定点加法结果宽限处理方法装置
  • [实用新型]运算纸牌及其包装盒-CN95206571.1无效
  • 任洪福 - 任洪福
  • 1995-03-31 - 1996-12-25 - G09B19/22
  • 运算纸牌及其包装盒由纸牌、运算底模和包装盒组成,纸牌包括表示1至16的十六个自然数的数字牌和表示加、减、乘、除四种运算符号的符号牌,运算底模中设有五个方框,方框依次为一号、符号、二号、等号、得数位,包装盒中设有五个空格,运算纸牌可用来进行数字游戏,是一种寓教于乐的教学娱乐工具,其趣味性强,长期游戏可提高心算能力。
  • 运算纸牌及其包装
  • [发明专利]一种通用多进制编码加法器的运算方法-CN200510037656.1无效
  • 周晓忠 - 周晓忠
  • 2005-01-05 - 2005-07-20 - G06F7/50
  • 一种通用多进制编码加法器的运算方法,在给定运算进制β、权值上数元的编码字长以及对应的数元编码表之后,针对每个权值分别构建专用一加法的运算码表A和进位传递标志Fi及本权值运算结果Si运算码表B或C;然后利用运算码表A读出“同位相加”的结果,再进行进位传递,最后利用运算码表B或C直接读出加运算的最终结果。本发明的运算过程由二至三次存储器的读取过程和一次进位信号的传递过程构成,其特点是:1.采用同一加法器硬件,可以实现不同进制的加法运算;2.运算速度高且可靠,运算步骤简单,可以利用这一特点设计出并行通用多进制编码加法器;3.使得电路结构简单化、单元化,最大限度的提高运算速度和运算的可靠性,降低制造、维修成本。
  • 一种通用多进制编码加法器运算方法
  • [发明专利]用于存储器阵列数据结构正数运算的设备、系统及方法-CN202010190596.1在审
  • V·S·拉梅什 - 美光科技公司
  • 2020-03-18 - 2020-09-29 - G11C7/10
  • 本发明涉及用于存储器阵列数据结构正数运算的设备、系统及方法。通用数字unum串,例如正数位串操作数及表示使用所述正数位串操作数执行的算术运算及/或逻辑运算的结果的正数位串,可经存储在存储器阵列中。部署在存储器装置中的电路可存取所述存储器阵列以从所述存储器阵列检索所述unum串操作数及/或使用所述unum串操作数执行的所述算术运算及/或所述逻辑运算的所述结果。例如,可使用存储在所述存储器阵列中的第一unum串及存储在所述存储器阵列中的第二unum串执行算术运算及/或逻辑运算。所述算术运算及/或所述逻辑运算的所述结果可经存储在所述存储器阵列中且随后进行检索。
  • 用于存储器阵列数据结构正数运算设备系统方法
  • [发明专利]一种运算电路及操作方法-CN201711358553.4有效
  • 李祎;王卓睿;缪向水;周亚雄;程龙 - 华中科技大学
  • 2017-12-17 - 2020-12-08 - H03K19/173
  • 本发明公开了一种运算电路及操作方法,计算阵列包括:1T1R阵列以及外围电路;1T1R阵列用于实现运算并存储运算结果,外围电路用于传输数据及控制信号,从而控制1T1R阵列的运算及存储过程;运算电路分别用于实现一全加器、多位逐进位加法器及其优化设计、二数据选择器、多位进位选择加法器以及多位pre‑calculation加法器;运算电路对应的操作方法分别通过控制1T1R器件初始化的电阻状态、字线输入信号、位线输入信号以及源线输入信号完成相应的运算及存储过程本发明实现了计算存储的融合,降低了集成电路的复杂性,可实现16种基本的布尔逻辑运算以及多种复杂运算
  • 一种运算电路操作方法
  • [发明专利]同一调频信号的重复多路信号的调制方法及其装置-CN201310670467.2有效
  • 梁富林;龙平;殷英;李忆 - 北京北广科技股份有限公司
  • 2013-12-07 - 2018-04-03 - H04L27/12
  • 本发明提出一种同一调频信号的重复多路信号的调制装置,包括模数转换器、调制器、第一相累加器、第二相累加器、第一cordic运算器、第二cordic运算器、数字除法器、数字乘法器、数模转换器;其中,该模数转换器进行模数转换,调制器、第一相累加器及第二相累加器连接,并将转换得到的数字信号传送至调制器、第一相累加器及第二相累加器;该第一cordic运算第一相累加器、数字除法器连接,同时,该第二cordic运算第二相累加器、数字除法器连接;该数字乘法器调制器、数字除法器连接,该数模转换器数字乘法器连接,并进行数模转换。
  • 同一调频信号重复调制方法及其装置

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