[发明专利]等离子体刻蚀方法及等离子体刻蚀后处理方法在审
申请号: | 201810317249.3 | 申请日: | 2018-04-10 |
公开(公告)号: | CN108493104A | 公开(公告)日: | 2018-09-04 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 睿力集成电路有限公司 |
主分类号: | H01L21/311 | 分类号: | H01L21/311;H01L21/3213 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 余明伟 |
地址: | 230000 安徽省合肥市*** | 国省代码: | 安徽;34 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提供等离子体刻蚀方法及等离子体刻蚀后处理方法,包括如下步骤:1)提供一待刻蚀目标材料层;2)于待刻蚀目标材料层的表面形成图形化掩膜层;3)依据图形化掩膜层对待刻蚀目标材料层进行干法刻蚀,以在待刻蚀目标材料层内形成凹槽,凹槽的内表面形成有第一损伤层;4)使用第一处理气体对第一损伤层进行第一次刻蚀后处理,第一次刻蚀后处理后凹槽的内表面形成有第二损伤层;5)使用第二处理气体对第二损伤层进行第二次刻蚀后处理,第二次刻蚀后处理后凹槽的内表面残留有第二损伤层残留层。本发明可以防止形成的半导体元器件的电器性能不良及物理性能不良,进而确保半导体元器件的可靠性。 | ||
搜索关键词: | 刻蚀 后处理 损伤层 等离子体刻蚀 目标材料层 内表面 半导体元器件 处理气体 后凹槽 表面形成图形 图形化掩膜层 电器性能 干法刻蚀 物理性能 残留层 掩膜层 残留 | ||
【主权项】:
1.一种等离子刻蚀方法,其特征在于,所述方法包括如下步骤:1)提供一待刻蚀目标材料层;2)于所述待刻蚀目标材料层的表面形成图形化掩膜层,所述图形化掩膜层包括若干个暴露出所述待刻蚀目标材料层的开口;3)依据所述图形化掩膜层对所述待刻蚀目标材料层进行干法刻蚀,以在所述待刻蚀目标材料层内形成凹槽,所述凹槽的内表面形成有第一损伤层;4)使用第一处理气体对所述第一损伤层进行第一次刻蚀后处理,以去除所述第一损伤层,并且所述第一次刻蚀后处理后所述凹槽的内表面形成有第二损伤层,所述第二损伤层的组分不同于所述第一损伤层;5)使用第二处理气体对所述第二损伤层进行第二次刻蚀后处理,以去除所述第二损伤层,当所述第二次刻蚀后处理后所述凹槽的内表面残留有第二损伤层残留层,所述第二损伤层残留层的组分相同于所述第二损伤层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造