[发明专利]使用双重图案化的自对准纳米线的形成有效
申请号: | 201410808255.0 | 申请日: | 2014-12-22 |
公开(公告)号: | CN105140100B | 公开(公告)日: | 2018-07-20 |
发明(设计)人: | 傅劲逢;陈德芳;严佑展;李佳颖;李俊鸿;林焕哲 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L21/308 | 分类号: | H01L21/308;H01L29/78;H01L21/8234;H01L21/306;H01L29/06;H01L23/528;H01L21/311;H01L27/088;H01L21/36;H01L29/786;H01L29/423 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | 本发明涉及一种方法,包括在半导体衬底上方形成图案预留层。该半导体衬底具有主表面。执行第一自对准多重图案化工艺以图案化图案预留层。该图案预留层的剩余部分包括在平行于半导体衬底的主表面的第一方向上延伸的图案预留带。执行第二自对准多重图案化工艺以在平行于半导体衬底的主表面的第二方向上图案化图案预留层。图案预留层的剩余部分包括图案化的部件。图案化的部件用作蚀刻掩模以通过蚀刻半导体衬底来形成半导体纳米线。本发明还提供了利用上述方法形成的集成电路结构。 | ||
搜索关键词: | 使用 双重 图案 对准 纳米 形成 | ||
【主权项】:
1.一种用于形成集成电路结构的方法,包括:在半导体衬底上方形成图案预留层,其中,所述半导体衬底包括主表面;执行第一自对准多重图案化工艺以图案化所述图案预留层,其中,所述图案预留层的剩余部分包括在平行于所述半导体衬底的主表面的第一方向上延伸的图案预留带;执行第二自对准多重图案化工艺以在平行于所述半导体衬底的主表面的第二方向上图案化所述图案预留层,其中,所述图案预留层的剩余部分包括图案化的部件;以及使用所述图案化的部件作为蚀刻掩模以通过蚀刻所述半导体衬底来形成半导体纳米线;其中,所述第一自对准多重图案化工艺和所述第二自对准多重图案化工艺均包括:形成芯轴层;蚀刻所述芯轴层以形成芯轴带,其中,所述第一自对准多重图案化工艺的所述芯轴带具有在所述第一方向上的纵向方向;在所述芯轴层上方形成间隔件层;去除所述间隔件层的水平部分,其中,所述芯轴层的垂直部分形成间隔件;去除所述芯轴带;以及使用所述芯轴带作为蚀刻掩模来蚀刻所述图案预留层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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