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[发明专利]指令翻译方法及装置、存储介质和终端-CN202310686324.4在审
发明人： 苟鹏飞 -专利权人：北京市合芯数字科技有限公司;合芯科技有限公司
申请日： 2023-06-09 - 公布日： 2023-09-29 - 主分类号： G06F9/30 文献下载
摘要：本发明公开了一种指令翻译方法及装置、存储介质和终端，其中方法包括基于待翻译程序的程序信息将待翻译程序拆分为多个代码段，再将每段代码段拆分为多个基本指令，并获取每段代码段的原始起始地址信息；对每段代码段中所有基本指令依次进行转化操作，获取每段代码段所对应的原子操作指令，并基于每段代码段的原始起始地址信息获取每段代码段的中间起始地址信息；对每段代码段中所有原子操作指令依次进行合并，并基于预设放置规则将每段代码段所对应的新基本指令放置于预设格式指令字中，获取每段代码段的新起始地址信息；本发明实现了老版本软件到新版本软件的指令直接转化，不会消耗CPU运算资源，大大提高CPU兼容性，解决软件兼容性问题。
指令翻译方法装置存储介质终端

[发明专利]一种优化三级缓存访问延迟的多核处理器调度方法及装置-CN202310878869.5在审
发明人：刘丹;苟鹏飞 -专利权人：合芯科技有限公司;北京市合芯数字科技有限公司
申请日： 2023-07-17 - 公布日： 2023-09-08 - 主分类号： G06F9/50 文献下载
摘要：本申请属于处理器技术领域，公开了一种优化三级缓存访问延迟的多核处理器调度方法及装置；该方法包括：构建各三级缓存块与各处理器核的跳步距离排序表；构建各三级缓存块与内存地址的映射关系配置表；获取新任务和候选处理器核队列；根据新任务的访问地址和候选处理器核队列查询跳步距离排序表和映射关系配置表，得到目标处理器核；将新任务分配到目标处理器核。本申请能够降低各个处理器核对三级缓存的访问延迟。
一种优化三级缓存访问延迟多核处理器调度方法装置

[发明专利]一种低延迟处理缓存读取请求的方法、设备及存储介质-CN202310545923.4在审
发明人：施葹;刘扬帆;陆泳;苟鹏飞;徐越;王贺 -专利权人：合芯科技有限公司;上海合芯数字科技有限公司
申请日： 2023-05-15 - 公布日： 2023-09-08 - 主分类号： G06F13/16 文献下载
摘要：本申请属于计算机技术领域，公开了一种低延迟处理缓存读取请求的方法、设备及存储介质，该方法包括：在检测到读取队列旁路空闲时，向处理器核发送旁路空闲信号；接收处理器核发送的读取请求；判断处理器核是否申请占用读取队列旁路；若是，则将读取请求通过读取队列旁路发送到缓存流水线，否则将读取请求发送至读取队列中。本申请能够当正在处理的读取请求数量较少时，省去读取队列仲裁请求的时间，实现了在不增加逻辑级数的情况下降低缓存处理读取请求的延迟。
一种延迟处理缓存读取请求方法设备存储介质

[发明专利]一种提升缓存带宽的方法、装置、设备及存储介质-CN202310587200.0在审
发明人：施葹;刘扬帆;徐越;苟鹏飞;陆泳;王贺 -专利权人：合芯科技有限公司;上海合芯数字科技有限公司
申请日： 2023-05-23 - 公布日： 2023-09-05 - 主分类号： G06F12/0831 文献下载
摘要：本申请属于缓存技术领域，公开了一种提升缓存带宽的方法、装置、设备及存储介质，该方法应用于缓存微结构中，该方法包括：步骤S1，接收新请求，并获取新请求的命中情况；步骤S2，基于命中情况和新请求确定执行条件；步骤S3，将新请求与缓存微结构中的旧请求进行地址对比，得到对比结果；若对比结果满足执行条件，则执行新请求。本申请可以提高缓存的并行处理能力，使得每个请求从进入缓存到被分发到并行处理状态机中执行的延时更小、单位时间内工作的并行处理状态机的个数更多，从而提升缓存整体的带宽和吞吐量。
一种提升缓存带宽方法装置设备存储介质

[发明专利]一种覆盖率标记文件更新方法、装置、设备及存储介质-CN202310525400.3在审
发明人：陆泳;施葹;苟鹏飞;刘扬帆;徐越;王贺 -专利权人：合芯科技有限公司;北京市合芯数字科技有限公司
申请日： 2023-05-10 - 公布日： 2023-09-05 - 主分类号： G06F11/36 文献下载
摘要：本申请属于软件测试技术领域，公开了一种覆盖率标记文件更新方法、装置、设备及存储介质，该方法包括：步骤S1，获取原始程序文件对应的原始覆盖率标记文件中的一个覆盖项；步骤S2，根据新程序文件对覆盖项进行更新；步骤S3，对原始覆盖率标记文件重复执行步骤S1‑S2，直至遍历完原始覆盖率标记文件中的所有覆盖项，得到新程序文件对应的目标覆盖率标记文件。本申请可以达到减少设计或验证人员的重复操作、提升代码覆盖率迭代频率和迭代效率，从而间接提升芯片的功能鲁棒性的效果。
一种覆盖率标记文件更新方法装置设备存储介质

[发明专利]一种硬件描述语言语义转换方法及装置-CN202310440474.7在审
发明人： 苟鹏飞;施葹;刘扬帆;陆泳;徐越 -专利权人：合芯科技有限公司
申请日： 2023-04-21 - 公布日： 2023-08-29 - 主分类号： G06F8/41 文献下载
摘要：本申请属于软件处理技术领域，公开了一种硬件描述语言语义转换方法及装置，该方法包括：获取第一程序文件，并对其中的第一程序进行逐行识别；将识别到的第一程序转换为第二程序；当第一程序为VHDL程序时，第二程序为systemverilog程序；当第一程序为systemverilog程序时，第二程序为VHDL程序；基于转换得到的第二程序生成第二程序文件。本申请可以实现从VHDL程序到systemverilog程序的快速转换，无需人工手动翻译，避免了人工重复输入的操作，节省人力与时间，减少了数字逻辑后续的验证、综合实现的风险，提高了VHDL程序与systemverilog程序之间转换的效率和正确率。
一种硬件描述语言语义转换方法装置

[发明专利]一种缓存替换控制方法及装置-CN202310721710.2在审
发明人：施葹;苟鹏飞;刘扬帆;陆泳;沈秀红;徐越;王贺 -专利权人：合芯科技有限公司;上海合芯数字科技有限公司
申请日： 2023-06-16 - 公布日： 2023-08-25 - 主分类号： G06F12/12 文献下载
摘要：本申请属于缓存技术领域，公开了一种缓存替换控制方法及装置；该方法包括：步骤S1，接收缓存替换请求，并获取寄存器信息；步骤S2，基于缓存替换请求和寄存器信息运行若干个缓存替换模式，得到若干个替换结果；步骤S3，若替换结果的数量大于预设数值，则根据预设的模式优先级对各替换结果进行覆盖，得到目标替换结果。本申请能够提高缓存替换控制单元中产生的缓存替换结果的可靠性。
一种缓存替换控制方法装置

[发明专利]一种处理器核外缓存模型及模拟方法-CN202310602633.9在审
发明人：施葹;苟鹏飞;刘扬帆;王贺;徐越;陆泳 -专利权人：合芯科技有限公司;合芯科技（苏州）有限公司
申请日： 2023-05-25 - 公布日： 2023-08-22 - 主分类号： G06F12/0877 文献下载
摘要：本申请属于处理器技术领域，公开了一种处理器核外缓存模型及模拟方法，该模型包括：请求接口模块，用于将读取请求和写入请求分别转换为读取事件和写入事件以及根据模式配置信息修改请求接口时序；数据缓存模块，用于将读取数据发送给读取处理模块以及根据模式配置信息修改数据缓存模块的容量；读取处理模块，用于基于模式配置信息和命中检测模块的读取命中结果获取读取数据；写入处理模块，用于基于模式配置信息和写入命中结果，根据写入事件或写入数据更新数据缓存模块；总线请求处理模块，用于获取读取数据和写入数据和根据模式配置信息修改总线接口时序。本申请可通用于多种缓存的应用场景，减少对多个缓存模型的维护和移植难度。
一种处理器缓存模型模拟方法

[发明专利]一种硬件描述语言增量编译方法及装置-CN202310620173.2在审
发明人：徐越;施葹;陆泳;刘扬帆;苟鹏飞 -专利权人：合芯科技有限公司;上海合芯数字科技有限公司
申请日： 2023-05-29 - 公布日： 2023-08-22 - 主分类号： G06F8/41 文献下载
摘要：本申请属于计算机技术领域，公开了一种硬件描述语言增量编译方法及装置，该方法包括：步骤S1，接收用户输入代码，将用户输入代码分别与热点代码区块和新代码区块进行对比，得到对比结果和用户输入代码中的无匹配部分；步骤S2，根据对比结果将新代码区块中的无修改部分移入热点代码区块中，将无匹配部分和热点代码区块中的修改部分移入新代码区块中；步骤S3，对新代码区块重新编译，得到增量数据库并将其合并到当前数据库。本申请能够大大减少了编译的迭代次数和仿真所需的时间，缩短模块的开发时间。
一种硬件描述语言增量编译方法装置

[实用新型]一种SVG串联功率模块及SVG设备-CN202320059104.4有效
发明人：丁国军;彭国平;史奔;张进;段博;朱依鹏;苟鹏飞;李德胜 -专利权人：广东安朴电力技术有限公司
申请日： 2023-01-04 - 公布日： 2023-08-22 - 主分类号： H02J3/18 文献下载
摘要：本实用新型公开了一种SVG串联功率模块及SVG设备，包括框体、第一IGBT组件和第二IGBT组件以及控制板，框体设有容置腔，第一IGBT组件和第二IGBT组件串联连接形成双H桥电路，在单个控制板上集成有电源单元、控制单元、第一驱动单元和第二驱动单元，电源单元用于供电，控制单元分别与第一驱动单元和第二驱动单元电连接以能够驱动控制两组IGBT组件的运行，通过将两个驱动单元共用一个电源单元和一个控制单元，简化了结构，减少了所用电子器件的数量和材料成本，有利于降低发生故障的几率，提高了功率模块的可靠性，同时仅采用单个控制板对两组IGBT组件实现驱动控制，减少了布置在框体中的控制板数量，有利于节省框体内部的安装空间。
一种 svg 串联功率模块设备

[发明专利]一种混合缓存粒度下的请求处理方法、设备及存储介质-CN202310541857.3在审
发明人：刘扬帆;施葹;苟鹏飞;陆泳;徐越;王贺 -专利权人：合芯科技（苏州）有限公司
申请日： 2023-05-15 - 公布日： 2023-08-08 - 主分类号： G06F12/0811 文献下载
摘要：本申请属于芯粒技术领域，公开了一种混合缓存粒度下的请求处理方法、设备及存储介质，该方法应用于处理器，处理器中的二级缓存和一级缓存位于处理器芯粒，三级缓存位于总线芯粒；该方法包括：获取一级缓存的一级缓存粒度和三级缓存的三级缓存粒度；根据一级缓存粒度和三级缓存粒度确定缓存工作模式；接收请求信息，并基于缓存工作模式处理请求信息。本申请确保不同级缓存之间数据传输的一致性，实现了处理器芯粒内部缓存粒度不同、或处理器芯粒和总线芯粒的缓存粒度不同时，处理器芯粒与总线芯粒之间的互联。
一种混合缓存粒度请求处理方法设备存储介质

[发明专利]多核片上网络评测的踪迹生成方法、系统、设备及介质-CN202310445613.5在审
发明人： 苟鹏飞 -专利权人：合芯科技有限公司;北京市合芯数字科技有限公司
申请日： 2023-04-23 - 公布日： 2023-07-04 - 主分类号： G06F15/78 文献下载
摘要：本发明提供了一种多核片上网络评测的踪迹生成方法、系统、设备与介质，所述方法包括：通过计算机系统模拟器模拟运行预设二进制程序，并监测所述计算机系统模拟器的二级缓存发出的指令请求；响应于二级缓存发出的各个指令请求，获取各个指令请求对应的请求信息，并根据请求信息，生成请求踪迹文件；将请求踪迹文件按照预设要求进行踪迹转换，得到满足多核片上网络模拟器中访存请求节点的使用需求的网络评测踪迹文件，以使多核片上网络模拟器根据网络测评踪迹文件完成相应的网络评测。本发明能够简单可靠的生成多核片上网络评测所需踪迹的同时，还能根据多核片上网络模拟器的评测需求灵活调整踪迹，为片上网络精准测评提供可靠保障。
多核网络评测踪迹生成方法系统设备介质

[发明专利]一种硅烷偶联剂改性银包铜粉异质结电池银浆及其制备方法-CN202310131450.3在审
发明人：王静;伍洋;万莉莎;王海清;蔡胜胜;杨红;苟鹏飞;肖毅 -专利权人：四川东树新材料有限公司
申请日： 2023-01-12 - 公布日： 2023-06-02 - 主分类号： H01B1/22 文献下载
摘要：本发明公开了一种硅烷偶联剂改性银包铜粉异质结电池银浆，包括导电粉末和有机载体；所述导电粉末包括改性银包铜粉和银粉，所述银包铜粉为核壳结构银包铜，所述银粉为几种不同粒径的导电银粉的混合物；所述有机载体包括溶剂、热固性树脂、潜伏性固化剂。本发明提供一种硅烷偶联剂改性银包铜粉异质结电池银浆，通过对银包铜粉的表面改性，有效解决银包铜粉电池银浆的粘度随着时间增加的问题，提供良好的印刷性。
一种硅烷偶联剂改性银包铜粉异质结电池及其制备方法

[发明专利]可重构处理器、可重构系统以及实现流密码算法的方法-CN202111436700.1在审
发明人：刘雷波;杨锦江;苟鹏飞;邓辰辰 -专利权人：清华大学无锡应用技术研究院;清华大学;合芯科技有限公司
申请日： 2021-11-29 - 公布日： 2023-05-30 - 主分类号： G06F15/78 文献下载
摘要：本发明提供了一种可重构处理器包括：有限状态机，用于对多个初始数据进行运算，得到状态位；至少一个寄存器阵列，配置有第一数据选择器，用于通过第一数据选择器获取状态位，并根据状态位对第一密钥数据进行更新，得到第二密钥数据；抽取模块，配置有第二数据选择器，用于通过第二数据选择器从第二密钥数据中抽取特定位；以及密钥流产生器，用于对特定位进行运算，生成密钥流。本发明还提供了一种用于实现流密码算法的可重构系统以及一种实现流密码算法的方法。本发明在寄存器阵列、抽取模块和有限状态机三者的协同工作下，通过可配置的数据选择器对寄存器阵列中任意比特位进行抽取，灵活地兼容了多种流密码算法。
可重构处理器系统以及实现密码算法方法

[发明专利]线性反馈移位寄存器、资源分配方法、设备及存储介质-CN202211636999.X在审
发明人：程利甫;朱建峰;冯春阳;苟鹏飞;魏少军 -专利权人：清华大学;合芯科技有限公司
申请日： 2022-12-14 - 公布日： 2023-05-02 - 主分类号： G06F7/58 文献下载
摘要：本发明提供了一种线性反馈移位寄存器，应用于计算机技术领域，包括：可重构配置模块，用于接收该待处理算法需要使用的移位数据链的配置信息，并基于该配置信息生成配置指令，将该配置指令发送给移位寄存器阵列，该移位寄存器阵列，包括多个移位寄存器，该移位寄存器阵列用于按照该配置指令，在该多个移位寄存器中存放该移位数据链，其中，该移位数据链的配置信息包括该移位数据链的数目信息、每条该移位数据链的长度信息和每条该移位数据链的宽度信息。本发明还提供了一种资源分配方法、电子设备及存储介质，可提高资源利用率。
线性反馈移位寄存器资源分配方法设备存储介质

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