[实用新型]一种叠层大功率陶瓷封装有效
申请号: | 202222992752.3 | 申请日: | 2022-11-10 |
公开(公告)号: | CN218730878U | 公开(公告)日: | 2023-03-24 |
发明(设计)人: | 马路遥;王曾;向跃军;王明康;潘朋涛;杨超平;马星丽 | 申请(专利权)人: | 中国振华集团永光电子有限公司(国营第八七三厂) |
主分类号: | H01L23/08 | 分类号: | H01L23/08;H01L23/053;H01L23/043;H01L23/40;H01L23/48 |
代理公司: | 贵州派腾知识产权代理有限公司 52114 | 代理人: | 汪劲松 |
地址: | 550018 贵州省*** | 国省代码: | 贵州;52 |
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摘要: | |||
搜索关键词: | 一种 大功率 陶瓷封装 | ||
本实用新型提供了一种叠层大功率陶瓷封装,包括陶瓷基座;陶瓷基座的上端加工有凹槽,凹槽内加工有芯片烧结区和若干金属层,每个金属层上均安装有一根支撑柱,若干金属层中有至少一个金属层上加工有芯片键合区;所述陶瓷基座的底部还匹配加工有与若干金属层位置数量相同的外电极。本实用新型通过将芯片烧结在陶瓷基座底部,陶瓷基座边缘加工导电柱体对电路板进行支撑的同时与电路板连接,使陶瓷基座的底部及其三维空间均得到利用,大大增加了封装壳体内部空间的利用率,减小了器件的平面面积。
技术领域
本实用新型涉及一种叠层大功率陶瓷封装。
背景技术
现有的电路板多数是将控制模块和功率模块加工在PCB板上,然后在将电路板分封装,由于所有模块均在同一平面进行搭接,电路板必须预留全部器件的安装空间及焊接位置,导致器件封装完成后体积过大。
为了减少封装在电路板上所占用的面积,现有的封装方式是将元器件分别封装在外壳不同高度处,如公开号为CN201340851Y公开的半导体功率器件的贴装式封装外壳,在陶瓷框架体的底部分别焊接连接装配器件管芯的金属底板以及金属外引线片,在陶瓷框架体台阶面上熔结有焊接内引线的电极层,有效减小了芯片贴装在电路板上占据的面积,但其未对金属底板进行分隔,将芯片及内引线均设置在封装底部,而将内引线的电极层设置在台阶面上,空间利用率合并不高,腔体上端的空间仍然存在浪费。
实用新型内容
为解决上述技术问题,本实用新型提供了一种叠层大功率陶瓷封装。
本实用新型通过以下技术方案得以实现。
本实用新型提供的一种叠层大功率陶瓷封装,包括陶瓷基座;陶瓷基座的上端加工有凹槽,凹槽内加工有芯片烧结区和若干金属层,每个金属层上均安装有一根支撑柱,若干金属层中有至少一个金属层上加工有芯片键合区;所述陶瓷基座的底部还匹配加工有与若干金属层位置数量相同的外电极。
所述芯片烧结区和芯片键合区高度相同且高于金属层且低于支撑柱。
所述芯片烧结区包括钨铜热沉,钨铜热沉的上端加工有凸起贯穿钨铜热沉,钨铜热沉的下端固定在钨铜热沉底部。
所述陶瓷基座在金属层下端加工有若干通孔,通孔内填充有钨柱将金属层和外电极连接。
所述金属层和其相对的外电极形状和大小相同。
所述陶瓷基座上端边缘还固定有封口环,封口环的高度大于支撑柱的高度。
封口环顶部通过和封口环截面形状相同的盖板封闭。
所述金属层顶层为金层。
本实用新型的有益效果在于:通过将芯片烧结在陶瓷基座底部,陶瓷基座边缘加工导电柱体对电路板进行支撑的同时与电路板连接,使陶瓷基座的底部及其三维空间均得到利用,大大增加了封装壳体内部空间的利用率,减小了器件的平面面积,利用钨铜热沉直接作为芯片的烧结底座,满足吸收芯片产生的功率热度要求、大电流传导要求外壳底部绝缘要求、满足大功率和大电流的传导需求。
附图说明
图1是本实用新型的结构示意图;
图2是本实用新型的热沉电极截面结构示意图;
图3是本实用新型的结构示意图;
图中:1-陶瓷基座,2-钨铜热沉,4-金属层,5-支撑柱,6-连接柱,7-外电极A,8-外电极B,9-芯片键合块A,10-芯片键合块B,11-封口环。
具体实施方式
下面进一步描述本实用新型的技术方案,但要求保护的范围并不局限于所述。
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