[发明专利]一种降低碳化硅外延片生长缺陷的方法及碳化硅衬底有效
| 申请号: | 202011581436.6 | 申请日: | 2020-12-28 |
| 公开(公告)号: | CN112701030B | 公开(公告)日: | 2021-11-23 |
| 发明(设计)人: | 冯淦;赵建辉;钱卫宁;黄海林;刘杰;梁瑞 | 申请(专利权)人: | 瀚天天成电子科技(厦门)有限公司 |
| 主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/04 |
| 代理公司: | 厦门市精诚新创知识产权代理有限公司 35218 | 代理人: | 刘小勤 |
| 地址: | 361001 福建省厦门市火炬高*** | 国省代码: | 福建;35 |
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| 摘要: | |||
| 搜索关键词: | 一种 降低 碳化硅 外延 生长 缺陷 方法 衬底 | ||
1.一种降低碳化硅外延生长缺陷的方法,其特征在于:包括以下步骤:
步骤10:提供具有注入面的碳化硅衬底,在所述注入面表面沉积500-800nm的SiO2作为掩膜层,然后在所述掩膜层表面涂覆光刻胶,在掩膜板下经过曝光并显影形成掩膜层刻蚀窗口,对刻蚀窗口下掩膜层进行刻蚀,完成刻蚀后,对所述光刻胶进行清洗;
步骤20:对上一步获得的碳化硅衬底的所述注入面进行N元素的高温离子注入,所述高温离子注入的温度为950-1100℃,使所述注入面上对应所述刻蚀窗口的位置形成高N区域,所述高N区域的N浓度至少要大于5E18 cm-3,所述高N区域的深度至少大于0.1μm;
步骤30:完成N元素的高温离子注入后,使用酸性缓冲液进行清洗,洗去掩膜层,得到经过处理的碳化硅衬底,以其作为外延生长的基片;在步骤30之后还包括步骤40:在步骤30得到的经过处理的碳化硅衬底表面生长高氮掺杂缓冲层,所述高氮掺杂缓冲层厚度为0.2μm-5μm,N浓度大于1E18 cm-3,以其作为外延生长的基片;
在步骤40之后重复步骤10至步骤40,其中第m次进行步骤10时对掩膜层刻蚀窗口进行调整,使之与前一次的掩膜层刻蚀窗口形成互补图案,m为大于1的正整数,在所述碳化硅衬底上形成N个所述高氮掺杂缓冲层的层叠结构。
2.根据权利要求1所述降低碳化硅外延生长缺陷的方法,其特征在于:步骤30中经过处理的碳化硅衬底,在进行后续外延生长时去除刻蚀步骤,以防止N原子的析出。
3.根据权利要求1或2所述降低碳化硅外延生长缺陷的方法,其特征在于:步骤10中,完成刻蚀后,对所述光刻胶进行清洗,并在清洗后的衬底表面均匀沉积20-60nm厚的SiO2作为保护层。
4.根据权利要求1或2所述降低碳化硅外延生长缺陷的方法,其特征在于:掩膜层刻蚀窗口为栅格结构。
5.根据权利要求1或2所述降低碳化硅外延生长缺陷的方法,其特征在于:所述高N区域的N浓度≥1E19 cm-3,所述高N区域的深度≥0.2μm。
6.根据权利要求1或2所述降低碳化硅外延生长缺陷的方法,其特征在于:所述高氮掺杂缓冲层厚度为0.2μm-0.5μm。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





