[发明专利]FINFET器件、半导体器件及其形成方法有效
申请号: | 201810917121.0 | 申请日: | 2018-08-13 |
公开(公告)号: | CN109585294B | 公开(公告)日: | 2022-03-08 |
发明(设计)人: | 柯忠廷;卢柏全;李志鸿;徐志安 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | finfet 器件 半导体器件 及其 形成 方法 | ||
1.一种用于形成半导体器件的方法,包括:
形成在隔离区域上方延伸的鳍以及所述鳍上方的介电层;
形成牺牲栅极,所述牺牲栅极包括在所述介电层上方形成的栅电极层;
在所述牺牲栅极的侧壁上选择性地沉积第一介电材料,以在所述牺牲栅极的侧壁上形成间隔件,其中,所述第一介电材料不沉积在所述牺牲栅极的顶面上方;
使用所述牺牲栅极和所述间隔件作为组合掩模来图案化所述鳍,以在所述鳍中形成凹槽;以及
在所述凹槽中形成外延源极/漏极区,
在所述沉积第一介电材料之前,对所述牺牲栅极上方的图案化掩模以及对未被所述牺牲栅极覆盖的所述介电层实施氟化工艺。
2.根据权利要求1所述的用于形成半导体器件的方法,其中,在所述鳍上方形成所述牺牲栅极包括:
在所述鳍上方形成栅电极层;
在所述栅电极层上方形成图案化掩模;以及
将所述图案化掩模的图案转印至所述栅电极层。
3.根据权利要求2所述的用于形成半导体器件的方法,所述间隔件具有在1nm与6nm之间的宽度。
4.根据权利要求3所述的用于形成半导体器件的方法,还包括:
在对所述图案化掩模实施所述氟化工艺之前,在所述图案化掩模的侧壁和顶面上形成第二介电材料。
5.根据权利要求4所述的用于形成半导体器件的方法,还包括:
在对所述图案化掩模实施所述氟化工艺之后,去除所述第二介电材料。
6.根据权利要求4所述的用于形成半导体器件的方法,其中,在所述图案化掩模的侧壁和顶面上形成所述第二介电材料还包括在所述牺牲栅极的侧壁上形成所述第二介电材料。
7.根据权利要求4所述的用于形成半导体器件的方法,其中,在所述图案化掩模的侧壁和顶面上形成所述第二介电材料包括选择性地将所述第二介电材料沉积在所述图案化掩模的侧壁和顶面上。
8.一种用于形成半导体器件的方法,包括:
使得隔离区域凹陷以暴露半导体鳍的侧壁;
在所述半导体鳍上方形成介电层以及位于所述介电层上方的栅电极层;
在所述栅电极层上方形成图案化掩模;
去除由所述图案化掩模暴露的所述栅电极层的部分,以在所述半导体鳍上方形成牺牲栅极,所述牺牲栅极包括在所述栅电极层下方的所述介电层;
对所述图案化掩模实施氟化工艺以形成氟化图案化掩模、以及对未被所述牺牲栅极覆盖的所述介电层实施氟化工艺;
在所述牺牲栅极的侧壁上选择性地沉积第一介电材料,以在所述牺牲栅极的侧壁上形成间隔件;
使用所述氟化图案化掩模、所述牺牲栅极和所述间隔件作为组合掩模来蚀刻所述半导体鳍,以在所述半导体鳍中形成凹槽;以及
在所述凹槽中沉积半导体材料。
9.根据权利要求8所述的用于形成半导体器件的方法,还包括:
在对所述图案化掩模实施所述氟化工艺之前,在所述图案化掩模的侧壁和顶面上形成第二介电材料。
10.根据权利要求9所述的用于形成半导体器件的方法,其中,所述第二介电材料包括氧化铝。
11.根据权利要求9所述的用于形成半导体器件的方法,所述间隔件具有在1nm与6nm之间的宽度。
12.根据权利要求9所述的用于形成半导体器件的方法,还包括:
在所述半导体鳍上方形成所述牺牲栅极之后,在所述介电层的暴露部分上方形成所述第二介电材料。
13.根据权利要求8所述的用于形成半导体器件的方法,其中,所述图案化掩模包括氧化物材料。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造