专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]累加处理器-CN201811311471.9有效
  • 刘勇攀;岳金山;刘若洋;袁哲;孙文钰;李学清;杨华中 - 清华大学
  • 2018-11-06 - 2022-12-16 - G06F7/525
  • 本发明实施例提供一种乘累加处理器,包括:乘累加阵列包括阵列式排列的多个乘累加单元;存储器为转置静态随机访问存储器,用于存储第一变换域序列;串并行转换模块,用于从存储器中获取第一变换域序列中第m个位置的数据,将获取的第一变换域序列中第m个位置的数据分别输入对应的乘累加阵列中的各行;乘累加单元,用于根据输入乘累加单元所在行的第一变换域序列中第m个位置的数据输入乘累加单元所在列的第二变换域序列中的数据进行乘累加本发明实施例提供的乘累加处理器,实现了数据的复用,减少了对存储器中数据的读取次数,能提高数据处理效率、降低乘累加处理器的功耗。
  • 累加处理器
  • [发明专利]DSV控制装置DSV控制方法-CN200610108446.1无效
  • 新江裕之 - 恩益禧电子股份有限公司
  • 2006-08-04 - 2007-02-07 - G11B20/10
  • 一种为每一DC控制块插入DC控制位的数字值(DSV)控制装置。该装置包括:第一DSV累加值比较器,其用于向第一DC控制块的DC控制位设置目标标记;第二DSV累加值比较器,其用于将根据第一DC控制块的DSV值累加计算的第一DSV累加值与根据第一DC控制块之后的多个DC控制块的DSV值累加计算的第二DSV累加值进行比较;以及DC控制位确定输出部件,其用于根据第一第二DSV累加值比较器的输出来确定第一控制块的DC控制位的值。
  • dsv控制装置方法
  • [发明专利]用于清洁机器人的线绳缠绕识别方法装置-CN202310143628.6在审
  • 李伟 - 深圳市云鼠科技开发有限公司
  • 2023-02-09 - 2023-06-09 - A47L11/24
  • 本发明公开了一种用于清洁机器人的线绳缠绕识别方法,包括下述步骤:角度监控步骤:建立用于累加清洁机器人运动过程中产生的俯仰角度的俯仰容器,用于累加清洁机器人运动过程中产生的横滚角度的横滚容器;并且分别通过俯仰容器横滚容器连续累加清洁机器人产生的角度数据;所述俯仰角度在俯仰容器中累加得到俯仰累加角,所述横滚角度在横滚容器中累加得到横滚累加角;当俯仰容器中记载的俯仰累加角超过了俯仰容器的最大容量,或横滚容器中记载的横滚累加角超过了横滚容器的最大容量时,确定清洁机器人被线绳缠绕
  • 用于清洁机器人线绳缠绕识别方法装置
  • [发明专利]电荷与数字混合累加型CMOS-TDI图像传感器-CN201610970573.6有效
  • 高静;黄蕊;聂凯明;徐江涛 - 天津大学
  • 2016-11-04 - 2019-07-12 - H04N5/374
  • 本发明涉及模拟集成电路设计领域,为实现充分发挥电荷域无噪声累加,数字域累加芯片面积小、无累加上限的优点,同时又不对电荷域累加时的传输效率满阱容量以及数字域累加时ADC的速度提出过高要求,本发明采用的技术方案是,电荷与数字混合累加型CMOS‑TDI图像传感器,由像素阵列、列并行ADC阵列、列并行数字域累加阵列、移位寄存器、时序控制模块构成,像素阵列大小为L列N行,像素阵列中N行像素分成K个子像素阵列,每个子像素阵列由M行像素一个读出电路组成;每个子像素阵列各级之间采用电荷累加方式,K个子阵列之间采用数字累加方式,其中N=M×K。
  • 电荷数字混合累加cmostdi图像传感器
  • [发明专利]低密度奇偶校验迭代译码提前终止的方法-CN201110052448.4有效
  • 吴亮明;李传磊;刘光辉 - 四川虹微技术有限公司
  • 2011-03-04 - 2011-06-29 - H04L1/00
  • 本发明涉及低密度奇偶校验迭代译码提前终止的方法,包括步骤:a.信息初始化;b.校验节点更新;c.信息节点更新;d.对累加门限赋值;设置累加变量;e.将所有信息节点更新后的置信度累加,并将累加值赋予累加变量;f.判断累加变量的值是否达到累加门限,如果达到累加门限,则终止迭代,并将信息经硬判决后输出;如果未达到累加门限,迭代至步骤b执行。针对目前低密度奇偶校验迭代译码(LDPC)的过程过于繁琐而导致其耗费大量的资源时间,本发明的方法,具有提前终止迭代策略,并且方法实现简单,硬件容易实现,资源消耗很少,因为每次迭代完成后的判决几乎没有时延
  • 密度奇偶校验译码提前终止方法
  • [发明专利]运算处理装置-CN201880096920.4在审
  • 古川英明 - 奥林巴斯株式会社
  • 2018-10-12 - 2021-04-09 - G06N3/08
  • 在运算处理装置中、运算控制部以如下方式进行控制:在用于计算输出特征量图的特定的像素的滤波处理累加处理的中途,将中间结果暂时保存在所述累加结果保存用存储器中而进行其他像素的处理,在将针对所有的像素的累加处理的中间结果在所述累加结果保存用存储器中保存完毕之后,返回到最初的像素,读出保存在所述累加结果保存用存储器中的值并将该值作为累加处理的初始值,继续执行累加处理。
  • 运算处理装置
  • [发明专利]一种分路实现高速数据累加电路-CN201810115799.7在审
  • 孙永明 - 长沙泰科阳微电子有限公司
  • 2018-02-06 - 2019-08-13 - H03L7/18
  • 本发明公开了一种分路实现高速数据累加电路,包括din输入信号、clk时钟信号、clkdiv2输入信号、第一选择器、第一累加器、第二选择器、第二累加器、第一加法器、第三累加器、第二加法器、第四累加第三选择器,其中,所述第一选择器、所述第二选择器所述第三选择器均包括输入D端、输入CLK端、输出Q端输出QN端,所述din输入信号与所述第一选择器的输入CLK端连接,所述第一累加器、所述第二累加器、所述第三累加所述第四累加器均包括输入D端、输入CLK端输出Q端,所述第一选择器的输出Q端与所述输入D1端连接,所述第一选择器输入D端分别与所述第一选择器输出QN端连接、所述第一累加器的输出Q端以及第二选择器的输入D端连接。
  • 累加器选择器输出高速数据累加电路加法器分路选择器输出选择器输入时钟信号
  • [发明专利]一种汽车助力转向器的稳定控制器-CN201710694986.0有效
  • 温东宾;王君竹;姚坤鹏;殷飞;张金萍 - 豫北转向系统(新乡)股份有限公司
  • 2017-08-15 - 2023-05-30 - B62D5/04
  • 本发明公开了一种汽车助力转向器的稳定控制器,包括累加器一累加器二,扭矩阻尼模块、偏航阻尼模块主动回正模块的输出端与累加器一的输入端连接,基本助力模块的输出端上述累加器一的输出端分别与累加器三的输入端连接,该累加器三的输出端与稳定滤波器的输入端连接,此稳定滤波器的输出端累加器一的输出端分别与累加器二的输入端连接,所述扭矩阻尼模块的输入端分别与管柱扭距信号车速信号连接,所述偏航阻尼模块的输入端分别与管柱扭距信号、管柱转速信号车速信号连接,主动回正模块的输入端分别与管柱位置信号车速信号连接,基本助力模块的输入端分别与管柱扭距信号车速信号连接,所述累加器二的输出端为所需要的扭距。
  • 一种汽车助力转向器稳定控制器
  • [发明专利]图像去噪方法、装置、介质及电子设备-CN202211157138.3在审
  • 陈岩;姬弘桢 - 展讯通信(上海)有限公司
  • 2022-09-22 - 2023-01-03 - G06T5/00
  • 图像去噪方法包括:获取待处理图像并从中选取参考帧当前帧;根据参考帧将当前帧进行内容对齐处理;计算对齐处理后的每个当前帧的像素权重;累加当前帧的像素权重得到第一权重累加图;根据第一权重累加图计算参考帧的像素权重;累加当前帧参考帧的像素权重得到第二权重累加图;根据当前帧参考帧的像素权重将对齐处理后当前帧参考帧的像素值进行加权求和,得到像素权重乘积累加图;根据像素权重乘积累加第二权重累加图中同一位置处像素的比值
  • 图像方法装置介质电子设备

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