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[发明专利]接收装置-CN00133777.7有效
发明人：片冈充照 -专利权人：松下电器产业株式会社
申请日： 2000-10-27 - 公布日： 2004-06-16 - 主分类号： G11B20/10 文献下载
摘要：接收装置，包括：接收第一数据的接收部，该数据包括多个数据项；存储这些数据项中至少一项的累加存储部；获取该累加存储部的自由空间容量的自由空间容量获取部；确定把哪一项数据存储在该累加存储部中的累加级确定部；根据累加级确定部的确定从第一数据中提取一数据项的数据提取部；把提取的数据项写入该累加存储部的数据写入部。累加级确定部包括一存储数据确定部，其根据预定参数确定要提取的数据项，这些参数至少包括自由空间容量。
接收装置

[发明专利]可实现双向计量的智能电表的总电量累加方法-CN201010615727.2有效
发明人：孟珺遐 -专利权人：中国电力科学研究院
申请日： 2010-12-31 - 公布日： 2011-09-28 - 主分类号： G01R11/57 文献下载
摘要：本发明可实现具有双向计量功能的智能电表的总电量累加方法，所述方法包括正反向总电量的累加和各费率正反向总电量的累加，能量寄存器采用“读复位”模式。上述两种方法只用到整数运算，却可以保证数字的准确和电量的精确累加，大部分的数据处理只用加法或减法就能完成。本发明依据电力公司的要求，即可以分别累加正向和反向总电量，也可计算出组合总电量。
实现双向计量智能电表电量累加方法

[发明专利]一种对交付前双语文件状态快速检查的系统及方法-CN202210685044.7在审
发明人：王博 -专利权人：沈阳创思佳业科技有限公司
申请日： 2022-06-14 - 公布日： 2022-09-09 - 主分类号： G06F16/17 文献下载
摘要：本发明提供了一种对交付前双语文件状态快速检查的系统及方法，包括：获取模块、累加模块和输出模块；所述获取模块用于获取待检查文件信息；所述累加模块用于对所述待检查文件信息进行分类累加整理；所述输出模块用于对分类累加整理的结果进行输出展示
一种交付双语文件状态快速检查系统方法

[发明专利]扩展精度累加器-CN02808633.3有效
发明人： M·斯特里贝克;P·帕里尔 -专利权人：美普思科技有限公司
申请日： 2002-02-15 - 公布日： 2004-06-09 - 主分类号： G06F7/38 文献下载
摘要：乘法单元包括一个扩展精度累加器。提供用于操作扩展精度累加器的各部分的微处理器指令，包括一个将扩展累加器的一部分的内容转移到一个通用寄存器的指令(“MFLHXU”)和一个将一个通用寄存器的内容转移到扩展累加器的一部分的指令(“MTLHX
扩展精度累加器

[发明专利]一种随机数累加和检测的快速实现方法及系统-CN202310197041.3在审
发明人：黄晓凯;魏荣;尤启迪;张文政;张洋;王轲;朱卫兵;袁野;程东旭;梁小虎;周旋;陈伍 -专利权人：航天恒星科技有限公司
申请日： 2023-03-01 - 公布日： 2023-06-23 - 主分类号： G06F7/58 文献下载
摘要：本发明涉及一种随机数累加和检测的快速实现方法，包括：调用随机数生成器产生二元随机数待检测序列；将二元随机数待检测序列转换为字节和比特混合型的随机数检测序列；对字节和比特混合型的随机数检测序列进行序列变换；基于查表法对随机数检测序列进行字节型迭代累加；取字节型迭代累加和最大值；基于字节型迭代累加和最大值，计算余误差函数P_value；当余误差函数P_value≥α时，α为显著性水平，待检测序列通过检测，本发明解决了计算机在执行二元序列累加和随机检测时效率低的问题，最大程度上的提升了累加和检测执行效率，进一步提升整套随机数检测的效率。
一种随机数累加检测快速实现方法系统

[发明专利]矩阵乘法器和处理器-CN202011406153.8有效
发明人：薛大庆;黄河 -专利权人：海光信息技术股份有限公司
申请日： 2020-12-03 - 公布日： 2022-09-13 - 主分类号： G06F17/16 文献下载
摘要：一种矩阵乘法器和处理器。该矩阵乘法器用于第一矩阵和第二矩阵的乘法运算，且包括：第一至第三向量寄存器组、乘累加运算单元组以及耦接到第一至第三向量寄存组和乘累加运算单元组的控制器。第一和第二向量寄存器组分别用于存储第一和第二矩阵；乘累加运算单元组包括的多个乘累加运算单元的每个包括第一至第三端；多个乘累加运算单元的第一端被配置为在操作中分别耦接到第一向量寄存器组中被选择的第一向量寄存器的多个第一向量寄存单元；多个乘累加运算单元的第二端彼此相连；多个乘累加运算单元的第三端被配置为在操作中分别耦接到第三向量寄存器组的被选择的第三向量寄存器的多个第三向量寄存单元。
矩阵乘法器处理器

[发明专利]信息处理设备和信息处理方法-CN201880004505.1有效
发明人：广井聪幸;中村章;山本真纪子;池谷亮志 -专利权人：索尼公司
申请日： 2018-06-29 - 公布日： 2021-01-05 - 主分类号： G06F17/10 文献下载
摘要：[解决方案]提供了一种信息处理设备，该信息处理设备设置有乘积累加运算电路，该乘积累加运算电路用于基于多个输入值和多个权重系数来执行乘积累加运算，所述多个权重系数分别对应于输入值并且通过幂表达来量化。经量化的权重系数的指数由将预定的除数作为分母的分数来表达，并且乘积累加运算电路基于根据除数确定的余数使用不同的加法乘数来执行乘积累加运算。
信息处理设备方法

[发明专利]零备件需求累积预测方法-CN200610027454.3无效
发明人：隋明刚;李虎 -专利权人：上海凌鼎管理软件有限公司
申请日： 2006-06-08 - 公布日： 2007-12-12 - 主分类号： G06Q10/00 文献下载
摘要：一种零备件需求的预测计量方法，包括：确定一定的时间点历史数据并对数据做累加使得累加数据呈现一定的规律性；并包括：对累加数据做预测；还包括：利用累加数据对累加预测值和时间点加1、时间点加1的平方做多元线性回归
备件需求累积预测方法

[发明专利]一种GaAs HBT双边沿触发流水线累加器结构-CN200910091373.3有效
发明人：刘新宇;陈高鹏;吴旦昱;金智;武锦 -专利权人：中国科学院微电子研究所
申请日： 2009-08-19 - 公布日： 2011-03-30 - 主分类号： G06F7/501 文献下载
摘要：本发明公开了一种GaAs HBT双边沿触发流水线累加器结构，该结构为一由N级1-bit全加器并行构成的流水线结构，N为大于2的自然数，每一级1-bit全加器完成累加运算之后向外部输出累加之和，并且向下一级利用本发明，在每个时钟周期内可以进行两次累加运算，从而实际上将累加器的速度提升为时钟频率两倍，大幅提升了累加器的速度。
一种 gaas hbt 双边触发流水线累加器结构

[发明专利]可实现多模式乘累加计算的存算一体芯片-CN202211193323.8在审
发明人：王源;肖康林;崔小欣 -专利权人：北京大学
申请日： 2022-09-28 - 公布日： 2023-06-09 - 主分类号： G06F15/78 文献下载
摘要：本发明提供一种可实现多模式乘累加计算的存算一体芯片，包括计算单元阵列和连接器阵列，计算单元阵列包括多个呈阵列排布的位单元；连接器阵列与计算单元阵列连接，包括列内连接器和列间连接器，用于实现位单元的列内连接和列间连接；调整位单元的配置信息、工作模式、阵内连接关系和阵间连接关系，使得计算单元阵列和连接器阵列构成二值权重网络乘累加计算结构、三值权重网络乘累加计算结构或多值网络乘累加计算结构，用以实现多模式乘累加计算。本发明通过调整位单元的配置信息、工作模式、阵内连接关系和阵间连接关系，实现多模式乘累加计算，解决了现有的静态随机存储器的存内计算芯片计算模式单一，灵活性较差的问题。
实现模式累加计算一体芯片

[发明专利]基于全展开的全流水128位精度浮点累加器-CN201010180381.8有效
发明人：窦勇;雷元武;郭松 -专利权人：中国人民解放军国防科学技术大学
申请日： 2010-05-22 - 公布日： 2010-10-13 - 主分类号： G06F7/50 文献下载
摘要：本发明公开了一种基于全展开的全流水128位精度浮点累加器，要解决的主要技术问题是提供一种实现无精度损失累加的累加器。本发明由全展开浮点累加模块和规格化模块组成，全展开浮点累加模块由尾数加法模块、存储模块和快速进位模块组成。存储模块由四个存储体、一个计数器和四个选择器组成；尾数加法模块由求补部件、移位部件、操作数A寄存器、操作数B寄存器、加法模块，加法结果寄存器和第一标志位更新部件组成；快速进位模块由进位终止因子地址生成部件、进位终止因子地址寄存器、进位终止因子生成部件、进位信息寄存器、进位终止因子寄存器、进位加法器、进位加法结果寄存器和第二标志位更新部件组成。本发明可提高累加器的精度和速度。
基于展开流水 128 精度浮点累加器

[发明专利]爬取数据的方法、装置、介质及电子设备-CN202110477953.7在审
发明人：杨光;周天星 -专利权人：北京精准沟通传媒科技股份有限公司
申请日： 2021-04-30 - 公布日： 2021-07-30 - 主分类号： G06F16/951 文献下载
摘要：一种爬取数据的方法，包括：获取本次请求URL，根据所述本次请求URL进行数据爬取任务；获取组装后续请求所需的配置数据，后续请求配置数据包括累加参数和累加数；读取本次请求URL中包含的累加参数的参数值；将参数值与累加数相加，得到累加后的参数值；基于累加后的参数值，生成新的URL请求；将新的URL请求放入待请求队列，从而依据待请求队列中的URL请求执行爬虫任务。
数据方法装置介质电子设备

[发明专利]一种提高发动机转速控制精度的总线油门控制方法-CN202110916379.0在审
发明人：王绪通;刘永鑫;李闯闯;牛东东;冯小靖;卞清荣;吕传伟;徐威 -专利权人：徐州徐工挖掘机械有限公司
申请日： 2021-08-11 - 公布日： 2021-09-24 - 主分类号： F02D11/10 文献下载
摘要：本发明公开一种提高发动机转速控制精度的总线油门控制方法，将小数累加值Ae初始值置0；通过转速‑油门对应关系，获取的实际油门值Af；将实际油门值Af分割成整数油门值Ai和小数油门值Ad；将小数油门值Ad累加到小数累加值Ae上；如果小数累加值Ae小于1，则将整数油门值Ai作为总线油门值Ab；如果小数累加值Ae大于等于1，则将整数油门值Ai增加1后再作为总线油门值Ab，同时将小数累加值Ae减去1；发送总线油门值Ab；重复
一种提高发动机转速控制精度总线油门方法

[发明专利]一种UWB接收机信道匹配响应降噪估计方法和装置-CN202211539949.X在审
发明人：王志国;唐珂;屠恩源 -专利权人：芯与物（上海）技术有限公司
申请日： 2022-12-02 - 公布日： 2023-06-09 - 主分类号： H04L25/02 文献下载
摘要：本发明涉及一种UWB接收机信道匹配响应降噪估计方法和装置，其中，方法包括：获取相干累加输出信号；对所述相干累加输出信号求取初始噪底功率，并基于所述初始噪底功率得到噪声门限；根据所述噪声门限提取所述相干累加输出信号中的噪声信号，并对提取的所述相干累加输出信号中的噪声信号求取噪底功率，并基于所述噪底功率得到新的噪声门限；判断是否到达迭代次数，如果到达迭代次数，则进入下一步，否则返回上一步；将相干累加输出信号中超过噪声门限的部分标记为有用信号；将相干累加输出信号中未标记的信号置零。
一种 uwb 接收机信道匹配响应估计方法装置

[发明专利]卷积神经网络处理装置、高速目标探测方法以及设备-CN202211505839.1有效
发明人：夏春秋;陈世淼 -专利权人：深圳市唯特视科技有限公司
申请日： 2022-11-29 - 公布日： 2023-04-07 - 主分类号： G06N3/0464 文献下载
摘要：卷积神经网络处理装置包括：处理模块、累加模块、激活模块和存储模块。处理模块，用于根据输入特征值与输入权重值进行融合得到中间特征值，其中，处理模块包括呈阵列结构排布的多个处理单元，阵列结构为具有行、列、通道三个维度的阵列结构；累加模块与处理模块连接，用于根据中间特征值进行累加得到累加结果；激活模块与累加模块连接，用于根据累加结果进行激活处理得到输出特征值；存储模块与激活模块、处理模块分别连接，用于存储输入特征值、输入权重值以及输出特征值。
卷积神经网络处理装置高速目标探测方法以及设备