专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [实用新型]一种抗辐射功率半导体器件-CN202320418535.5有效
  • 王颖;包梦恬;曹菲 - 大连海事大学
  • 2023-03-08 - 2023-08-01 - H01L23/552
  • 本实用新型提供一种抗辐射功率半导体器件,涉及半导体功率器件领域,包括第一掺杂类型衬底和设置于第一掺杂类型衬底上方的第一掺杂类型外延层,所述第一掺杂类型外延层和第一掺杂类型衬底间设置有第一掺杂类型衬底缓冲层,所述第一掺杂类型外延层上形成沟槽,所述沟槽内部淀积形成栅氧化层介质。所述沟槽的上部空间设置有控制栅,所述沟槽的下部空间设置有屏蔽栅。所述第一掺杂类型外延层表面设置有第二掺杂类型阱区、第二掺杂类型接触区和第一掺杂类型源区。本实用新型结构在不增加功率半导体器件工艺难度的前提下,提高功率半导体器件抗单粒子辐射效应能力。
  • 一种辐射功率半导体器件
  • [发明专利]一种抗总剂量辐射效应的SOI LDMOS器件加固结构-CN202210247580.9有效
  • 于成浩;王颖;郭浩民;包梦恬;张立龙 - 杭州电子科技大学
  • 2022-03-14 - 2023-06-27 - H01L29/06
  • 本发明公开了一种抗总剂量辐射效应的SOI LDMOS器件加固结构。本发明通过外延方法在埋氧层2的界面生长一层薄的N扩展层,该N扩展层可吸取因辐照在埋氧层引入固定正电荷镜像产生的电子;通过离子注入方法在浅槽隔离氧化层的下表面的拐角附近形成一个P保护区,该P保护区能够降低浅槽隔离拐角附近体硅内部电场峰值,从而提高器件的横向击穿电压;通过高能离子注入方法在漂移区形成一个P柱区15,该P柱区能够起到电导调制作用,在同一耐压条件下可以提高漂移区浓度对击穿电压的变化窗口。本发明在相同耐压条件下不但降低了比导通电阻,还可以大幅度提高器件的抗总剂量性能,从而保证SOI LDMOS器件在空间辐射环境中长时间稳定工作。
  • 一种剂量辐射效应soildmos器件加固结构
  • [发明专利]一种NP层交替外延的碳化硅微沟槽中子探测器结构-CN202210406250.X有效
  • 于成浩;王颖;郭浩民;包梦恬;张立龙 - 杭州电子科技大学
  • 2022-04-18 - 2023-06-27 - H01L31/0352
  • 本发明公开了一种NP层交替外延的碳化硅微沟槽中子探测器结构。本发明结构采用多次外延法在N+衬底上依次交替制作N型层和P型层。首先在N+衬底上外延第一层N型层,之后在第一层N型层上外延第一层P型层,之后在第一层P型层外延层上外延第二层N型层,之后在第二层N型层外延层上外延第二层P型层,直到外延最后一层为N型层为止。如果外延的N型层一共有M层,则外延的P型层一共有M‑1层,总的外延层数为2M‑1层。每个N型层与每个P型层的厚度、掺杂浓度完全相同。本发明在外延层内部形成“锯齿形”的纵向电场分布,该电场分布更加均匀,使探测器在更低的衬底偏压下实现外延层的全耗尽,从而有效降低SiC微沟槽中子探测器的工作电压。
  • 一种np交替外延碳化硅沟槽中子探测器结构
  • [发明专利]一种碳化硅器件及其制备方法-CN202211713713.3在审
  • 曹菲;刘云涛;费新星;包梦恬 - 大连海事大学
  • 2022-12-29 - 2023-03-31 - H01L29/423
  • 本发明公开了一种碳化硅器件及其制备方法,包括有自下而上的金属漏极,N+衬底,N‑外延层,P型体区,N+源区,金属源极。在两侧的P型体区中间设置有N型电流扩展层,在元胞源极表面设置有P型掺杂区,在两侧栅极以及P型掺杂区中设置有异质结二极管,栅极表面设置有栅极氧化膜。本发明提出的SiCMOSFET结构相较于传统的MOSFET结构具有更好的静态品质因子和动态品质因子,具体表现为具有更低的导通电阻和更低的反向传输电容,且器件的第三象限导通特性和反向恢复特性得到了改善,双极退化效应与栅氧化物电场过高的问题得到了解决,具有更好的可靠性。
  • 一种碳化硅器件及其制备方法
  • [发明专利]一种双沟槽型碳化硅中子探测器-CN202210993292.8在审
  • 王颖;张立龙;包梦恬;曹菲 - 大连海事大学
  • 2022-08-18 - 2022-11-11 - H01L31/0352
  • 本发明公开了一种双沟槽型碳化硅中子探测器结构,包括:4H‑SiC衬底、设置在4H‑SiC衬底上方的4H‑SiC外延层、开设在4H‑SiC外延层正面的第一沟槽和第二沟槽,第一沟槽和第二沟槽交错设置;第一沟槽内设有中子转换材料10B粉末,第二沟槽内设有中子转换材料6LiF粉末;所述4H‑SiC外延层正面台面上设有P型欧姆接触电极,背面台面上设有N型欧姆接触电极。相比于传统的单沟槽型结构碳化硅中子探测器,本发明提出的双沟槽结构充分利用了10B和6LiF与热中子发生核反应的特点,大幅度提升本征探测效率。
  • 一种沟槽碳化硅中子探测器
  • [发明专利]一种高UIS雪崩耐量的功率VDMOSFET器件及其制备方法-CN202211084593.5在审
  • 王颖;周建成;曹菲;包梦恬 - 大连海事大学
  • 2022-09-06 - 2022-11-04 - H01L29/78
  • 本发明公开了一种高UIS雪崩耐量的功率VDMOSFET器件及其制备方法,该器件包括:N型衬底区;N型漂移区,在N型衬底区上方经一次外延形成;注入区,在N型漂移区上方两侧的沟槽内,包括P型轻浓度掺杂基区、P型高浓度掺杂区和N型高浓度源区,N型高浓度源区在P型轻浓度掺杂基区和P型高浓度掺杂区之间;功能区,在N型漂移区上方经多次外延形成,包括电流扩展层和P型高浓度屏蔽层;栅极区,在功能区的两侧,经高温氧化形成,包括栅极氧化层和栅极;源极和漏极,均经过器件金属化形成。本发明通过形成电流扩展层和P型高浓度屏蔽层可以在不牺牲器件基本电学特性的条件下,提高MOSFET器件的UIS雪崩耐量。
  • 一种uis雪崩功率vdmosfet器件及其制备方法
  • [发明专利]一种碳化硅槽栅功率MOSFET器件及制备方法-CN202210358599.0在审
  • 王颖;沈培;包梦恬;曹菲 - 杭州电子科技大学
  • 2022-04-06 - 2022-07-12 - H01L29/06
  • 本发明提供了一种碳化硅槽栅功率MOSFET器件及制备方法。本发明使用n型柱包裹侧壁p型柱构成一种侧壁超结电场调制区来改善SiC功率槽栅MOSFET电学性能。本发明侧壁超结电场调制区使得沟槽底部周围电场均匀,从而起到了进一步缓解沟槽底部拐角处高场强,保护了栅氧化层。通过改变n型柱与栅极之间的距离,选取一组最优距离使得击穿电压与比导通电阻之间很好地折中。并且由n型柱包裹层与侧壁p型柱构成的侧壁超结电场调制区具有的p‑n结的面积较SiC全超结槽栅MOSFET结构小,从而导致新结构的栅‑漏电荷Qgd比传统SiC全超结槽栅MOSFET结构的栅‑漏电荷Qgd略小。
  • 一种碳化硅功率mosfet器件制备方法
  • [发明专利]一种消除负阻效应的横向RC-IGBT器件结构-CN202111576801.9在审
  • 王颖;张孝冬;包梦恬;曹菲 - 杭州电子科技大学
  • 2021-12-21 - 2022-04-19 - H01L27/06
  • 本发明提供了一种消除负阻效应的横向RC‑IGBT器件结构。该横向RC‑IGBT器件与在传统的横向IGBT器件相比,在器件的漂移区中心处存在氧化物隔离区域,且在该氧化物隔离区域内部存在一个低掺杂的硅区域。由于上述氧化物的隔离作用,在氧化物下方是传统的IGBT区域,因此可以正常导通正向导通模式的双极电流,且不存在负阻效应。在氧化物上方是续流二极管区域,因此可以正常导通反向导通模式的双极电流。通过调整氧化物上方和下方所占面积的比例,可以调整IGBT和续流二极管的性能分布。
  • 一种消除效应横向rcigbt器件结构

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