[发明专利]单次可编程存储器架构中的自锁存感测时序有效

专利信息
申请号: 201611168426.3 申请日: 2016-12-16
公开(公告)号: CN106960687B 公开(公告)日: 2022-05-10
发明(设计)人: 邱云晨;大卫·J·图普斯;哈罗德·L·戴维斯 申请(专利权)人: 德州仪器公司
主分类号: G11C16/34 分类号: G11C16/34;G11C16/32
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 林斯凯
地址: 美国德*** 国省代码: 暂无信息
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摘要:
搜索关键词: 可编程 存储器 架构 中的 锁存感 测时
【权利要求书】:

1.一种可编程固态存储器,其包括:

存储器阵列,其具有被布置于行及列中的多个存储器单元,存储器单元的每一列与位线相关联,可将每一存储器单元从第一数据状态编程到第二数据状态;

感测放大器,其具有耦合到所述位线中的一者的输入,以用于在输出处呈现对应于耦合到所述位线的所选择的存储器单元的数据状态的信号;

数据锁存器,其具有耦合到所述感测放大器的所述输出的输入,其中所述数据锁存器包含耦合到输出数据路径的存储元件,所述数据锁存器可在复位状态中操作以将所述感测放大器的所述输出传递到所述输出数据路径,且其可在设置状态中操作以存储数据状态并将所述存储元件与所述感测放大器隔离;及

锁存器设置复位逻辑,其耦合到所述数据锁存器的所述输出,以用于响应于所述感测放大器感测来自所选择的存储器单元的所述第二数据状态将所述数据锁存器置于其设置状态中。

2.根据权利要求1所述的存储器,其中所述锁存器设置复位逻辑也用于响应于接收对应于读取循环的开始的启用信号将所述数据锁存器置于其复位状态中。

3.根据权利要求2所述的存储器,其进一步包括:

控制逻辑,其耦合到所述锁存器设置复位逻辑及所述感测放大器,以用于响应于时钟信号产生所述启用信号;

且其中所述控制逻辑响应于所述时钟信号复位所述感测放大器。

4.根据权利要求3所述的存储器,其进一步包括:

定时器,其用于在最大循环时间处产生循环结束信号;

其中所述锁存器设置复位逻辑响应于所述循环结束信号产生所述启用信号。

5.根据权利要求1所述的存储器,其中:

所述存储元件,其包含输入,且包含耦合到所述输出数据路径的输出;及

所述数据锁存器包括第一传输门,其耦合于所述感测放大器的所述输出与所述存储元件的所述输入之间;

其中所述锁存器设置复位逻辑具有耦合到所述存储元件的所述输出的输入,且所述锁存器设置复位逻辑经配置以响应于在所述存储元件的所述输出处的对应于所述感测放大器感测所述第二数据状态的转变打开所述第一传输门。

6.根据权利要求5所述的存储器,其中所述数据锁存器的所述存储元件包括:

第一反相器,其具有耦合到所述第一传输门的输入及输出;

第二反相器,其具有耦合到所述第一反相器的所述输出的输入及输出;及

第二传输门,其耦合于所述第二反相器的所述输出与所述第一反相器的所述输入之间;

其中所述锁存器设置复位逻辑也经配置以响应于所述存储元件的所述输出处对应于所述感测放大器感测所述第二数据状态的转变关闭所述第二传输门。

7.根据权利要求6所述的存储器,其中所述锁存器设置复位逻辑也经配置以响应于接收对应于读取循环的开始的启用信号关闭所述数据锁存器的所述第一传输门并打开所述数据锁存器的所述第二传输门。

8.根据权利要求1所述的存储器,其进一步包括:

行选择电路,其用于将所述存储器阵列的所选择的行中的存储器单元的所述数据状态施加于其相关联的位线;及

列选择电路,其用于响应于列地址将多个位线中的所选择的一者耦合到所述感测放大器。

9.根据权利要求1所述的存储器,其中所述第一数据状态对应于未经编程的存储器单元状态;

且其中所述第二数据状态对应于经编程的存储器单元状态。

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