[发明专利]一种氧化锌薄膜晶体管的制备方法有效

专利信息
申请号: 201210008323.6 申请日: 2012-01-12
公开(公告)号: CN102544108A 公开(公告)日: 2012-07-04
发明(设计)人: 韩德栋;蔡剑;王漪;王薇;王亮亮;任奕成;张盛东;刘晓彦;康晋锋 申请(专利权)人: 北京大学
主分类号: H01L29/786 分类号: H01L29/786;H01L29/06;H01L21/77
代理公司: 北京万象新悦知识产权代理事务所(普通合伙) 11360 代理人: 贾晓玲
地址: 100871*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 氧化锌 薄膜晶体管 制备 方法
【说明书】:

技术领域

发明涉及一种氧化锌薄膜晶体管的制造方法,属于平板显示领域。

背景技术

目前,OLED平板显示已经开始快速成熟。今年,除索尼表示将大规模研发和生产OLED电视之外,韩国电子业界领军企业——三星电子和LG电子也于今年11月同时发布消息,将在明年年初的国际消费电子展览会(CES)上推出55英寸有机发光二极管(OLED)电视。业界普遍认为,此举将提前拉开OLED电视市场竞争的序幕。

而在有源驱动OLED显示面板方面,以氧化锌及其掺杂半导体材料作为有源区的薄膜晶体管在各个主要性能方面都明显优于传统的非晶硅薄膜晶体管和多晶硅薄膜晶体管:一、氧化锌及其掺杂半导体材料薄膜晶体管具有高迁移率以适应OLED显示模式、快速超大屏幕液晶显示模式和3D显示模式等诸多模式;二、氧化锌及其掺杂半导体材料薄膜晶体管是非晶材料,具有良好一致的电学特性;三、氧化锌及其掺杂半导体材料薄膜晶体管兼容于现在的平板显示技术,能够适用大的玻璃衬底(低温工艺);四、氧化锌及其掺杂半导体材料薄膜晶体管比非晶硅薄膜晶体管和有机薄膜晶体管更加稳定;五、氧化锌及其掺杂半导体材料薄膜晶体管还具有其他优势,比如当尺寸减小时没有短沟道效应,也没有类似与单晶硅的kink效应。

目前,如何高效地制备氧化锌薄膜晶体管是本领域的热点和难点。

发明内容

本发明的目的在于提供一种氧化锌薄膜晶体管的制备方法,可有效地提高氧化锌薄膜晶体管器件的性能。

本发明提供的氧化锌薄膜晶体管,形成于玻璃衬底之上,包括一半导体缓冲层,一源区和一漏区,一半导体导电沟道区,一栅绝缘介质层,一栅电极,所述半导体缓冲层位于玻璃或者塑料衬底之上,所述源漏电极位于半导体缓冲层之上并与沟道区相交叠,所述半导体导电沟道层位于半导体缓冲层及小部分源漏电极之上,所述栅绝缘介质层位于半导体导电沟道层之上,所述栅电极层位于栅绝缘介质层之上。

本发明提供的氧化锌薄膜晶体管制备方法包括以下步骤:

1)首先在玻璃衬底上生长一层半导体缓冲层;

2)在半导体缓冲层上生长一层透明导电薄膜,然后光刻和刻蚀形成源漏电极;

3)甩一层光刻胶,在源漏电极之间包含部分源漏电极的区域内无光刻胶,其余区域被光刻胶覆盖,然后显影,未被光刻胶覆盖的区域为未来的沟道区;

4)溅射生长一层氧化锌及其掺杂的半导体材料层作为半导体导电沟道层;

5)在半导体材料层之上生长一层二氧化硅、氮化硅或者高介电常数绝缘材料介质层或者其叠层组合作为栅介质层;

6)在栅介质层之上生长一层透明导电薄膜作为栅电极层;

7)剥离工艺去除生长在光刻胶之上的半导体材料层、栅介质层和栅电极层这三层叠层;

8)生长一层钝化介质层,光刻和刻蚀形成栅、源和漏的引出孔;

9)生长一层金属薄膜,光刻和刻蚀形成金属电极和互连。

上述方法,步骤1)所生长的氧化物半导体层缓冲层,采用氧化锌及其掺杂半导体材料形成。

所述的制作方法,步骤2)所生长的导电薄膜,可由透明导电材料ITO等形成。

所述的制作方法,步骤4)所生长的氧化物半导体层,采用氧化锌及其掺杂半导体材料形成。

所述的制作方法,步骤5)所生长的栅绝缘介质层,由氧化铝、二氧化硅、氮化硅或者高介电常数绝缘材料形成。

所述的制作方法,步骤6)所生长的导电薄膜,可由透明导电材料形成。

本发明的有益效果:

本发明首先利用半导体缓冲层来增加源漏电极与沟道材料的接触面积,减小源漏接触电阻,然后采用剥离工艺将连续生长的沟道层、栅介质层和栅电极层一起剥离。本发明简化了制造流程,有效减小了源漏端接触电阻,而且关键的沟道层、栅介质层和栅电极层这三层的生长过程完全没有脱离真空环境。本发明优化了器件特性,提高了效率以及成品率。

附图说明

图1为本发明具体实施例所描述的氧化锌薄膜晶体管的剖面结构示意图;

图2为本发明具体实施例所描述的氧化锌薄膜晶体管的俯视结构示;

图3(a)~(f)依次示出了本发明的薄膜晶体管一个制作方法的主要工艺步骤,其中:

图3(b)示意了岛状半导体缓冲层形成的工艺步骤;

图3(c)示意了源漏电极形成的工艺步骤;

图3(d)示意了甩胶光刻的工艺步骤;

图3(e)示意了半导体导电沟道层、栅绝缘介质层和栅电极层生长的工艺步骤;

图3(f)示意了剥离工艺。

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