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[发明专利]管理高速缓存存储区的系统、方法和计算机可读介质-CN201410053087.9有效
发明人： V·B·施瓦山卡拉;S·帕拉麦思沃伦;M·艾什 -专利权人： LSI公司
申请日： 2014-02-17 - 公布日： 2014-09-17 - 主分类号： G06F12/08 文献下载
摘要：本发明涉及管理高速缓存存储区的系统、方法和计算机可读介质。具有高速缓存存储区并且与存储系统关联的高速缓存控制器跨高速缓存控制器的重启地维持保存在高速缓存存储区中的信息。高速缓存控制器与主计算机系统和数据存储系统通信。高速缓存控制器分割高速缓冲存储器以包括元数据部分和日志部分。一个独立的部分用于缓存数据元素。高速缓存控制器将元数据的副本保持在主计算机系统可访问的独立存储器中。当元数据日志达到其容量时，数据被写入高速缓存存储区中。当重启时，元数据被复制回到主计算机系统，遍历元数据日历，以将未被保存的高速缓存中的其它变化复制到数据存储系统。
管理高速缓存存储系统方法计算机可读介质

[发明专利]非均匀存储器访问计算机系统的可重构高速缓存控制器-CN03152412.5无效
发明人：约翰·T·罗宾森 -专利权人：国际商业机器公司
申请日： 2003-07-30 - 公布日： 2004-04-21 - 主分类号： G06F12/12 文献下载
摘要：公开了替换具有组关联高速缓冲存储器的计算机系统中的高速缓存管线的方法和结构。该方法使用可改写高速缓存替换控制阵列建立排序指南，其中通过将数据写到高速缓存替换控制阵列中可以动态改变指南。本发明根据排序指南对不同高速缓存管线的状态进行排序，并且在高速缓存命中失误时替换具有最高排序序号的高速缓存管线。
均匀存储器访问计算机系统可重构高速缓存控制器

[发明专利]存储器侧高速缓存中通路的伺机增加-CN201711090913.7在审
发明人： R·萨桑卡 -专利权人：英特尔公司
申请日： 2017-11-08 - 公布日： 2018-06-29 - 主分类号： G06F3/06 文献下载
摘要：本申请公开了存储器侧高速缓存中通路的伺机增加。处理器包括处理器核以及耦合到该处理器核的高速缓存控制器。高速缓存控制器用于为存储器分配高速缓存中的多个高速缓存条目，其中，处理器核用于：检测安装在计算系统中的所述存储器的量；以及响应于检测到少于所述计算系统的所述存储器的最大可允许量，指示所述高速缓存控制器增加在其中分配所述多个高速缓存条目的所述高速缓存的通路的数量
存储器高速缓存高速缓存控制器处理器核高速缓存条目计算系统存储器分配耦合到检测处理器响应分配申请

[发明专利]数据存储设备中的高速缓存超量配置-CN201710569331.0有效
发明人： S·雅恩亚武拉·文卡塔;M·A·盖特纳;J·G·巴克曼 -专利权人：希捷科技有限公司
申请日： 2017-07-13 - 公布日： 2023-04-14 - 主分类号： G06F12/0871 文献下载
摘要：本发明题为：“数据存储设备中的高速缓存超量配置”。本申请涉及数据存储设备中的高速缓存超量配置。本文所公开的混合数据存储设备包括主数据存储库、一个或多个数据存储高速缓存和数据存储高速缓存管理子系统。所述数据存储高速缓存可以被划分为超量配置部分和通告空间部分。当所述数据存储高速缓存管理子系统接收到写入请求时，所述数据存储高速缓存上对应于所述超量配置部分的数据群集被标记为待定逐出而不会被实际逐出，从而增加有效容量并减少所述数据存储高速缓存的写入放大。
数据存储设备中的高速缓存超量配置

[发明专利]两级高速缓存系统中的自适应高速缓存提升-CN201380012272.7有效
发明人： L·M·古普塔;E·S·埃勒夫塞里奥;I·科尔特斯达斯;胡晓宇;R·普勒特卡;R·哈斯;S·布利尼克;M·T·本哈泽 -专利权人：国际商业机器公司
申请日： 2013-02-18 - 公布日： 2017-03-29 - 主分类号： G06F12/126 文献下载
摘要：提供了一种用于管理第一高速缓存和第二高速缓存中的数据的计算机程序产品、系统和方法。当页面被存储在第二高速缓存中时，针对该页面在第二高速缓存中维护参考计数。确定页面将从第二高速缓存提升至第一高速缓存。响应于确定该参考计数大于零，将该页面添加至第一高速缓存中的最近最少使用(LRU)列表的LRU端。响应于确定该参考计数小于或等于零，将该页面添加至第一高速缓存中的LRU列表的最近最多使用(MRU)端。
两级高速缓存系统中的自适应提升

[发明专利]功率选通高速缓存存储器的一部分-CN201380059598.5有效
发明人： R·王;S·A·艾哈迈德;E·德拉诺;P·J·夏;Z·A·切希蒂;C·麦西奥科;T-Y·C·泰 -专利权人：英特尔公司
申请日： 2013-06-28 - 公布日： 2017-09-08 - 主分类号： G06F12/0802 文献下载
摘要：在一个实施例中，处理器包括多个区块，每一区块都包括核以及区块高速缓存层次结构。此区块高速缓存层次结构包括第一级高速缓存、中级高速缓存(MLC)以及末级高速缓存(LLC)，这些高速缓存中的每一个都是区块私有的。耦合到区块的控制器包括高速缓存功率控制逻辑，该逻辑接收关于区块的核以及区块高速缓存层次结构的利用率信息，并至少部分地基于此信息，导致区块的LLC被独立地功率选通。描述并要求保护其他实施例。
功率高速缓存存储器一部分

[发明专利]用于即时高速缓存关联性的装置、方法和系统-CN201810166324.0在审
发明人： C.威尔克森;Z.基什蒂;Z.王;E.特兰 -专利权人：英特尔公司
申请日： 2018-02-28 - 公布日： 2018-10-23 - 主分类号： G06F12/0864 文献下载
摘要：所提供的是用于即时高速缓存关联性的装置、方法和系统，其用于具有作为用于非易失性存储器的高速缓存的高速缓存位置的高速缓冲存储器。接收针对非易失性存储器中的目标地址的要添加到高速缓冲存储器的数据。根据非易失性存储器中的目标地址确定高速缓冲存储器中的直接映射高速缓存位置。响应于直接映射高速缓存位置存储针对非易失性存储器中的另一地址的数据，在与直接映射高速缓存位置不同的高速缓冲存储器中的可用高速缓存位置处写入针对目标地址的数据。响应于直接映射高速缓存位置不存储针对非易失性存储器中的另一地址的数据，在直接映射高速缓存位置中写入针对目标地址的数据。
直接映射高速缓存非易失性存储器高速缓冲存储器目标地址高速缓存高速缓存位置关联性写入位置存储响应可用存储

[发明专利]存储阵列中使用镜像高速缓存卷来减小驱动开销的系统-CN201010146852.3无效
发明人：马哈茂德·K·杰贝;森蒂尔·卡纳安 -专利权人： LSI公司
申请日： 2010-04-01 - 公布日： 2010-10-13 - 主分类号： G06F3/06 文献下载
摘要：固态装置可以包括写入高速缓存区和读取高速缓存区。读取高速缓存区可以是写入高速缓存区的镜像。抽象层可以配置用来(i)接收多个IO请求，(ii)处理IO请求，以及(iii)将多个IO请求映射到写入高速缓存区和读取高速缓存区。
存储阵列使用高速缓存减小驱动开销系统

[发明专利]末级高速缓存插入策略软件控制方法-CN201210077431.9有效
发明人：程旭;黄涛;管雪涛 -专利权人：北京北大众志微系统科技有限责任公司
申请日： 2012-03-22 - 公布日： 2012-09-12 - 主分类号： G06F12/08 文献下载
摘要：本发明涉及一种末级高速缓存插入策略软件控制方法，首先在处理器页表项中设计末级高速缓存插入策略控制位或控制接口；其次，当数据进入末级高速缓存时，通过判断TLB记录的页一级末级高速缓存插入策略控制位的值，决定该页数据进入末级高速缓存时的位置利用本发明软件可以控制页一级末级高速缓存插入策略，为具有不同局部性特征的区域提供不同的末级高速缓存管理方法，达到降低末级高速缓存污染的目的；本发明应用于任何具有多级高速缓存结构，同时采用虚拟存储机制的计算机系统中
高速缓存插入策略软件控制方法

[发明专利]通过移动通信网的信息传递控制方法和系统-CN02101661.5有效
发明人：舆水敬;笹田浩司 -专利权人：株式会社NTT都科摩
申请日： 2002-01-15 - 公布日： 2002-08-28 - 主分类号： H04L29/06 文献下载
摘要：一种在一个移动通信网中的信息传递的控制方法和系统,其中,当一个移动终端从一个通信区移动到另一个的时候,将一个传递高速缓存信息到移动终端的传递信道中的一个高速缓存节点切换到另一个传递信道中的另一个高速缓存节点,以利用高速缓存节点的高速缓存功能减少网络中的信息业务量。在一个高速缓存节点把高速缓存信息的一部分传递到移动终端之后,另一个高速缓存节点仅传递高速缓存信息的剩余部分。
通过移动通信网信息传递控制方法系统

[发明专利]处理高速缓存未命中的方法和装置-CN200610101870.3有效
发明人： J·D·艾里希;C·B·麦克布莱德;A·H·沃特朗 -专利权人：国际商业机器公司
申请日： 2006-07-12 - 公布日： 2007-06-13 - 主分类号： G06F12/08 文献下载
摘要：所述第一方法包括如下步骤：(1)提供具有多个高速缓存表项的高速缓存，每个表项都适于存储数据，其中所述高速缓存适于由硬件和软件以第一运行模式来访问；(2)判定在所述多个高速缓存表项中的一个高速缓存表项中缺少所需的数据；(3)根据当前运行模式以及与所述多个高速缓存表项关联的提示－锁定位的值来判定状态；以及(4)根据所述状态来判定至少一个所述高速缓存表项的可用性，其中高速缓存表项的可用性指示可以替换存储在所述高速缓存表项中的数据
处理高速缓存命中方法装置

[发明专利]计算每一中央处理单元预取的逻辑块号的最佳数目-CN201711399885.7有效
发明人： K.J.温泽尔 -专利权人：西部数据技术公司
申请日： 2017-12-22 - 公布日： 2022-09-13 - 主分类号： G06F12/0862 文献下载
摘要：预取的数据从存储器预取并被存储在高速缓存中。如果主机装置请求还没有在高速缓存中的数据，则进行关于是否调度数据以写入高速缓存中的判断。如果数据不在高速缓存中并且没有被调度以写入高速缓存中，则数据从存储器恢复并传递到主机装置。如果数据被调度以写入高速缓存中、或者当前正被写入高速缓存中，则恢复数据的请求被延迟或调度，从而一旦数据在高速缓存中就恢复数据。如果数据已经在高速缓存中，则将数据传递到主机装置。
计算每一中央处理单元逻辑最佳数目

[发明专利]多线程事务性存储器一致性-CN201310210525.3无效
发明人：吉列尔莫·J·罗扎斯 -专利权人：辉达公司
申请日： 2013-05-30 - 公布日： 2013-12-18 - 主分类号： G06F9/38 文献下载
摘要：本公开提供用于在多线程处理环境下维持高速缓存一致性的系统和方法。对于数据高速缓存中的每个位置，维持指定高速缓存位置相对于其他数据高速缓存和/或相对于支持数据高速缓存的共享存储器资源的一致性的全局状态。对于每个高速缓存位置，维持与多个线程相关联的线程状态信息。线程状态信息除全局状态以外并与全局状态分开地被加以指定，并且用来独立地控制用于高速缓存位置的对每个线程的读和写许可。线程状态信息还例如由高速缓存控制器用来控制是否将回滚与高速缓存位置相关的线程的未提交事务。
多线程事务性存储器一致性

[发明专利]指令高速缓存功耗降低-CN201310008129.2无效
发明人：安尼施·阿加沃尔;罗斯·泽格尔肯;凯温·科朔雷克 -专利权人：辉达公司
申请日： 2013-01-09 - 公布日： 2013-07-10 - 主分类号： G06F12/08 文献下载
摘要：在一个实施例中，一种用于控制包括最近最少使用位阵列、标签阵列和数据阵列的指令高速缓存的方法，包括：在最近最少使用位阵列中查找用于指令高速缓存中的多个高速缓存线集合的每一个的最近最少使用位，基于用于指定高速缓存线的最近最少使用位来确定多个高速缓存线集合的指定高速缓存线集合中的最近最多使用通路，在标签阵列中查找用于指定高速缓存线集合中一个或多个通路的标签，在数据阵列中查找存储在高速缓存线集合中的最近最多使用通路中的数据，以及如果在最近最多使用通路中存在高速缓存命中，则从数据阵列中检索存储在最近最多使用通路中的数据
指令高速缓存功耗降低

[发明专利]用于对芯片多处理器的共享高速缓存器分区的设备和方法-CN200510098071.0无效
发明人： M·马蒂娜;A·胡安－奥米戈;J·埃默;R·马塔斯－纳瓦罗 -专利权人：英特尔公司
申请日： 2005-06-30 - 公布日： 2006-02-01 - 主分类号： G06F12/08 文献下载
摘要：描述一种用于对芯片多处理器的共享高速缓存器分区的方法和设备。在一个实施例中，该方法包括如果依照从处理器接收的请求检测到共享高速缓存器内高速缓存器未命中，则从系统存储器请求高速缓存器块。一旦请求高速缓存器块，就依照处理器标识符和接收请求的请求类型选择共享高速缓存器内的牺牲块。在一个实施例中，依照处理器标识符和请求类型的牺牲块选择是基于成组相联的共享高速缓存器的分区，从而依照高速缓存器分区限制从可利用高速缓存器路径的子集中选择牺牲块。描述并主张了其他实施例。
用于芯片处理器共享高速缓存分区设备方法