专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]逻辑器件配置方法及装置-CN201510331399.6在审
  • 刘佳妮 - 中兴通讯股份有限公司
  • 2015-06-15 - 2017-01-11 - G06F9/445
  • 本发明提供了一种逻辑器件配置方法及装置,其中,该方法包括:指定通用输入/输出口GPIO将地址信号发送至逻辑器件;其中,该地址信号用于指示逻辑器件的地址;在GPIO将地址信号发送至逻辑器件之后,同一指定GPIO将用于写入该逻辑器件的数据信号发送至该逻辑器件。通过本发明解决了相关技术中在配置逻辑器件的过程中要求使用特定的访问接口,并且设计电路复杂的问题,进而实现了对CPU所需提供的接口要求低,节省了接口资源的效果。
  • 逻辑器件配置方法装置
  • [发明专利]可编程逻辑器件配置以及可编程逻辑器件-CN202210896739.X有效
  • 张树强;夏冰冰;石拓 - 北京一径科技有限公司
  • 2022-07-28 - 2022-11-15 - G01S7/48
  • 本申请公开了可编程逻辑器件配置以及可编程逻辑器件,可以应用于激光雷达技术领域。该配置的方法包括:获取针对可编程逻辑器件的代码;获取针对可编程逻辑器件的约束信息,约束信息指示可编程逻辑器件中的一锁定区域,锁定区域中用于输出一信号的寄存器和缓冲器连接;基于代码并根据约束信息,确定可编程逻辑器件的第一配置信息;基于第一配置信息,配置可编程逻辑器件。本申请实现了不同版本的可编程逻辑器件对激光雷达的控制的一致性,简化了逻辑锁定操作,同时提高了可靠性。
  • 可编程逻辑器件配置以及
  • [发明专利]集成电路(IC)和用于形成集成电路的方法-CN202010485643.5在审
  • 吴伟成;邓立峯 - 台湾积体电路制造股份有限公司
  • 2020-06-01 - 2020-12-01 - H01L27/11529
  • 本申请的各个实施例涉及IC器件和相关的形成方法。在一些实施例中,存储区域和逻辑区域集成在衬底中。存储单元结构设置在存储区域上。多个逻辑器件设置在逻辑区域的多个逻辑子区域上。第一逻辑器件设置在第一逻辑子区域的第一上表面上。第二逻辑器件设置在第二逻辑子区域的第二上表面上。第三逻辑器件设置在第三逻辑子区域的第三上表面上。逻辑子区域的第一、第二和第三上表面的高度单调减小。通过将逻辑器件布置在衬底的多个凹进位置,可以提高设计灵活性,并且更适合具有多个工作电压的器件。本发明的实施例还涉及集成电路(IC)和用于形成集成电路的方法。
  • 集成电路ic用于形成方法
  • [发明专利]一种交互式可编程逻辑器件互联服务器系统-CN202111669202.1有效
  • 张明哲;段雪珂 - 苏州浪潮智能科技有限公司
  • 2021-12-30 - 2023-05-26 - G06F13/12
  • 本发明属于服务器互联设计技术领域,具体提供一种交互式可编程逻辑器件互联服务器系统,包括主可编程逻辑器件,用于通过低压差分信号链路管理服务器主板和时序可编程逻辑器件的桥接信号;调试可编程逻辑器件,用于传递基于IO的信号;时序可编程逻辑器件,用于独立引导CPU并管理电源时序;专用可编程逻辑器件,用于负责系统的软件更新;低压差分信号链路,用于将主可编程逻辑器件侧的I2C信号、GPIO信号、异步收发信号、内存映射信号进行编码设计通过低压差分信号传输到时序可编程逻辑器件侧充分利用可编程逻辑器件特有功能,来降低CPU core利用数量,大大降低开发难度,节省人力。
  • 一种交互式可编程逻辑器件服务器系统
  • [实用新型]一种无逻辑器件的边沿检测电路-CN202222166447.9有效
  • 王焕永;黎炳平 - 厦门凯胜诺科技有限公司
  • 2022-08-17 - 2023-01-10 - G01R31/28
  • 本实用新型涉及检测技术领域,公开一种无逻辑器件的边沿检测电路。包括:边沿检测电路包括:电源输入模块、信号发生模块、信号负载模块和无逻辑器件控制模块,电源输入模块的电源输入端连接外部电源,电源输入模块的电源输出端连接无逻辑器件控制模块的电源输入端,信号发生模块的信号输出端连接无逻辑器件控制模块的信号输入端,无逻辑器件控制模块的信号输出端连接信号负载模块的信号输入端。采用电源输入模块、信号发生模块、信号负载模块和无逻辑器件控制模块,实现简单可靠、无需任何逻辑器件和无需集成芯片,以及低成本,可靠性高等。无逻辑器件控制模块,实现无逻辑器件的边沿检测电路的INPUT端有一个电平变化时,会在OUTPUT端输出一个短时脉冲。
  • 一种逻辑器件边沿检测电路
  • [实用新型]运动控制器-CN201520455251.9有效
  • 杨春 - 深圳市得意自动化科技有限公司
  • 2015-06-17 - 2015-11-25 - G05B19/042
  • 本实用新型公开了一种运动控制器,包括:一ARM处理器,通过总线连接一现场可编程逻辑器件;一数字信号处理器,通过并行总线与现场可编程逻辑器件连接;至少一非易失性存储器和一动态存储器,用于数字信号处理器与现场可编程逻辑器件的数据存储和交换;一复杂可编程逻辑器件,通过串行通信协议与数字信号处理器实现数据的传输,复杂可编程逻辑器件连接一数字模拟转换器件,实现数字模拟转换。现场可编程逻辑器件或复杂可编程逻辑器件用以扩展IO接口和通讯接口,实现逻辑信号处理和扩展通讯功能的独立设置,简化运动控制器装置,通过复杂可编程逻辑器件逻辑功能实现了不同功能子模块的外围接口扩展,便于维护升级
  • 运动控制器
  • [发明专利]电路组件和可编程逻辑器件配置方法、设备及存储介质-CN202211485112.1在审
  • 何波;包朝伟 - 深圳市紫光同创电子有限公司
  • 2022-11-24 - 2023-04-04 - G06F9/30
  • 本申请公开了一种电路组件和适用于所述电路组件的可编程逻辑器件配置方法、设备及存储介质。该电路组件包括电路板、处理器模块和多个可编程逻辑器件,处理器模块和多个可编程逻辑器件设置在电路板上,处理器模块通过配置总线连接多个可编程逻辑器件,处理器模块用于通过配置总线读取多个可编程逻辑器件内部寄存器中的器件标识、基于器件标识确定匹配的预存位流文件、并将匹配的预存位流文件通过配置总线加载至相对应的可编程逻辑器件。本申请可以基于可编程逻辑器件中的器件标识匹配选择相对应的预存位流文件、并加载至可编程逻辑器件以实现其功能配置,因而可以在不需增加额外物料和成本前提下,方便地识别多种类可编程逻辑器件并进行加载管理。
  • 电路组件可编程逻辑器件配置方法设备存储介质
  • [发明专利]一种逻辑代码调试方法、装置、设备及存储介质-CN202110871216.5在审
  • 周宁宁;张中云;张亚男 - 郑州云海信息技术有限公司
  • 2021-07-30 - 2021-11-26 - G06F11/36
  • 发明公开了一种逻辑代码调试方法、装置、设备及存储介质,该方法包括:接收访问指令,并获取访问指令中携带的器件标识;其中,访问指令为进行逻辑代码调试的过程中需要访问相应器件时生成的;如果器件标识对应的器件为真实的物理器件或者硬件驱动,则到硬件动态库中访问与器件标识对应的物理器件或者硬件驱动,并将访问所得的数据返回,以供实现逻辑代码的调试;如果器件标识对应的器件为虚拟器件,则到虚拟动态库中访问与器件标识对应的虚拟器件,并将访问所得的数据返回,以供实现逻辑代码的调试;其中,虚拟器件为模拟相应真实的物理器件的文件。可见,本申请能够保证逻辑代码的快速调试,进而有效提高逻辑代码的调试效率。
  • 一种逻辑代码调试方法装置设备存储介质
  • [发明专利]一种逻辑芯片及电子设备-CN202080107280.X在审
  • 冯君校;景蔚亮;叶力;王正波 - 华为技术有限公司
  • 2020-12-30 - 2023-07-25 - H10N50/00
  • 本申请的实施例提供一种逻辑芯片及电子设备,涉及逻辑运算领域,可在同一基片上同时实现具有NAND功能的磁畴壁逻辑器件和具有NOR功能的磁畴壁逻辑器件,更适合工业应用。该逻辑芯片,包括多个磁畴壁逻辑器件,磁畴壁逻辑器件包括设置在基片上的输入极、偏置极以及输出极,其中输入极以及偏置极通过连接区域连接输出极;输入极或偏置极的磁化方向经连接区域后在输出极输出相反的磁化方向;多个磁畴壁逻辑器件中的一部分磁畴壁逻辑器件的偏置极具有第一磁化方向,另一部分磁畴壁逻辑逻辑器件的偏置极具有第二磁化方向;其中第一磁化方向与第二磁化方向相反。
  • 一种逻辑芯片电子设备
  • [发明专利]一种相位噪声非线性放大方法及装置-CN201910893880.2有效
  • 张建国;杜海鋆;王云才;李璞;王安帮;刘峰 - 太原理工大学
  • 2019-09-20 - 2023-05-16 - H03L7/093
  • 本发明属于集成电路技术领域,具体为一种相位噪声非线性放大方法及装置;具体包括环形振荡器,环形振荡器由M个逻辑器件组成,0节点的逻辑器件执行异或非操作,其余节点的逻辑器件执行异或操作;每个节点逻辑器件的两个输入端分别连接相邻两个节点逻辑器件的输出端;每个节点的逻辑器件两个输入由相邻两个逻辑门提供,经逻辑运算后的输出反馈给相邻两个节点的逻辑器件的输入,环形振荡器中所有节点的逻辑器件均可以输出信号;本发明只需要少量的数字逻辑门就可以将周期振荡中的相位噪声进行非线性放大产生宽带相位噪声信号
  • 一种相位噪声非线性放大方法装置

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