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[实用新型]RS编码解码装置-CN200920251324.7无效
发明人：张鹏泉;曹晓冬;谢建庭;范玉进;赵维兵;宋光伟;李柬;苏红;孙光 -专利权人：天津光电通信技术有限公司
申请日： 2009-12-04 - 公布日： 2010-08-04 - 主分类号： H03M13/15 文献下载
摘要：本实用新型涉及RS编码解码装置，可编辑逻辑器件的内部结构为控制器通过控制线分别与RS编码器，RS解码器、编码输入存储器、解码输入存储器、编码输出存储器、解码输出存储器连接，控制器根据控制需求进行方式配置与过程控制，编码输入存储器通过数据线依次与RS编码器、编码输出存储器连接，解码输入存储器通过数据线依次与RS解码器、解码器输出存储器连接；控制端口通过控制总线与控制器连接，数据输入端口通过数据总线分别与编码输入存储器、解码输入存储器连接，数据输出端口通过数据总线分别与编码输出存储器、解码输出存储器连接，RS编码器、RS解码器可完成五种码型的RS编码、RS解码。
rs 编码解码装置

[实用新型]BCH编码解码电路-CN201020600102.4无效
发明人：曹晓冬;吕前进;张鹏泉;李续;范玉进;赵维兵;张波;李柬;刘欣;宋光伟;王文亮 -专利权人：天津光电通信技术有限公司
申请日： 2010-11-10 - 公布日： 2011-07-13 - 主分类号： H03M13/15 文献下载
摘要：本实用新型涉及一种BCH编码解码电路，包括FPGA器件，FPGA器件的内部电路连接为：控制器通过控制线分别与编码输入存储器、BCH编码器、编码输出存储器、解码输入存储器、BCH解码器、解码输出存储器连接，编码输入存储器、编码输出存储器分别通过数据线与BCH解码器连接，解码器输入存储器、解码输出存储器分别通过数据线与BCH解码器连接。本实用新型的特点是：1、备选码型丰富，可配置为任意n<1024的BCH码，控制方式简单，操作灵活方便；2、采用专门设计的编解码算法，运算快捷；3、采用可编程逻辑器件实现，结构简单，可靠性高。
bch 编码解码电路

[发明专利]利用存储器阵列的掩蔽训练和分析-CN202210472631.8在审
发明人： W·A·斯皮尔科;P·A·拉斯马森;T·海因 -专利权人：美光科技公司
申请日： 2022-04-29 - 公布日： 2022-11-04 - 主分类号： G06F13/16 文献下载
摘要：本申请涉及利用存储器阵列的掩蔽训练和分析。存储器装置可在第一模式中操作，其中所述存储器装置的存储器阵列的最大过渡避免MTA解码器停用。在所述第一模式期间，所述存储器装置可耦合所述MTA解码器的输入节点与第一解码器的第一输出节点，所述第一解码器例如第一脉冲幅度调制PAM解码器。所述存储器装置可在第二模式中操作，其中所述存储器阵列的所述MTA解码器启用。在所述第二模式期间，所述存储器装置可耦合所述MTA解码器的所述输入节点与第二解码器的第二输出节点，所述第二解码器例如第二PAM解码器。
利用存储器阵列掩蔽训练分析

[实用新型]音视频编解码电路-CN201821224840.6有效
发明人：蔡炜 -专利权人：广州爱易学智能信息科技有限公司
申请日： 2018-07-31 - 公布日： 2019-03-05 - 主分类号： H04N19/42 文献下载
摘要：本实用新型公开了一种音视频编解码电路，包括控制器、编码输入存储器、音视频编码器、编码输出存储器、解码输入存储器、音视频解码器、解码输出存储器、数据输入端口、数据输出端口、控制端口和电源模块，控制端口与控制器连接，控制器分别与编码输入存储器、音视频编码器、编码输出存储器、解码输入存储器、音视频解码器和解码输出存储器连接；电源模块包括电压输入端、电压输出端、第一三极管、第二三极管、第一电容、第二电容、第一电阻、第二电阻
电阻三极管音视频编解码电路编码输出存储器编码输入存储器解码输入存储器音视频编码器音视频解码器本实用新型电源模块控制端口控制器电容解码输出存储器数据输出端口数据输入端口电压输出端电压输入端控制器连接输出存储器电路结构时基芯片电路维护

[发明专利]再现设备、数据处理系统、再现方法、程序以及存储介质-CN200510121709.8无效
发明人：纲岛修二;柴田正二郎;高村元嗣;小薮恭平;柿田新次郎 -专利权人：索尼株式会社
申请日： 2005-10-26 - 公布日： 2006-08-16 - 主分类号： H04N5/93 文献下载
摘要：一种用于连续解码并再现多个画面数据的再现设备，包括再现存储器和解码器，该解码器用于以按照指定的再现方向的顺序连续地解码多个画面数据，将解码结果写入该再现存储器中，并对从该再现存储器中读取的解码结果进行再现和输出，该解码器甚至当存储在再现存储器中的解码结果在按所指定的再现方向继续再现时不再使用之后，仍在再现存储器中保持对解码结果的存储，并且当接收到再现方向的反向命令作为输入时，使用在输入反向命令之前已经存储在再现存储器中的解码结果来执行再现和输出
再现设备数据处理系统方法程序以及存储介质

[发明专利]能够进行高速处理的半导体存储装置-CN200310104710.0无效
发明人：加藤光司;大岛成夫 -专利权人：株式会社东芝
申请日： 2003-10-31 - 公布日： 2004-05-26 - 主分类号： G11C11/34 文献下载
摘要：本发明的半导体存储装置具备存储器单元阵列、指令解码器和输入输出控制电路。存储器单元阵列由排列的多个存储数据的存储器单元构成。指令解码器对从外部输入的指令进行解码。输入输出控制电路依据从上述指令解码器的输出，控制向上述存储器单元的数据写入、向外部的数据输出。所以，在指示写入的写指令被输入到上述指令解码器时从外部取得的写入数据在输入了上述写指令后输入了2次后的写指令的定时，被写入到上述存储器单元。
能够进行高速处理半导体存储装置

[发明专利]信息处理设备和信息处理方法-CN200710110394.6无效
发明人：小薮恭平;柴田正二郎;纲岛修二;白根庆太;田中一好;高桥贵笵 -专利权人：索尼株式会社
申请日： 2007-06-13 - 公布日： 2007-12-19 - 主分类号： H04N5/92 文献下载
摘要：一种解码编码流的信息处理设备，包含：存储器，用于存储所述编码流；解码器，用于通过解码存储器中存储的编码流来生成图像数据；存储器传输控制器，用于控制传输，以便在用于输出图像数据的定时之前将编码流传输到存储器；以及解码控制器，用于控制由所述解码器进行的解码，以便在所述存储器中存储的编码流中优先解码在画面解码过程中被参考的参考画面。
信息处理设备方法

[发明专利]非易失性存储器接口-CN202010565278.9在审
发明人： S.米塔尔;S.巴蒂亚;V.加塔瓦德 -专利权人：桑迪士克科技有限责任公司
申请日： 2020-06-19 - 公布日： 2021-09-28 - 主分类号： G06F3/06 文献下载
摘要：本发明题为“非易失性存储器接口”。一种电路，该电路包括非易失性存储器阵列、输入/输出(IO)电路、解码器电路、控制电路和读/写电路。非易失性存储器阵列耦接到地址解码器，该地址解码器识别非易失性存储器阵列内用于存储命令的位置。IO电路通过控制总线耦接到解码器电路。解码器电路从由IO电路通过数据总线接收的固定长度命令序列解码命令地址和存储命令。解码器电路可包括用于解码和并行操作的串行输入并行输出(SIPO)电路。控制电路耦接到IO电路和解码器电路并生成控制信号以执行经解码的存储命令。读/写电路耦接到非易失性存储器阵列和控制电路。读/写电路响应于存储命令在非易失性存储器阵列和IO电路之间传输数据。
非易失性存储器接口

[发明专利]具有对称的读取电流曲线的存储器及其读取方法-CN201711057032.5有效
发明人：陈宇翔;周绍禹;张君豪;吴旻信;池育德 -专利权人：台湾积体电路制造股份有限公司
申请日： 2017-10-27 - 公布日： 2022-01-04 - 主分类号： G11C11/413 文献下载
摘要：本发明提供了一种具有对称的读取电流曲线的存储器。存储器包括由多个存储器单元形成的第一存储器阵列，由多个存储器单元形成的第二存储器阵列以及读取电路。读取电路包括连接至第一存储器阵列的第一解码器，连接至第二存储器阵列的第二解码器以及输出缓冲器。第一解码器根据第一地址信号从第一存储器阵列获得第一数据。第二解码器根据第一地址信号从第二存储器阵列获得第二数据。输出缓冲器根据控制信号选择性地提供第一数据或第二数据作为输出。第一数据与第二数据互补。本发明还提供了存储器的读取方法。
具有对称读取电流曲线存储器及其方法

[发明专利]包括状态电路的存储器装置及其操作方法-CN201711347720.5有效
发明人：吴文熙;柳济民;吴凜;尹载允 -专利权人：三星电子株式会社
申请日： 2017-12-15 - 公布日： 2023-05-02 - 主分类号： G11C29/04 文献下载
摘要：提供包括状态电路的存储器装置及其操作方法。一种存储器装置包括命令解码器和状态电路。命令解码器对命令进行解码。状态电路顺序地存储基于解码的命令确定的所述存储器装置的操作信息，并响应于输出控制信号而输出顺序存储的操作信息中的至少一个。
包括状态电路存储器装置及其操作方法

[发明专利]具有回放操作模式并包括两个缓冲存储器的数字解码器-CN03136278.8有效
发明人：塞巴斯蒂安·弗拉勒;安德烈·马格拉思;蒂里·凯里 -专利权人：汤姆森许可贸易公司
申请日： 2003-05-15 - 公布日： 2003-11-26 - 主分类号： H04N5/455 文献下载
摘要：一种用于电视接收机的数字解码器，包括：接收数字的音频/视频信号的输入端、将输入信号解调或解码为可以由电视接收机使用的输出信号的装置、和第一缓冲存储器，在解码器处于“实况”模式时，解调后的输入信号被转移到第一缓冲存储器在“回放”模式，在第一缓冲存储器中记录的信号构成了解码器输出的信号。该解码器包括第二缓冲存储器，当解码器处于“回放”模式时，解调以后的输入信号被转移第二缓冲存储器。当解码器从“回放”模式切换到“返回实况”模式时，记录于第二缓冲存储器中的信号构成了输出信号。在“返回实况”模式，在解码器切换回“实况”模式以前，用户以较高的速度浏览记录于第二缓冲存储器中的视频片断。
具有回放操作模式包括两个缓冲存储器数字解码器

[发明专利]解码装置及操作方法-CN202210690817.0在审
发明人：李美姸 -专利权人：三星电子株式会社
申请日： 2022-06-17 - 公布日： 2023-02-17 - 主分类号： H04N19/44 文献下载
摘要：提供了解码装置及操作方法，解码装置包括：控制器，基于由矩阵定义并包括在帧中的多个块将比特流分类为第一比特流和第二比特流；第一解码器，包括对第一比特流执行解码并输出第一解码数据的第一处理器和第一存储器；第二解码器，包括对第二比特流执行解码并输出第二解码数据的第二处理器和第二存储器；第一缓冲器，将第一解码数据发送到第二存储器；和第二缓冲器，将第二解码数据发送到第一存储器。第一处理器控制第二存储器存储第一解码数据，并且第二处理器控制第一存储器存储第二解码数据。
解码装置操作方法

[发明专利]再生方法及再生装置-CN99118534.X无效
发明人：本城正博 -专利权人：松下电器产业株式会社
申请日： 1999-09-07 - 公布日： 2000-04-05 - 主分类号： H04N5/93 文献下载
摘要：本发明提供的再生方法和再生装置,将现在显示着的帧之前的过去的编码数据流或过去的解码图像数据储存起来,在显示过去的图像时,用该储存的数据,可极力缩短直到显示过去图像之前的时间。它设有读出图像信号的再生头6、使该读出的编码数据流再生的再生电路7、暂时存储上述编码数据流的第1存储器1从第1存储器1中读出上述编码数据流并解码的解码电路8、从解码电路8将解码图像暂时存储起来的第2存储器2、把来自第2存储器2或解码电路8的解码图像数据作为图像信号输出显示的输出电路9、设在第1存储器1的输出端的用于存储过去数据的第3存储器3。
再生方法装置

[实用新型]传输数据可靠的BCH编码及解码电路-CN201420115196.4有效
发明人：周惠;李甲林;廖常武 -专利权人：南京工业职业技术学院
申请日： 2013-11-18 - 公布日： 2014-09-03 - 主分类号： H03M13/15 文献下载
摘要：本实用新型涉及一种传输数据可靠的BCH编码及解码电路,包括：对输入信号进行编码的编码单元，用于对编码信号进行解码的解码单元，串行转并行模块；所述编码单元包括：与输入信号相连的编码输入存储器，与该编码输入存储器相连的BCH编码器，与该BCH编码器相连的编码输出存储器；所述编码输出存储器与串行转并行模块相连；所述解码单元包括：与所述串行转并行模块相连的BCH解码器，与该BCH解码器相连的解码输出存储器；分别与所述BCH编码器、BCH解码器相连的用于选择BCH码型的控制器。本实用新型通过的编码、解码单元中的相应电路模块实现了BCH的编码和解码的功能，其具有结构简单、可靠性好、成本低的特点。
传输数据可靠 bch 编码解码电路

[实用新型]一种BCH编码及解码电路-CN201320732782.9有效
发明人：李兆方;周立新;陆毅;沈克强;周霄翮;王丰华;沈琳;潘瑜;罗印升;金磊;刘勇;范洪辉;薛达新;王骞;杨强;蒋陈铭 -专利权人：常州市武进广播电视信息网络有限责任公司;江苏理工学院;常州香传电子商务有限公司
申请日： 2013-11-18 - 公布日： 2014-05-14 - 主分类号： H03M13/15 文献下载
摘要：本实用新型涉及一种BCH编码及解码电路,包括：对输入信号进行编码的编码单元，用于对编码信号进行解码的解码单元，串行转并行模块；所述编码单元包括：与输入信号相连的编码输入存储器，与该编码输入存储器相连的BCH编码器，与该BCH编码器相连的编码输出存储器；所述编码输出存储器与串行转并行模块相连；所述解码单元包括：与所述串行转并行模块相连的BCH解码器，与该BCH解码器相连的解码输出存储器；分别与所述BCH编码器、BCH解码器相连的用于选择BCH码型的控制器。本实用新型通过的编码、解码单元中的相应电路模块实现了BCH的编码和解码的功能，其具有结构简单、可靠性好、成本低的特点。
一种 bch 编码解码电路

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