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[发明专利]振荡电路设计辅助方法、振荡电路设计辅助系统以及振荡电路设计辅助程序-CN202080021828.9在审
发明人：高尾真辅;黑坂昌弘;西尾浩伸;七役强 -专利权人：株式会社村田制作所
申请日： 2020-11-18 - 公布日： 2022-01-04 - 主分类号： G06F30/36 文献下载
摘要：本发明涉及振荡电路设计辅助方法、振荡电路设计辅助系统以及振荡电路设计辅助程序。是辅助安装有振荡用IC芯片以及振子的电路基板中的振荡电路条件的设计的振荡电路设计辅助方法，包括：第一接受工序，接受与振荡用IC芯片有关的IC芯片信息的输入；第一提供工序，提供基于IC芯片信息决定的、振子样本数据以及振荡电路条件样本数据；第二接受工序，接受当与振子样本数据对应的振子被安装在电路基板的情况下，基于振荡电路条件样本数据测定的频率测定信息的输入；以及第二提供工序，提供与至少基于频率测定信息决定的振荡电路条件适合数据有关的信息
振荡电路设计辅助方法系统以及程序

[发明专利]集成电路设计的增量寄存器重定时-CN201610800831.6有效
发明人： N·辛纳杜莱;G·R·邱 -专利权人：阿尔特拉公司
申请日： 2016-09-01 - 公布日： 2020-06-16 - 主分类号： G06F30/34 文献下载
摘要：本发明涉及集成电路设计的增量寄存器重定时。第一电路设计描述可以具有寄存器和组合门。电路设计计算设备可以对第一电路设计描述执行寄存器重定时，由此在第一电路设计实现过程中跨组合门移动寄存器。第一电路设计的工程变更指令(ECO)可以引起第二电路设计。可以将第一与第二电路设计之间的差异限制到变化区域。电路设计计算设备可以在第二电路设计实现过程中保存来自第一电路设计实现的结果以及这些结果的重复使用部分。例如，电路设计计算设备可以针对第二电路设计的、在变化区域之外的部分保存来自第一电路设计实现的寄存器重定时方案，并增量地创建允许在第二电路设计实现过程中增量地解决寄存器重定时问题的图。
集成电路设计增量寄存器重定时

[发明专利]基于大语言模型的电路设计方法、装置、电子设备及介质-CN202310641979.X在审
发明人：丁凯;徐成斌;陈锐;祝维靖;许鹏;华志强;罗大思 -专利权人：长园深瑞能源技术有限公司
申请日： 2023-05-31 - 公布日： 2023-08-29 - 主分类号： G06F30/392 文献下载
摘要：本申请公开了一种基于大语言模型的电路设计方法、装置、电子设备及介质，基于大语言模型的电路设计方法，包括：获取当前电路设计参数；根据当前电路设计参数以及大语言模型，获取电路设计软件的驱动参数；根据驱动参数，驱动电路设计软件绘制对应的电路图。本方法实现了在电路设计过程中，根据当前电路设计参数以及大语言模型，自动驱动电路设计软件绘制对应的电路图，绘制电路图花费的时长较短，提高了电路设计效率。
基于语言模型电路设计方法装置电子设备介质

[发明专利]基于人工智能进行电路设计的方法及装置-CN201711262529.0在审
发明人：不公告发明人 -专利权人：石家庄创天电子科技有限公司
申请日： 2017-12-04 - 公布日： 2019-06-11 - 主分类号： G06F17/50 文献下载
摘要：本申请实施例提供了一种基于人工智能进行电路设计的方法及装置，方法包括如下步骤：根据预先设定的初始化电路元素进行电路设计的初始化；基于人工智能算法创建多个电路设计域；对每个电路设计域匹配价值评估值；根据每个电路设计域的价值评估值以及设计库进行电路设计，从而降低了电路设计过程中风险，提高了电路设计的质量，最终提高了电路设计的效率。
电路设计人工智能价值评估电路设计过程人工智能算法初始化电路初始化匹配创建申请

[发明专利]集成电路设计制造方法以及集成电路设计系统-CN201510859455.3有效
发明人：黄旭霆;刘如淦;周硕彦;高蔡胜 -专利权人：台湾积体电路制造股份有限公司
申请日： 2015-11-30 - 公布日： 2020-10-23 - 主分类号： G06F30/392 文献下载
摘要：本发明提供一集成电路设计制造方法以及集成电路设计系统。该集成电路设计制造方法包括：接收一集成电路版图文件；以及对集成电路版图文件执行一反式电子束技术工艺以产生一最终掩膜图案，其中反式电子束技术工艺使用一单一反式电子束技术模型以模拟一掩膜工艺以及晶圆工艺。
集成电路设计制造方法以及系统

[发明专利]非同步电路设计工具及计算机程序-CN200610006145.8有效
发明人：唐木信雄;李德群 -专利权人：精工爱普生株式会社
申请日： 2006-01-19 - 公布日： 2006-07-26 - 主分类号： G06F17/50 文献下载
摘要：一种非同步电路设计工具，包含具有转换机构的翻译机，所述转换机构将由非同步电路设计语言描述的代码转换为同步电路设计用的硬件描述语言，所述非同步电路设计语言是附加有使非同步进程间通信成为可能的基本要素的所述同步电路设计用的硬件描述语言通过将由非同步电路设计语言描述的代码，转换为同步电路设计用的硬件描述语言，能够用同步电路用的市售仿真器对电路设计进行功能验证。从而，能够提供一种非同步电路设计工具，使得熟悉工业界广泛普及的同步电路设计的硬件描述语言的技术人员，能够比较容易地进行非同步电路设计。
同步电路设计工具计算机程序

[发明专利]印刷电路板的电路设计模拟系统及其电路设计方法-CN201310625242.5在审
发明人：林凤玲;张瑞荣;郭文瑞 -专利权人：纬创资通股份有限公司
申请日： 2013-11-28 - 公布日： 2015-05-20 - 主分类号： G06F17/50 文献下载
摘要：本发明涉及印刷电路板的电路设计模拟系统及其电路设计方法。该电路设计方法，适用于一印刷电路板。经由一布局工具的一使用者界面，得到一第一使用者输入，其中第一使用者输入是指示使用者界面中印刷电路板的一线路图的一物件被选取。根据物件的一属性，从一数据库中得到对应于属性的多个制约设定。
印刷电路板电路设计模拟系统及其方法

[发明专利]印刷电路板的电路设计模拟系统及其电路设计方法-CN201210351466.7无效
发明人：游苇凡;亚力斯;张瑞荣 -专利权人：纬创资通股份有限公司
申请日： 2012-09-20 - 公布日： 2014-03-26 - 主分类号： G06F17/50 文献下载
摘要：本发明提供一种电路设计方法，适用于一印刷电路板。经由一使用者介面，得到欲设置在上述印刷电路板的一集成电路的复数规格参数。根据上述规格参数，得到上述集成电路于上述印刷电路板的一扇出脚位。根据上述扇出脚位以及上述规格参数，决定上述印刷电路板的一工艺类型。根据上述工艺类型，得到设置上述集成电路于上述印刷电路板所需的一印刷电路板层数以及一密度值。通过本发明提供的设计方法，可对印刷电路板层数、密度值与工艺类型进行自动模拟分析与判断，从而替代费时又费力的人工作业模式。
印刷电路板电路设计模拟系统及其方法

[发明专利]电路设计方法和相关电路-CN202011367509.1在审
发明人：吴宗叡 -专利权人：瑞昱半导体股份有限公司
申请日： 2020-11-27 - 公布日： 2022-05-31 - 主分类号： G06F21/72 文献下载
摘要：本申请提出一种电路设计方法和相关电路，该电路设计方法用来产生一电路，该方法包括：在特定电路单元的周围设置多个攻击检测电路，其中该特定电路单元位于该电路中；依据该些攻击检测电路的数量决定该电路所需的多个备用晶胞的数量；以及依据该些备用晶胞的数量将该些备用晶胞摆放于该电路中。
电路设计方法相关电路

[发明专利]用于在寄存器重定时之后探测信号的方法和装置-CN201610315631.1有效
发明人： G·R·邱 -专利权人：阿尔特拉公司
申请日： 2016-05-13 - 公布日： 2020-02-21 - 主分类号： G06F30/30 文献下载
摘要：一种电路设计可以具有寄存器和组合门。电路设计计算设备可以在电路设计中执行寄存器重定时，藉此，寄存器移动跨越各组合门。可以记录与寄存器移动有关的信息，并创建修改的电路设计。电路设计计算设备可以在集成电路中实施电路设计。逻辑分析器可以用于实时并高速地调试在集成电路中实施的电路设计。为促进调试过程，电路设计计算设备可以基于在寄存器重定时期间记录的信息来增加集成电路和/或补偿寄存器重定时。
用于寄存器重定时之后探测信号方法装置

[发明专利]计算机辅助电路设计及布局的方法-CN01140145.1无效
发明人：张有权 -专利权人：英业达股份有限公司
申请日： 2001-11-27 - 公布日： 2003-06-04 - 主分类号： G06F17/50 文献下载
摘要：一种计算机辅助电路设计及布局的方法，其可用以设计及产生制造电路板所需的电路设计图及电路布局图；并可在变更组件布局方式时，协助设计及布局人员核对变更后的电路设计图是否无误，藉此而确保最后完成的电路布局图为完全正确此计算机辅助电路设计及布局的方法的特点在于计算机辅助电路设计工具完成电路设计图的设计工作之后，接着即将电路设计图中的每一个电路组件的名称、布局位置、和属性整理成一电路组件清单；若以后电路设计图有变更设计的情况，则将电路设计图的前后版本的电路组件清单作一比对，藉此而产生一变更组件报表，以提供电路设计及布局人员作为人工核对的依据，藉此而确保最后完成的电路布局图为完全正确。
计算机辅助电路设计布局方法

[发明专利]自动选取金属氧化物半导体场效应晶体管的系统及方法-CN200510037019.4无效
发明人：游永兴;曹翔 -专利权人：鸿富锦精密工业（深圳）有限公司;鸿海精密工业股份有限公司
申请日： 2005-09-02 - 公布日： 2007-03-07 - 主分类号： G06F17/50 文献下载
摘要：一种自动选取适用电路设计的金属氧化物半导体场效应晶体管(Metallic Oxide Semiconductor Field EffectTransistor，MOSFET)的系统，包括：一数据库，用于记录不同的MOSFET的规格及产品信息；一电路设计规格接收模块，用于接收电路设计规格；一电路设计规格分析模块，用于分析判断所接收的电路设计规格是否符合电路设计基本要求；一规格计算模块，用于根据所接收的电路设计规格计算适用该电路设计的MOSFET的规格；以及一搜索模块，用于根据计算出的适用该电路设计的MOSFET的规格，在所述数据库中搜索适用该电路设计的MOSFET。
自动选取金属氧化物半导体场效应晶体管系统方法

[发明专利]功能安全保护电路设计文件的生成方法、装置及介质-CN202211497338.3在审
发明人：李天立 -专利权人：北京地平线信息技术有限公司
申请日： 2022-11-25 - 公布日： 2023-04-07 - 主分类号： G06F30/32 文献下载
摘要：公开了一种功能安全保护电路设计文件的生成方法、装置及介质。该方法包括：对被保护电路设计文件进行复制，得到参考电路设计代码；基于被保护电路设计文件中的端口标识和端口类型，确定包括参考电路设计代码和预设电路设计代码的代码集的端口连接信息；基于被保护电路设计文件的第一位宽定义信息和代码集的端口连接信息，确定代码集的第二位宽定义信息；基于代码集、端口连接信息和第二位宽定义信息，生成被保护电路设计文件对应的第一功能安全保护电路设计文件。本公开无需大量人工的参与，即可自动高效地实现功能安全保护电路设计文件的生成，以便据此实现对被保护电路的保护，从而有利于缩短集成电路设计周期，节省开发成本。
功能安全保护电路设计文件生成方法装置介质

[发明专利]电路设计支援方法和电路设计支援系统以及程序记录媒体-CN01802092.5无效
发明人：宇佐美丰 -专利权人：东芝泰格有限公司
申请日： 2001-07-12 - 公布日： 2002-12-18 - 主分类号： G06F17/50 文献下载
摘要：服务系统(12)通过网络(11)将能够选择电路模块的显示信息、能够指定电路模块的参数的显示信息、能够输入电路规格的显示信息向客户终端(13)发送。然后,从客户终端(13)接收电路模块选择信息、指定的参数信息、电路规格信息,并对电路的电气特性进行模拟,将其判断结果发送到客户终端(13)。藉此,能够进行符合客户的技术规格的电路设计。
电路设计支援方法系统以及程序记录媒体

[发明专利]设计感知自适应混合信号仿真-CN202080103470.4在审
发明人： A·科尔佩克沃;K·班纳吉 -专利权人：西门子工业软件有限公司
申请日： 2020-08-25 - 公布日： 2023-04-18 - 主分类号： G06F30/38 文献下载
摘要：一种实施设计验证系统的计算系统，可以基于混合信号电路设计的设计拓扑来对描述电子设备的混合信号电路设计进行分类。该分类可以通过以下步骤执行：识别混合信号电路设计中的顶层设计块，遍历设计层级的连接以识别混合信号电路设计中的较低层设计块，以及基于顶层设计块的设计类型、较低层设计块的设计类型、或混合信号电路设计中的设计块的连接中的至少一者来对混合信号电路设计进行分类该设计验证系统可以基于该分类将混合信号电路设计选择性地划分为模拟分区和数字分区，并用模拟仿真器对混合信号电路设计的模拟分区进行仿真以及用数字仿真器对混合信号电路设计的数字分区进行仿真。
设计感知自适应混合信号仿真