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[发明专利]高性能指令缓存系统和方法-CN201210228129.9有效
发明人：林正浩 -专利权人：上海芯豪微电子有限公司
申请日： 2012-06-27 - 公布日： 2017-01-25 - 主分类号： G06F9/30 文献下载
摘要：一种高性能指令缓存系统和方法，应用于处理器领域时能在处理器核执行指令前，将所述指令填充到所述处理器核能直接访问的高速存储器中，几乎使所述处理器核每次都能在所述高速存储器中获取到需要的指令，达到极高的缓存命中率
性能指令缓存系统方法

[发明专利]提升任务切换效率的方法及终端设备-CN201910942626.7有效
发明人：汤增宏 -专利权人：百富计算机技术（深圳）有限公司
申请日： 2019-09-30 - 公布日： 2022-04-12 - 主分类号： G06F9/38 文献下载
摘要：本发明适用于计算机信息处理技术领域，提供了一种提升任务切换效率的方法及终端设备，该方法包括：通过在操作系统启动时以及操作系统正常运行过程中每次任务切换时，控制CPU的所有协处理器处于禁用状态；当任务运行到协处理器指令时，所述协处理器指令对应的协处理器处于禁用状态，则触发未定义指令异常，执行对应的未定义指令异常处理流程，确定未定义指令属于所述协处理器的指令集范围后，进行所述协处理器的上下文内容信息的保护与恢复，从而可以根据任务需求，按需自动对协处理器的上下文内容信息进行保护与恢复，既提高了任务切换的效率，又能使多个任务共享使用协处理器。
提升任务切换效率方法终端设备

[发明专利]数字数据处理系统中处理器与专用指令处理器间的接口-CN87107291.2无效
发明人：保罗·L·鲁宾费尔德 -专利权人：数字设备公司
申请日： 1987-12-07 - 公布日： 1992-11-18 - 主分类号： G06F13/12 文献下载
摘要：用于一个数字数据处理系统中的处理器及辅助处理器，其辅助处理器处理选定的指令，如浮点指令。通过状态线、数据线及总线将其处理器及辅助处理器相互连接起来，并也可把该系统中其他装置连接到总线上。当该处理器正在处理一个选定指令时，它要在数据线上把该指令的操作代码传送给辅助处理器，并要在该总线上把操作数传送给辅助处理器，同时在数据线上传送每个操作数涉及的信息。然后，该处理器通过状态线发出信号准备接收其处理结果。该辅助处理器执行完该特定指令时，要在状态线上发送代码指示处理结果正在送出，并在数据线上发送状态代码，在总线上发送处理结果数据。
数字数据处理系统处理器专用指令接口

[发明专利]一种处理器测试方法、相关装置和设备-CN201811653379.0在审
发明人：王东;曹庆新 -专利权人：深圳云天励飞技术有限公司
申请日： 2018-12-29 - 公布日： 2020-07-07 - 主分类号： G06F11/26 文献下载
摘要：本公开实施例公开了一种处理器测试方法和装置以及存储介质，该方法包括：获取第一类测试指令，将所述第一类测试指令输入待测试处理器进行测试，并反馈第一覆盖率；所述第一类测试指令包括对处理器进行测试的通用测试指令；获取第二类测试指令，将所述第二类测试指令输入待测试处理器进行测试，并反馈第二覆盖率；所述第二类测试指令包括对所述待测试处理器的指定功能进行测试的指定测试指令。采用本公开实施例，能够快速、高效地测试到处理器所有功能点。
一种处理器测试方法相关装置设备

[发明专利]一种计算任务处理装置、方法及电子设备-CN202180035983.0在审
发明人：徐涛;石洁珂;王晓禹;郑明 -专利权人：华为技术有限公司
申请日： 2021-12-31 - 公布日： 2023-10-03 - 主分类号： G06F9/50 文献下载
摘要：一种计算任务处理装置、方法及电子设备，涉及数据处理技术领域。该装置包括：通用处理器(201)和专用处理器(202)，该通用处理器(201)和该专用处理器(202)之间通过物理接口(203)耦合；该通用处理器(201)，用于通过该物理接口(203)向该专用处理器(202)发送第一指令，该第一指令为该通用处理器(201)的指令集中的指令且用于指示该专用处理器(202)处理第一计算任务；该专用处理器(202)，用于通过该物理接口(203)接收并执行该第一指令，并根据该第一指令处理该第一计算任务这样在该通用处理器(201)为CPU、该专用处理器(202)为NPU时，该CPU能够通过该CPU与该NPU之间耦合的物理接口(203)调度该NPU处理计算任务，而无需通过软件栈和系统总线调度，从而能够降低
一种计算任务处理装置方法电子设备

[发明专利]机器人示教装置、方法和机器人系统-CN202310473001.7在审
发明人：谷岱;张国平;王光能 -专利权人：深圳市大族机器人有限公司
申请日： 2023-04-25 - 公布日： 2023-07-14 - 主分类号： B25J9/00 文献下载
摘要：机器人示教装置包括空间操作件和处理器，空间操作件连接处理器，处理器连接机器人。空间操作件用于接收用户操作指令，将接收到的用户操作指令转化为空间方向指令，并发送至处理器。处理器用于根据空间方向指令控制机器人运动。该机器人示教装置通过使用空间操作件将接收到的用户操作指令转化为空间方向指令并发送至处理器，处理器再根据空间方向指令控制机器人运动，实现了对机器人的示教，并且提高了示教便利性和示教精度。
机器人装置方法系统

[发明专利]超长指令字VLIW的处理器和处理方法-CN201210343250.6有效
发明人：石晶林;朱子元;于亚轩 -专利权人：北京中科晶上科技有限公司
申请日： 2012-09-14 - 公布日： 2013-01-02 - 主分类号： G06F9/30 文献下载
摘要：本发明公开一种超长指令字VLIW的处理器和处理方法，主要为了提供一种取指简便，运行周期短的超长指令字VLIW的处理器和处理方法。本发明超长指令字VLIW的处理器，将对指令进行分组判断进入不同的指令处理通路硬件结构指令选择模块设置在指令寄存器之前，减少了执行装置之前的逻辑电路；配合在指令进入指令寄存器前就通过判断指令的组别信息，把指令存储到相应的指令寄存器装置中存储，分别执行各个指令寄存器中的指令的处理方法，缩短了指令的运行周期。本发明通过将本次并行的指令存放在不同的指令寄存器，简化了后期指令执行过程的复杂度，提高了处理器的频率。
超长指令 vliw 处理器处理方法

[发明专利]一种POWER指令集向量协处理器的译码电路-CN201510777046.9在审
发明人：郭炜;王捷;魏继增 -专利权人：天津大学
申请日： 2015-11-12 - 公布日： 2016-03-23 - 主分类号： G06F9/30 文献下载
摘要：一种POWER指令集向量协处理器的译码电路，第一判断器的输入端连接主处理器的输出端接收指令，判断指令是否为有效指令；第一设置器的输出连接主处理器的输入端，向主处理器反馈指令是有效还是无效，并在收到第一判断器的有效指令信息时，将向量协处理器指令有效标志位置为高，否则为低，发给第二判断器；第二判断器的输入端连接主处理器的输出端，当接收第一设置器的有效信息后判断指令所属的功能执行单元及功能单元所需操作数的数据来源，并送入第二设置器；第二设置器根据第二判断器的判断结果将相应的控制信号及指令所要读取的操作数交给不同的功能执行单元。本发明使功能单元在识别所接收指令的具体指令类型时所需的判断逻辑更为简单。
一种 power 指令向量处理器译码电路

[发明专利]32位微处理器-CN200710037745.5无效
发明人：方建中 -专利权人：黄新亚;方建中
申请日： 2007-03-01 - 公布日： 2008-09-03 - 主分类号： G06F15/78 文献下载
摘要：本发明涉及32位微处理器及其指令集。该微处理器系统包括指令处理器、控制部件、定点运算部件、浮点运算部件、寄存器组、存储器接口部件和输入输出处理器。整个指令周期采用二级流水线，结构简单。系统设置16个32位通用寄存器，分别拥有4GB存储器地址空间和输入输出地址空间。存储器、输入输出处理器与中央处理器之间连接64位数据通路。处理速度达到每时钟周期32位指令流和32位数据流。微处理器系统支持16位、32位、48位三种指令格式，共9种类型，50条指令。其中浮点加、减、乘、除，定点除法，定点求模，浮点与定点之间转化均由指令实现。指令数量精简但功能强大，兼具RISC和CISC的优点。
32 微处理器

[发明专利]预取与外部触发的事件相关联的数据/指令的方法-CN03801236.7无效
发明人：安德烈亚斯·多林 -专利权人：国际商业机器公司
申请日： 2003-02-27 - 公布日： 2005-11-16 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及在系统中预取与外部触发事件相关联的数据/指令的方法，所述系统包括：基础结构(18)，它具有用于接收要由所述基础结构处理的数据/指令的输入接口(20)和用于在数据已被处理之后发送它们的输出接口(22)；存储器(14)，用于当数据/指令被所述输入接口接收时存储数据/指令；处理器(10)，用于处理至少一些所述数据/指令，所述处理器具有高速缓冲存储器，其中数据/指令在被处理之前被存储；外部来源(26)，用于向所述处理器分配序列任务。所述方法包括下列步骤，这些步骤当处理器在执行前一个任务时被执行：确定要由处理器处理的数据/指令在存储器中的位置；向高速缓冲存储器指示这些存储器位置的地址；取得存储器位置的内容和将它们写入高速缓冲存储器中；向处理器分配处理数据/指令的任务。
外部触发事件相关数据指令方法

[发明专利]指令模拟处理器、方法和系统-CN201410098580.2有效
发明人： W·C·拉什;B·L·托尔;S·D·哈恩;G·J·辛顿 -专利权人：英特尔公司
申请日： 2014-03-17 - 公布日： 2017-11-28 - 主分类号： G06F9/455 文献下载
摘要：一方面的处理器包括用于接收第一指令和用于确定第一指令将被模拟的解码逻辑。该处理器还包括与解码逻辑耦合的模拟模式知晓解码后指令处理器逻辑。模拟模式知晓解码后指令处理器逻辑将处理从指令解码的一个或多个控制信号。该指令是用于模拟第一指令的一个或多个指令的集合中的一个指令。模拟模式知晓解码后指令处理器逻辑在处于模拟模式时将与在不处于模拟模式时不同地处理这一个或多个控制信号。还公开了其它装置以及方法和系统。
指令模拟处理器方法系统

[发明专利]使用指令追踪或标出的处理器仿真-CN200980134122.7有效
发明人： A·D·沃克 -专利权人：爱立信电话股份有限公司
申请日： 2009-08-24 - 公布日： 2011-07-20 - 主分类号： G06F17/50 文献下载
摘要：一种有效的周期准确的处理器执行仿真器通过执行借助于在与目标处理器兼容的现有处理器上的执行解决了运行时间相关性的、包括指令的程序执行映像来为目标处理器建模。指令可能已在太复杂而不能建模的I/O环境中的处理器上执行。在一个实施例中，仿真器执行以前直接在处理器上执行的指令。在另一实施例中，标出引擎通过参照在处理器上执行的指令，改变编译的程序映像以消除运行时间相关性。标出程序映像随后由仿真器执行。处理器执行仿真器包括可操作用于周期准确地仿真指令执行的更新引擎和可操作用于为目标处理器的每个通信总线建模的通信引擎。
使用指令追踪标出处理器仿真

[发明专利]基于阵列结构的处理器核心的通信方法及通信装置-CN201010508839.8有效
发明人：谢向辉;李宏亮;过锋;郑方;吕晖;钱磊 -专利权人：无锡江南计算技术研究所
申请日： 2010-10-12 - 公布日： 2012-05-09 - 主分类号： G06F15/167 文献下载
摘要：一种基于阵列结构的处理器核心的通信方法及通信装置。所述基于阵列结构的处理器核心的通信方法包括：发送端处理器核心获取数据发送指令并进行解析；基于所述数据发送指令的解析结果，所述发送端处理器核心从其通用寄存器文件中获取数据，并将所述数据存储到其发送缓冲单元中；发送端处理器核心将其发送缓冲单元中的数据发送至所述数据发送指令指示的目标处理器核心的接收缓冲单元；目标处理器核心获取数据接收指令并进行解析；基于所述数据接收指令的解析结果，所述目标处理器核心从其接收缓冲单元中获取数据，并将数据存储到其通用寄存器文件中。
基于阵列结构处理器核心通信方法装置

[发明专利]具有加速器的数字信号系统及其操作方法-CN200610071507.1有效
发明人：依佛·托塞克;汤米·艾瑞克森;尼可拉斯·皮尔森 -专利权人：威盛电子股份有限公司
申请日： 2006-03-29 - 公布日： 2006-08-16 - 主分类号： G06F9/38 文献下载
摘要：本发明一数字信号处理系统包含一数字信号处理器、至少一加速器以及一连接此数字信号处理器与此至少一加速器的加速器接口。此加速器接口包含一加速器指令总线用以自此数字信号处理器传递指令至此些加速器。当指令是用以存取此些加速器时，此数字信号处理器指定在指令中的一加速器字段，并且当此数字信号处理器选取一特定加速器时，此数字信号处理器更指定在指令中的一加速器识别字段。此指令亦包含用以指示在此数字信号处理器内一缓存器地址的信息以及送给被选取的加速器的命令。
具有加速器数字信号系统及其操作方法

[发明专利]一种基于梯形图语言的逻辑控制器-CN201911317550.5在审
发明人：苏亚杰 -专利权人：江苏三蜂机器人有限公司
申请日： 2019-12-19 - 公布日： 2020-03-17 - 主分类号： G05B19/05 文献下载
摘要：本发明公开了一种基于梯形图语言的逻辑控制器，包括印刷电路板，印刷电路板上焊接安装有处理器模块、内部存储器模块、通信接口模块和外部扩展模块，处理器模块包括主控处理器和专用处理器，专用处理器通过内部交换总线与主控处理器、通信接口模块连接，用户编写的梯形图及指令通过通信接口模块输入专用处理器，专用处理器用于将梯形图及指令表生成主控处理器可识别的目标代码。主控处理器通过内部交换总线与外部扩展模块和通信接口模块连接，主控处理器用于处理通信接口模块和专用处理器传输来的指令，并将处理后的指令传输至内部存储器模块；内部存储器模块用于存储主控处理器发送来的数据；外部扩展模块
一种基于梯形语言逻辑控制器